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單片機(jī)的40個(gè)實(shí)驗(yàn)

  • 基于FPGA的數(shù)字信號處理算法研究與高效實現(xiàn).rar

    現(xiàn)代數(shù)字信號處理對實時性提出了很高的要求,當最快的數(shù)字信號處理器(DSP)仍無法達到速度要求時,唯一的選擇是增加處理器的數(shù)目,或采用客戶定制的門陣列產(chǎn)品。隨著可編程邏輯器件技術(shù)的發(fā)展,具有強大并行處理能力的現(xiàn)場可編程門陣列(FPGA)在成本、性能、體積等方面都顯示出了優(yōu)勢。本文以此為背景,研究了基于FPGA的快速傅立葉變換、數(shù)字濾波、相關(guān)運算等數(shù)字信號處理算法的高效實現(xiàn)。 首先,針對圖像聲納實時性的要求和FPGA片內(nèi)資源的限制,設(shè)計了級聯(lián)和并行遞歸兩種結(jié)構(gòu)的FFT處理器。文中詳細討論了利用流水線技術(shù)和并行處理技術(shù)提高FFT處理器運算速度的方法,并針對蝶形運算的特點提出了一些優(yōu)化和改進措施。 其次,分析了具有相同結(jié)構(gòu)的數(shù)字濾波和相關(guān)運算的特點,采用了有乘法器和無乘法器兩種結(jié)構(gòu)實現(xiàn)乘累加(MAC)運算。無乘法器結(jié)構(gòu)采用分布式算法(DA),將乘法運算轉(zhuǎn)化為FPGA易于實現(xiàn)的查表和移位累加操作,顯著提高了運算效率。此外,還對相關(guān)運算的時域多MAC方法及頻域FFT方法進行了研究。 最后,完成了圖像聲納預(yù)處理模塊。在一片EP2S60上實現(xiàn)了對160路信號的接收、濾波、正交變換以及發(fā)送等處理。實驗表明,本論文所有算法均達到了設(shè)計要求。

    標簽: FPGA 數(shù)字信號處理 算法研究

    上傳時間: 2013-06-09

    上傳用戶:zgu489

  • 基于FPGA的數(shù)字信號發(fā)生器.rar

    數(shù)字信號發(fā)生器是數(shù)字信號處理中不可缺少的調(diào)試設(shè)備。在某工程項目中,為了提供特殊信號,比如雷達信號,就需要設(shè)計專用的數(shù)字信號發(fā)生器,用以達到發(fā)送雷達信號的要求。在本文中提出了使用PCI接口的專用數(shù)字信號發(fā)生器方案。 該方案的目標是能夠采錄雷達信號,把信號發(fā)送到主機作為信號文件存儲起來,然后對這個信號文件進行航跡分離,得到需要的航跡信號文件。同時,信號發(fā)生器具有發(fā)送信號的功能,可以把不同形式的信號文件發(fā)送到檢測端口,用于設(shè)備調(diào)試。 在本文中系統(tǒng)設(shè)計主要分為硬件和軟件兩個方面來介紹: 硬件部分采用了FPGA邏輯設(shè)計加上外圍電路來實現(xiàn)的。在硬件設(shè)計中,最主要的是FPGA邏輯設(shè)計,包括9路主從SPI接口信號的邏輯控制,片外SDRAM的邏輯控制,PCI9054的邏輯控制,以及這些邏輯模塊間信號的同步、發(fā)送和接收。在這個過程中信號的方向是雙向的,所選用的芯片都具有雙向數(shù)據(jù)的功能。 在本文中軟件部分包括驅(qū)動軟件和應(yīng)用軟件。驅(qū)動軟件采用PLXSDK驅(qū)動開發(fā),通過控制PCI總線完成數(shù)據(jù)的采錄和發(fā)送。應(yīng)用軟件中包括數(shù)據(jù)提取和數(shù)據(jù)發(fā)送,采用卡爾曼濾波器等方法。 通過實驗證明該方案完全滿足數(shù)據(jù)傳輸?shù)囊螅_到SPI傳輸?shù)乃俣纫螅軌蛲瓿珊桔E提取,以及數(shù)據(jù)傳輸。

    標簽: FPGA 數(shù)字信號發(fā)生器

    上傳時間: 2013-07-14

    上傳用戶:腳趾頭

  • 基于FPGA的數(shù)據(jù)采集與處理技術(shù)的研究.rar

    目前,數(shù)字信號處理廣泛應(yīng)用于通信、雷達、聲納、語音與圖像處理等領(lǐng)域,信號處理算法理論己趨于成熟,但其具體硬件實現(xiàn)方法卻值得探討。FPGA是近年來廣泛應(yīng)用的超大規(guī)模、超高速的可編程邏輯器件,由于其具有高集成度、高速、可編程等優(yōu)點,大大推動了數(shù)字系統(tǒng)設(shè)計的單片化、自動化,縮短了單片數(shù)字系統(tǒng)的設(shè)計周期、提高了設(shè)計的靈活性和可靠性,在超高速信號處理和實時測控方面有非常廣泛的應(yīng)用。本文對FPGA的數(shù)據(jù)采集與處理技術(shù)進行研究,基于FPGA在數(shù)據(jù)采樣控制和信號處理方面的高性能和單片系統(tǒng)發(fā)展的新熱點,把FPGA作為整個數(shù)據(jù)采集與處理系統(tǒng)的控制核心。主要研究內(nèi)容如下: FPGA的單片系統(tǒng)研究。針對數(shù)據(jù)采集與處理,對FPGA進行選型,設(shè)計了基于FPGA的單片系統(tǒng)的結(jié)構(gòu)。把整個控制系統(tǒng)分為三個部分:多通道采樣控制模塊,數(shù)據(jù)處理模塊,存儲控制模塊。 多通道采樣控制模塊的設(shè)計。利用4片AD7506和一片AD7862對64路模擬量進行周期采樣,分別設(shè)計了通道選擇控制模塊和A/D轉(zhuǎn)換控制模塊,并進行了仿真,完成了基于FPGA的多通道采樣控制。 數(shù)據(jù)處理模塊的設(shè)計。FFT算法在數(shù)字信號處理中占有重要的地位,因此本文研究了FFT的硬件實現(xiàn)結(jié)構(gòu),提出了用FPGA實現(xiàn)FFT的一種設(shè)計思想,給出了總體實現(xiàn)框圖。分別設(shè)計了旋轉(zhuǎn)因子復(fù)數(shù)乘法器,碟形運算單元,存儲器,控制器,并分別進行了仿真。重點設(shè)計實現(xiàn)了FFT算法中的蝶形處理單元,采用了一種高效乘法器算法設(shè)計實現(xiàn)了蝶形處理單元中的旋轉(zhuǎn)因子乘法器,從而提高了蝶形處理器的運算速度,降低了運算復(fù)雜度。理論分析和仿真結(jié)果表明,狀態(tài)機控制器成功地對各個模塊進行了有序、協(xié)調(diào)的控制。 存儲控制模塊的設(shè)計。利用閃存芯片K9K1G08UOA對采集處理后的數(shù)據(jù)進行存儲,設(shè)計了FPGA與閃存的硬件連接,設(shè)計了存儲控制模塊。 本文對FFT算法的硬件實現(xiàn)進行了研究,結(jié)合單片系統(tǒng)的特點,把整個系統(tǒng)分為多通道采樣控制模塊,數(shù)據(jù)處理模塊,存儲控制模塊進行設(shè)計和仿真。設(shè)計采用VHDL編寫程序的源代碼。仿真測試結(jié)果表明,此FPGA單片系統(tǒng)可完成對實時信號的高速采集與處理。

    標簽: FPGA 數(shù)據(jù)采集 處理技術(shù)

    上傳時間: 2013-04-24

    上傳用戶:362279997

  • 基于DSP/FPGA的多波形數(shù)字脈沖壓縮系統(tǒng)硬件的研究與實現(xiàn)

    現(xiàn)代雷達系統(tǒng)廣泛采用脈沖壓縮技術(shù),用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達通過發(fā)射寬脈沖,保證足夠的最大作用距離,而接收時,采用相應(yīng)的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過程。同時,數(shù)字信號處理技術(shù)的迅猛發(fā)展和廣泛應(yīng)用,為雷達脈沖壓縮處理的數(shù)字化實現(xiàn)提供了可能。 本文主要研究雷達多波形頻域數(shù)字脈沖壓縮系統(tǒng)的硬件系統(tǒng)實現(xiàn)。在匹配濾波理論的指導(dǎo)下,成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數(shù)字脈沖壓縮系統(tǒng)。該系統(tǒng)可處理時寬在42μs以內(nèi)、帶寬在5MHz以下的線性調(diào)頻信號(LFM),非線性調(diào)頻信號(NLFM)和Taylor四相碼信號,且技術(shù)指標完全滿足實用系統(tǒng)的設(shè)計要求。 本文完成的主要工作和創(chuàng)新之處有:(1)基于雙通道模數(shù)轉(zhuǎn)換器AD10242設(shè)計高精度數(shù)據(jù)采集電路,為整個脈壓系統(tǒng)的工作提供必要的條件。完成了前端模擬信號輸入電路的優(yōu)化和差分輸入時鐘的產(chǎn)生,以實現(xiàn)高精度采樣。 (2)根據(jù)協(xié)議和脈壓系統(tǒng)的工作要求,以基于FPGAEP1K100QC208完成系統(tǒng)控制,使整個脈壓系統(tǒng)正確穩(wěn)定地工作。同時以該FPGA生成雙口RAM,實現(xiàn)數(shù)據(jù)暫存,以匹配采樣速率和脈壓系統(tǒng)頻率。 (3)設(shè)計基于4片高性能ADSP21160M的緊耦合并行處理系統(tǒng),以完成多波形頻域數(shù)字脈沖壓縮的全部運算工作。4片DSP共享外部總線,且各DSP以鏈路口互連,進行數(shù)據(jù)通信。各DSP還使用一個鏈路口連接到接口板DSP,將脈壓結(jié)果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心,設(shè)計輸出板電路,完成數(shù)據(jù)對齊、求模和數(shù)據(jù)向下一級的輸出,并產(chǎn)生模擬輸出。 (5)調(diào)試并改進處理板和輸出板。

    標簽: FPGA DSP 多波形 壓縮系統(tǒng)

    上傳時間: 2013-06-11

    上傳用戶:qq277541717

  • 基于USB和FPGA技術(shù)的高性能數(shù)據(jù)采集模塊的設(shè)計與實現(xiàn)

    在合成孔徑雷達的研究和研制工作中,合成孔徑雷達模擬技術(shù)具有十分重要的作用。本文以440MHz帶寬線性調(diào)頻信號,采樣頻率500MHz高分辨合成孔徑雷達視頻模擬器為研究對象。首先對模擬器的幾項主要技術(shù)進行分析,在對點目標回波信號模型分析研究的基礎(chǔ)上,對點目標原始回波數(shù)據(jù)進行模擬并做了成像驗證,從而為硬件實現(xiàn)提供了正確的信號模型;針對傳統(tǒng)的“波形存儲直讀法”方案,即在計算機平臺上用模擬軟件產(chǎn)生原始回波數(shù)據(jù)并存儲,再通過計算機接口實現(xiàn)數(shù)據(jù)傳輸,最后完成數(shù)模轉(zhuǎn)換產(chǎn)生視頻信號這一過程,分析指出該方案在實現(xiàn)高分辨率時的速度和容量瓶頸。  針對具體的設(shè)計要求,圍繞速度和容量問題,本文著眼于高分辨率SAR模擬器的FPGA實現(xiàn)研究,指出FPGA實時生成點目標原始回波數(shù)據(jù)是其實現(xiàn)的核心;針對這一核心問題,充分利用現(xiàn)代VLSI設(shè)計中的流水線技術(shù)與并行陣列技術(shù)以及FPGA的優(yōu)良性能和豐富資源,在時間上采用同步流水結(jié)構(gòu)、空間上采用并行陣列形式,將速度和容量問題統(tǒng)一為數(shù)據(jù)的高速生成問題;給出了系統(tǒng)總體設(shè)計思想,該方案不需要大容量存儲器單元,大大減少模擬器復(fù)雜度;對原始回波數(shù)據(jù)實時生成模塊的各主要單元給出了結(jié)構(gòu)并進行了仿真,結(jié)果表明FPGA可以滿足課題設(shè)計要求;同時,對該模擬器片上系統(tǒng)的實現(xiàn)、增強人機交互性,給出了人機界面的設(shè)計思路。  分析指出了點目標原始回波數(shù)據(jù)實時生成模塊通過并行擴展即可實現(xiàn)多點目標的原始回波數(shù)據(jù)實時生成;最后對復(fù)雜場景目標模擬器的實現(xiàn)進行了構(gòu)思,指出了傳統(tǒng)方案在改進的基礎(chǔ)上實現(xiàn)高分辨率視頻模擬器的可行性。本文首次提出以FPGA實現(xiàn)高分辨率合成孔徑雷達原始回波數(shù)據(jù)實時生成的思想,為國內(nèi)業(yè)界在此方向做了一些理論和實踐上的有益探索,對于國內(nèi)高分辨率合成孔徑雷達的研制具有一定的實際意義。

    標簽: FPGA USB 性能 數(shù)據(jù)采集模塊

    上傳時間: 2013-05-26

    上傳用戶:alia

  • 抑制少槽永磁直流電機定位力矩的方法研究

    在永磁直流電機中,即使電樞繞組不通電,由于永磁體產(chǎn)生的磁場同電樞鐵芯的齒槽相互作用而產(chǎn)生轉(zhuǎn)矩,即齒槽定位力矩(CoggingTorque)。定位力矩使電機輸出轉(zhuǎn)矩波動,產(chǎn)生振動及噪聲。文中闡述了產(chǎn)生定位力矩的原理,綜述了包括德昌電機公司的技術(shù)在內(nèi)的抑制定位力矩的方法和研究現(xiàn)狀。抑制定位力矩的方法,主要就是減小電樞旋轉(zhuǎn)過程中氣隙中磁場能量的變化。 文中以少槽永磁直流電機為例,通過有限元分析,以及DOE實驗驗證,對轉(zhuǎn)子沖片增加輔助凹槽、充磁方式和轉(zhuǎn)子沖片不同類型對定位力矩的影響進行了研究,深入分析了沖片輔助凹槽對抑制少槽永磁直流電機定位力矩的作用,結(jié)果表明,同一沖片上在對稱位置上排布輔助凹槽能取得很好的效果,而以沖片中心線對稱地加兩個輔助凹槽時,輔助凹槽角度不同作用不同。對不同沖片,適合的輔助凹槽角度也是不同的。文中找出了一個較成熟的抑制少槽永磁直流電機定位力矩的系統(tǒng)方法,給出了生產(chǎn)中實用的抑制方法,同時通過實驗給出了這些方法對電機性能的影響。 DOE方法能從不同因素中找出對定位力矩起主要作用的變異因素,并且尋找到各變異因素之間的影響作用,給出抑制定位力矩各變量的最佳組合,相比現(xiàn)時生產(chǎn)中的方法,該組合可將定位力矩降低70%。

    標簽: 直流電機 定位 力矩 方法研究

    上傳時間: 2013-07-10

    上傳用戶:ljthhhhhh123

  • 基于ARM的TimeToCount輻射測量儀的研究

    隨著半導(dǎo)體工藝的飛速發(fā)展和芯片設(shè)計水平的不斷進步,ARM微處理器的性能得到大幅度地提高,同時其芯片的價格也在不斷下降,嵌入式系統(tǒng)以其獨有的優(yōu)勢,己經(jīng)廣泛地滲透到科學研究和日常生活的各個方面。 本文以ARM7 LPC2132處理器為核心,結(jié)合蓋革一彌勒計數(shù)管對Time-To-Count輻射測量方法進行研究。ARM結(jié)構(gòu)是基于精簡指令集計算機(RISC)原理而設(shè)計的,其指令集和相關(guān)的譯碼機制比復(fù)雜指令集計算機要簡單得多,使用一個小的、廉價的ARM微處理器就可實現(xiàn)很高的指令吞吐量和實時的中斷響應(yīng)。基于ARM7TDMI-S核的LPC2132微處理器,其工作頻率可達到60MHz,這對于Time-To-Count技術(shù)是非常有利的,而且利用LPC2132芯片的定時/計數(shù)器引腳捕獲功能,可以直接讀取TC中的計數(shù)值,也就是說不再需要調(diào)用中斷函數(shù)讀取TC值,從而大大降低了計數(shù)前雜質(zhì)時間。本文是在我?guī)熜謪诬姷摹禩ime-To-Count測量方法初步研究》基礎(chǔ)上,使用了高速的ARM芯片,對基于MCS-51的Time-To-Count輻射測量系統(tǒng)進行了改進,進一步論證了采用高速ARM處理器芯片可以極大的提高G-M計數(shù)器的測量范圍與測量精度。 首先,討論了傳統(tǒng)的蓋革-彌勒計數(shù)管探測射線強度的方法,并指出傳統(tǒng)的脈沖測量方法的不足。然后討論了什么是Time-To-Count測量方法,對Time-To-Count測量方法的理論基礎(chǔ)進行分析。指出Time-To-Count方法與傳統(tǒng)的脈沖計數(shù)方法的區(qū)別,以及采用Time-To-Count方法進行輻射測量的可行性。 接著,詳細論述基于ARM7 LPC2132處理器的Time-To-Count輻射測量儀的原理、功能、特點以及輻射測量儀的各部分接口電路設(shè)計及相關(guān)程序的編制。 最后得出結(jié)論,通過高速32位ARM處理器的使用,Time-To-Count輻射測量儀的精度和量程均得到很大的提高,對于Y射線總量測量,使用了ARM處理器的Time-To-Count輻射測量儀的量程約為20 u R/h到1R/h,數(shù)據(jù)線性程度也比以前的Time-To-CotJnt輻射測量儀要好。所以在使用Time-To-Count方法進行的輻射測量時,如何減少雜質(zhì)時間以及如何提高計數(shù)前時間的測量精度,是決定Time-To-Count輻射測量儀性能的關(guān)鍵因素。實驗用三只相同型號的J33G-M計數(shù)管分別作為探測元件,在100U R/h到lR/h的輻射場中進行試驗.每個測量點測量5次取平均,得出隨著照射量率的增大,輻射強度R的測量值偏小且與輻射真實值之間的誤差也隨之增大。如果將測量誤差限定在10%的范圍內(nèi),則此儀器的量程范圍為20 u R/h至1R/h,量程跨度近六個數(shù)量級。而用J33型G-M計數(shù)管作常規(guī)的脈沖測量,量程范圍約為50 u R/h到5000 u R/h,充分體現(xiàn)了運用Time-To-Count方法測量輻射強度的優(yōu)越性,也從另一個角度反應(yīng)了隨著計數(shù)前時間的逐漸減小,雜質(zhì)時間在其中的比重越來越大,對測量結(jié)果的影響也就越來越嚴重,盡可能的減小雜質(zhì)時間在Time-To-Count方法輻射測量特別是測量高強度輻射中是關(guān)鍵的。筆者用示波器測出此輻射儀器的雜質(zhì)時間約為6.5 u S,所以在計算定時器值的時候減去這個雜質(zhì)時間,可以增加計數(shù)前時間的精確度。通過實驗得出,在標定儀器的K值時,應(yīng)該在照射量率較低的條件下行,而測得的計數(shù)前時間是否精確則需要在照射量率較高的條件下通過儀器標定來檢驗。這是因為在照射量率較低時,計數(shù)前時間較大,雜質(zhì)時間對測量結(jié)果的影響不明顯,數(shù)據(jù)線斜率較穩(wěn)定,適宜于確定標定系數(shù)K值,而在照射量率較高時,計數(shù)前時間很小,雜質(zhì)時間對測量結(jié)果的影響較大,可以明顯的在數(shù)據(jù)線上反映出來,從而可以很好的反應(yīng)出儀器的性能與量程。實驗證明了Time-To-Count測量方法中最為關(guān)鍵的環(huán)節(jié)就是如何對計數(shù)前時間進行精確測量。經(jīng)過對大量實驗數(shù)據(jù)的分析,得到計數(shù)前時間中的雜質(zhì)時間可分為硬件雜質(zhì)時間和軟件雜質(zhì)時間,并以軟件雜質(zhì)時間為主,通過對程序進行合理優(yōu)化,軟件雜質(zhì)時間可以通過程序的改進而減少,甚至可以用數(shù)學補償?shù)姆椒▉淼窒瑥亩梢缘玫奖容^精確的計數(shù)前時間,以此得到較精確的輻射強度值。對于本輻射儀,用戶可以選擇不同的工作模式來進行測量,當輻射場較弱時,通常采用規(guī)定次數(shù)測量的方式,在輻射場較強時,應(yīng)該選用定時測量的方式。因為,當輻射場較弱時,如果用規(guī)定次數(shù)測量的方式,會浪費很多時間來采集足夠的脈沖信號。當輻射場較強時,由于輻射粒子很多,產(chǎn)生脈沖的頻率就很高,規(guī)定次數(shù)的測量會加大測量誤差,當選用定時測量的方式時,由于時間的相對加長,所以記錄的粒子數(shù)就相對的增加,從而提高儀器的測量精度。通過調(diào)研國內(nèi)外先進核輻射測量儀器的發(fā)展現(xiàn)狀,了解到了目前最新的核輻射總量測量技術(shù)一Time-To-Count理論及其應(yīng)用情況。論證了該新技術(shù)的理論原理,根據(jù)此原理,結(jié)合高速處理器ARM7 LPC2132,對以G-計數(shù)管為探測元件的Time-To-Count輻射測量儀進行設(shè)計。論文以實驗的方法論證了Time-To-Count原理測量核輻射方法的科學性,該輻射儀的量程和精度均優(yōu)于以前以脈沖計數(shù)為基礎(chǔ)理論的MCS-51核輻射測量儀。該輻射儀具有量程寬、精度高、易操作、用戶界面友好等優(yōu)點。用戶可以定期的對儀器的標定,來減小由于電子元件的老化對低儀器性能參數(shù)造成的影響,通過Time-To-Count測量方法的使用,可以極大拓寬G-M計數(shù)管的量程。就儀器中使用的J33型G-M計數(shù)管而言,G-M計數(shù)管廠家參考線性測量范圍約為50 u R/h到5000 u R/h,而用了Time-To-Count測量方法后,結(jié)合高速微處理器ARM7 LPC2132,此核輻射測量儀的量程為20 u R/h至1R/h。在允許的誤差范圍內(nèi),核輻射儀的量程比以前基于MCS-51的輻射儀提高了近200倍,而且精度也比傳統(tǒng)的脈沖計數(shù)方法要高,測量結(jié)果的線性程度也比傳統(tǒng)的方法要好。G-M計數(shù)管的使用壽命被大大延長。 綜上所述,本文取得了如下成果:對國內(nèi)外Time-To-Count方法的研究現(xiàn)狀進行分析,指出了Time-To-Count測量方法的基本原理,并對Time-T0-Count方法理論進行了分析,推導(dǎo)出了計數(shù)前時間和兩個相鄰輻射粒子時間間隔之間的關(guān)系,從數(shù)學的角度論證了Time-To-Count方法的科學性。詳細說明了基于ARM 7 LPC2132的Time-To-Count輻射測量儀的硬件設(shè)計、軟件編程的過程,通過高速微處理芯片LPC2132的使用,成功完成了對基于MCS-51單片機的Time-To-Count測量儀的改進。改進后的輻射儀器具有量程寬、精度高、易操作、用戶界面友好等特點。本論文根據(jù)實驗結(jié)果總結(jié)出了Time-To-Count技術(shù)中的幾點關(guān)鍵因素,如:處理器的頻率、計數(shù)前時間、雜質(zhì)時間、采樣次數(shù)和測量時間等,重點分析了雜質(zhì)時間的組成以及引入雜質(zhì)時間的主要因素等,對國內(nèi)核輻射測量儀的研究具有一定的指導(dǎo)意義。

    標簽: TimeToCount ARM 輻射測量儀

    上傳時間: 2013-06-24

    上傳用戶:pinksun9

  • 基于VB實現(xiàn)PC機與單片機的串行通訊

    本文介紹使用VB6.0開發(fā)工具實現(xiàn)PC機與單片機的串行通訊的基本原理和方法。并結(jié)合具體實例給出使用RS-232接口進行串行通信的基本程序。隨著計算機技術(shù)尤其是單片微型機技術(shù)的發(fā)展,人們已越來越

    標簽: PC機與單片機 串行通訊

    上傳時間: 2013-04-24

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  • AES加、解密算法的FPGA優(yōu)化設(shè)計

    2000年10月2日,美國國家標準與技術(shù)研究所宣布采用Rijndael算法作為高級加密標準,并于2002年5月26日正式生效,AES算法將在今后很長一段時間內(nèi),在信息安全中扮演重要角色。因此,對AES算法實現(xiàn)的研究就成為了國內(nèi)外的熱點,會在信息安全領(lǐng)域得到廣泛的應(yīng)用。用FPGA實現(xiàn)AES算法具有快速、靈活、開發(fā)周期短等優(yōu)點。 本論文就是針對AES加、解密算法在同一片F(xiàn)PGA中的優(yōu)化實現(xiàn)問題,在深入分析了AES算法的整體結(jié)構(gòu)、基本變換以及加、解密流程的基礎(chǔ)上,對AES算法的加、解密系統(tǒng)的FPGA優(yōu)化設(shè)計進行了研究。主要內(nèi)容為: 1.確定了實現(xiàn)方案以及關(guān)鍵技術(shù),在比較了常用的結(jié)構(gòu)后,采用了適合高速并行實現(xiàn)AES加、解密算法的結(jié)構(gòu)——內(nèi)外混合的流水線結(jié)構(gòu),并給出了總體的設(shè)計框圖。由于流水線結(jié)構(gòu)不適用于反饋模式,為了達到較高的運算速度,該系統(tǒng)使用的是電碼本模式(ECB)的工作方式; 2.對各個子模塊的設(shè)計分別予以詳細分析,結(jié)合算法本身和FPGA的特點,采用查表法優(yōu)化處理了字節(jié)代換運算,列混合運算和密鑰擴展運算。同時,考慮到應(yīng)用環(huán)境的不同,本設(shè)計支持數(shù)據(jù)分組為128比特,密鑰長度為128比特、192比特以及256比特三種模式下的AES算法加、解密過程。完成了AES加、解密算法在同一片F(xiàn)PGA中實現(xiàn)的這個系統(tǒng)的優(yōu)化設(shè)計; 3.利用QLJARTUSII開發(fā)工具進行代碼的編寫工作和綜合編譯工作,在 MODELSIM中進行仿真并給出仿真結(jié)果,給出了各個模塊和整個設(shè)計的仿真測試結(jié)果; 4.和其他類似的設(shè)計做了橫向?qū)Ρ龋贸鼋Y(jié)論:本設(shè)計在保證了速度的基礎(chǔ)上實現(xiàn)了資源和速度的均衡,在性能上具有較大的優(yōu)勢。

    標簽: FPGA AES 解密 算法

    上傳時間: 2013-05-25

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  • 基于FPGA的視頻圖像檢測技術(shù)

    在圖像處理及檢測系統(tǒng)中,實時性要求往往影響著系統(tǒng)處理速度的性能。本文在分析研究視頻檢測技術(shù)及方法的基礎(chǔ)上,應(yīng)用嵌入式系統(tǒng)設(shè)計和圖像處理技術(shù),以交通信息視頻檢測系統(tǒng)為研究背景,展開了基于FPGA視頻圖像檢測技術(shù)的研究與應(yīng)用,通過系統(tǒng)仿真驗證了基于FPGA架構(gòu)的圖像并行處理和檢測系統(tǒng)具有較高的實時處理能力,能夠準確并穩(wěn)定地檢測出運動目標的信息。可見FPGA對提高視頻檢測及處理的實時性是一個較好的選擇。 本文主要研究的內(nèi)容有: 1.分析研究了視頻圖像檢測技術(shù),針對傳統(tǒng)基于PC構(gòu)架和DSP處理器的視頻檢測系統(tǒng)的弊端,并從可靠性、穩(wěn)定性、實時性和開發(fā)成本等因素考慮,提出了以FPGA芯片作為中央處理器的嵌入式并行數(shù)據(jù)處理系統(tǒng)的設(shè)計方案。 2.應(yīng)用模塊化的硬件設(shè)計方法,構(gòu)建了新一代嵌入式視頻檢測系統(tǒng)的硬件平臺。該系統(tǒng)由異步FIFO模塊、圖像空間轉(zhuǎn)換模塊、SRAM幀存控制模塊、圖像預(yù)處理模塊和圖像檢測模塊等組成,較好地解決了圖像采樣存儲、處理和傳輸?shù)膯栴},并為以后系統(tǒng)功能的擴展奠定了良好的基礎(chǔ)。 3.在深入研究了線性與非線性濾波幾種圖像處理算法,分析比較了各自的優(yōu)缺點的基礎(chǔ)上,本文提出一種適合于FPGA的快速圖像中值濾波算法,并給出該算法的硬件實現(xiàn)結(jié)構(gòu)圖,應(yīng)用VHDL硬件描述語言編程、實現(xiàn),仿真結(jié)果表明,快速中值濾波算法的處理速度較傳統(tǒng)算法提高了50%,更有效地降低了系統(tǒng)資源占用率和提高了系統(tǒng)運算速度,增強了檢測系統(tǒng)的實時性能。 4.研究了基于視頻的交通車流量檢測算法,重點討論背景差分法,圖像二值化以及利用直方圖分析方法確定二值化的閾值,并對圖像進行了直方圖均衡處理,提高圖像檢測精度。并結(jié)合嵌入式系統(tǒng)處理技術(shù),在FPGA系統(tǒng)上研究設(shè)計了這些算法的硬件實現(xiàn)結(jié)構(gòu),用VHDL語言實現(xiàn),并對各個模塊及相應(yīng)算法做出了功能仿真和性能分析。 5.系統(tǒng)仿真與驗證是整個FPGA設(shè)計流程中最重要的步驟,針對現(xiàn)有仿真工具用手動設(shè)置輸入波形工作量大等弊病,本文提出了一種VHDL測試基準(TestBench)方法解決系統(tǒng)輸入源仿真問題,用TEXTIO程序包設(shè)計了MATLAB與FPGA仿真軟件的接口,很好地解決了仿真測試中因測試向量龐大而難以手動輸入的問題。并將系統(tǒng)的仿真結(jié)果數(shù)據(jù)在MATLAB上還原為圖像,方便了系統(tǒng)測試結(jié)果的分析與調(diào)試。系統(tǒng)測試的結(jié)果表明,運動目標的檢測基本符合要求,可以排除行走路人等移動物體(除車輛外)的噪聲干擾,有效地檢測出正確的目標。 本文主要研究了基于FPGA片上系統(tǒng)的圖像處理及檢測技術(shù),針對FPGA技術(shù)的特點對某些算法提出了改進,并在MATLAB、QuartusⅡ和ModelSim軟件開發(fā)平臺上仿真實現(xiàn),仿真結(jié)果達到預(yù)期目標。本文的研究對智能化交通監(jiān)控系統(tǒng)的車流量檢測做了有益探索,對其他場合的圖像高速處理及檢測也具有一定的參考價值。

    標簽: FPGA 視頻圖像 檢測技術(shù)

    上傳時間: 2013-07-13

    上傳用戶:woshiayin

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