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同步系統(tǒng)

  • GB-T 2471-1995 電阻器和電容器優先數系.pdf

    國標類相關專輯 313冊 701MGB-T 2471-1995 電阻器和電容器優先數系.pdf

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    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • 電動汽車永磁同步電動機及其控制器研究.rar

    20世紀90年代以來,為了緩解能源和環境對人類生活和社會發展的壓力,世界各國都投入了大量資金開發電動汽車。在日本、美國、法國等汽車強國已經開發出一些商品化的電動汽車。我國在“十五”期間,國家電動汽車重大科技專項確立以燃料電池汽車、混合電動汽車、純電動汽車以及相關的多能源動力總成控制、驅動電機、動力蓄電池及燃料電池等關鍵零部件研發。 與其它驅動電機相比,永磁同步電動機具有高效率、高功率密度和良好的控制特性,受到人們的普遍關注,越來越多地應用于電動汽車的驅動裝置中。本文課題以印度REVA公司小型純電動汽車驅動用永磁同步電動機及其控制器為研究對象,對永磁同步電動機本體及控制器硬件進行了比較深入的研究,設計并制作了永磁同步電動機試驗樣機以及基于TMS320LF2407A DSP的永磁同步電動機控制器,在此基礎上展開了初步試驗研究。 本文首先比較了當前常用電動汽車驅動電機的特點,并綜述了電力電子和計算機控制技術在汽車驅動中的應用;然后分析永磁同步電機氣隙磁場對電機性能的影響,針對電動汽車驅動電機的特點,提出了T形轉子永磁同步電動機,不僅使永磁同步電動機的氣隙磁場接近正弦同時解決了高速運行時磁鋼的固定問題;同時,制作了基于TMS320LF2407A DSP和IPM模塊的永磁同步電動機矢量控制器,并對控制器進行了驅動無刷直流電動機的負載實驗和永磁同步電機的空載實驗;最后,分析永磁同步電機矢量控制的數學模型,并建立了永磁同步電機的SVPWM驅動的仿真模型,進行了id=0的矢量控制系統仿真,研究了永磁同步電機參數對系統動態響應的影響。

    標簽: 電動汽車 永磁同步電動機 控制器

    上傳時間: 2013-07-23

    上傳用戶:cooran

  • 永磁同步直線電機的矢量控制.rar

    本文分析了永磁同步直線電動機的運行機理與運行特性,并通過坐標變換,分別得出了電機在a—b—c,α—β、d—q坐標系下的數學模型。針對永磁同步直線電機模型的非線性與耦合特性,采用了次級磁場定向的矢量控制,并使id=0,不但解決了上述問題,還實現了最大推力電流比控制。為了獲得平穩的推力,采用了SVPWM控制,并對它算法實現進行了研究。 針對速度環采用傳統PID控制難以滿足高性能矢量控制系統,通過對傳統PID控制和模糊控制理論的研究,將兩者相結合,設計出能夠在線自整定的模糊PID控制器。將該控制器代替傳統的PID控制器應用于速度環,以提高系統的動靜態性能。 在以上分析的基礎上,設計了永磁同步直線電機矢量控制系統的軟、硬件。其中電流檢測采用了新穎的電流傳感器芯片IR2175,以解決溫漂問題;速度檢測采用了增量式光柵尺,設計了與DSP的接口電路,通過M/T法實現對電機的測速。最后在Matlab/Simlink下建立了電機及其矢量控制系統的仿真模型,并對分別采用傳統PID速度控制器和模糊PID速度控制器的系統進行仿真,結果表明采用模糊PID控制具有更好的動態響應性能,能有效的抑制暫態和穩態下的推力脈動,對于負載擾動具有較強的魯棒性。

    標簽: 永磁同步 直線電機 矢量控制

    上傳時間: 2013-07-04

    上傳用戶:13681659100

  • 基于FPGA的全彩色LED同步顯示屏控制系統的設計.rar

    LED顯示屏作為一項高新科技產品正引起人們的高度重視,它以其動態范圍廣,亮度高,壽命長,工作性能穩定而日漸成為顯示媒體中的佼佼者,現已廣泛應用于廣告、證券、交通、信息發布等各方面,且隨著全彩屏顯示技術的日益完善,LED顯示屏有著廣闊的市場前景。 本文主要研究的對象為全彩色LED同步顯示屏控制系統,提出了一個系統實現方案,整個系統分三部分組成:DVI解碼電路、發送系統以及接收系統。DVI解碼模塊用于從顯卡的DVI口獲取視頻源數據,經過T.D.M.S.解碼恢復出可供LED屏顯示的紅、綠、藍共24位像素數據和一些控制信號。發送系統用于將收到的數據流進行緩存,經處理后發送至以太網芯片進行以太網傳輸。接收系統接收以太網上傳來的視頻數據流,經過位分離操作后存入SRAM進行緩存,再串行輸入至LED顯示屏進行掃描顯示。然后,從多方面論述了該方案的可行性,仔細推導了LED顯示屏各技術參數之間的聯系及約束關系。 本課題采用可編程邏輯器件來完成系統功能,可編程邏輯器件具有高集成度、高速度、在線可編程等特點,不僅可以滿足高速圖像數據處理對速度的要求,而且增加了設計的靈活性,不需修改電路硬件設計,縮短了設計周期,還可以進行在線升級。

    標簽: FPGA LED 全彩色

    上傳時間: 2013-04-24

    上傳用戶:西伯利亞

  • 基于FPGA的全同步數字頻率計的設計.rar

    頻率是電子技術領域內的一個基本參數,同時也是一個非常重要的參數。穩定的時鐘在高性能電子系統中有著舉足輕重的作用,直接決定系統性能的優劣。隨著電子技術的發展,測頻系統使用時鐘的提高,測頻技術有了相當大的發展,但不管是何種測頻方法,±1個計數誤差始終是限制測頻精度進一步提高的一個重要因素。 本設計闡述了各種數字測頻方法的優缺點。通過分析±1個計數誤差的來源得出了一種新的測頻方法:檢測被測信號,時基信號的相位,當相位同步時開始計數,相位再次同步時停止計數,通過相位同步來消除計數誤差,然后再通過運算得到實際頻率的大小。根據M/T法的測頻原理,已經出現了等精度的測頻方法,但是還存在±1的計數誤差。因此,本文根據等精度測頻原理中閘門時間只與被測信號同步,而不與標準信號同步的缺點,通過分析已有等精度澳孽頻方法所存在±1個計數誤差的來源,采用了全同步的測頻原理在FPGA器件上實現了全同步數字頻率計。根據全同步數字頻率計的測頻原理方框圖,采用VHDL語言,成功的編寫出了設計程序,并在MAX+PLUS Ⅱ軟件環境中,對編寫的VHDL程序進行了仿真,得到了很好的效果。最后,又討論了全同步頻率計的硬件設計并給出了電路原理圖和PCB圖。對構成全同步數字頻率計的每一個模塊,給出了較詳細的設計方法和完整的程序設計以及仿真結果。

    標簽: FPGA 數字頻率計

    上傳時間: 2013-06-05

    上傳用戶:wys0120

  • 基于FPGA的海事衛星突發信號位同步檢測研究及實現.rar

    碼元定時恢復(位同步)技術是數字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發傳輸系統,快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數據接收系統為背景,研究了突發通信傳輸模式下的全數字接收機中位同步方法,并予以實現。 本文系統地論述了位同步原理,在此基礎上著重研究了位同步的系統結構、碼元定時恢復算法以及衡量系統性能的各項指標,為后續工作奠定了基礎。 首先根據衛星系統突發信道傳輸的特點分析了傳統位同步方法在突發系統中的不足,接下來對Inmarsat系統的短突發R信道和長突發T信道的調制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發形式下的位同步,并在FPGA上予以實現,效果良好。 在長突發形式下的報頭時鐘捕獲后還需要對后續數據進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現了插值環路的位同步算法,進行了Matlab仿真和FPGA實現。并在插值環路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發信道位同步跟蹤。 論文對兩個突發信道的位同步系統進行了理論研究、算法設計以及硬件實現的全過程,滿足系統要求。

    標簽: FPGA 海事衛星 信號

    上傳時間: 2013-04-24

    上傳用戶:yare

  • 基于ARM架構的μCOS-Ⅱ移植及其實時同步交流采樣研究

    隨著微處理器技術與信息技術的不斷發展,嵌入式系統的應用也進入到國防、工業、能源、交通以及日常生活中的各個領域。嵌入式系統的軟件核心是嵌入式操作系統。然而,國內在嵌入式系統軟件開發上有很多困難,主要有:國外成熟的RTOS大都價格昂貴并且不公開源代碼,用好這些操作系統需對計算機體系結構有深刻理解。針對以上問題,免費公開源代碼的嵌入式操作系統就倍受矚目了,μC/OS-II就是其中之一。μC/OS-II是面向中小型應用的、基于優先級的可剝奪嵌入式實時內核,其特點是小巧、性能穩定、可免費獲得源代碼。 本文在深入研究μC/OS-II內核基礎上,將其運用于實際課題,完成了基于ARM架構的μC/OS-II移植及實時同步交流采樣的誤差補償研究。本文主要工作內容和研究成果如下: 1.剖析了μC/OS-II操作系統內核,重點研究了μC/OS-II內核的任務管理與調度算法機理,得出了μC/OS-II內核優點:任務調度算法簡潔、高效、實時性較好(與Linux相比)。 2.介紹了ARM9體系架構,重點講敘了MMU(存儲管理單元)功能。為了提高交流采樣系統的取指令和讀數據速度,成功將MMU功能應用于本嵌入式系統中。 3.完成了μC/OS-II操作系統在目標板上的移植,主要用匯編語言編寫了啟動代碼、開關中斷、任務切換和首次任務切換等函數。 4.針對國內外提出的同步交流采樣誤差補償算法的局限性,本文從理論上對同步交流采樣的準確誤差進行了研究,并嘗試根據被測信號周期的首尾過零點的三角形相似法,求出誤差參數并對誤差進行補償。此外,考慮到采樣周期△T不均勻,經多次采樣后會產生累積誤差,本文也給出了采樣周期△T的優化算法。 5.完成了系統硬件設計,并根據補償算法和△T優化法則,編寫了相應采樣驅動和串口驅動。最后對實驗數據進行了分析和比較,得出重要結論:該補償算法實現簡單,計算機工作量小,精度較高。

    標簽: ARM COS 架構 交流采樣

    上傳時間: 2013-04-24

    上傳用戶:xzt

  • 基于FPGA的全彩色LED同步顯示屏

    LED顯示屏作為一項高新科技產品正引起人們的高度重視,它以其動態范圍廣,亮度高,壽命長,工作性能穩定而日漸成為顯示媒體中的佼佼者,現已廣泛應用于廣告、證券、交通、信息發布等各方面,且隨著全彩屏顯示技術的日益完善,LED顯示屏有著廣闊的市場前景。 本文主要研究的對象為全彩色LED同步顯示屏控制系統,提出了一個系統實現方案,整個系統分三部分組成:DVI解碼電路、發送系統以及接收系統。DVI解碼模塊用于從顯卡的DVI口獲取視頻源數據,經過T.D.M.S.解碼恢復出可供LED屏顯示的紅、綠、藍共24位像素數據和一些控制信號。發送系統用于將收到的數據流進行緩存,經處理后發送至以太網芯片進行以太網傳輸。接收系統接收以太網上傳來的視頻數據流,經過位分離操作后存入SRAM進行緩存,再串行輸入至LED顯示屏進行掃描顯示。然后,從多方面論述了該方案的可行性,仔細推導了LED顯示屏各技術參數之間的聯系及約束關系。 本課題采用可編程邏輯器件來完成系統功能,可編程邏輯器件具有高集成度、高速度、在線可編程等特點,不僅可以滿足高速圖像數據處理對速度的要求,而且增加了設計的靈活性,不需修改電路硬件設計,縮短了設計周期,還可以進行在線升級。

    標簽: FPGA LED 全彩色 同步顯示

    上傳時間: 2013-06-22

    上傳用戶:jennyzai

  • 海事衛星突發信號位同步檢測

    碼元定時恢復(位同步)技術是數字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發傳輸系統,快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數據接收系統為背景,研究了突發通信傳輸模式下的全數字接收機中位同步方法,并予以實現。 本文系統地論述了位同步原理,在此基礎上著重研究了位同步的系統結構、碼元定時恢復算法以及衡量系統性能的各項指標,為后續工作奠定了基礎。 首先根據衛星系統突發信道傳輸的特點分析了傳統位同步方法在突發系統中的不足,接下來對Inmarsat系統的短突發R信道和長突發T信道的調制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發形式下的位同步,并在FPGA上予以實現,效果良好。 在長突發形式下的報頭時鐘捕獲后還需要對后續數據進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現了插值環路的位同步算法,進行了Matlab仿真和FPGA實現。并在插值環路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發信道位同步跟蹤。 論文對兩個突發信道的位同步系統進行了理論研究、算法設計以及硬件實現的全過程,滿足系統要求。

    標簽: 海事衛星 信號 位同步 檢測

    上傳時間: 2013-04-24

    上傳用戶:zukfu

  • 基于FPGA的全同步數字頻率計的設計

    頻率是電子技術領域內的一個基本參數,同時也是一個非常重要的參數。穩定的時鐘在高性能電子系統中有著舉足輕重的作用,直接決定系統性能的優劣。隨著電子技術的發展,測頻系統使用時鐘的提高,測頻技術有了相當大的發展,但不管是何種測頻方法,±1個計數誤差始終是限制測頻精度進一步提高的一個重要因素。 本設計闡述了各種數字測頻方法的優缺點。通過分析±1個計數誤差的來源得出了一種新的測頻方法:檢測被測信號,時基信號的相位,當相位同步時開始計數,相位再次同步時停止計數,通過相位同步來消除計數誤差,然后再通過運算得到實際頻率的大小。根據M/T法的測頻原理,已經出現了等精度的測頻方法,但是還存在±1的計數誤差。因此,本文根據等精度測頻原理中閘門時間只與被測信號同步,而不與標準信號同步的缺點,通過分析已有等精度澳孽頻方法所存在±1個計數誤差的來源,采用了全同步的測頻原理在FPGA器件上實現了全同步數字頻率計。根據全同步數字頻率計的測頻原理方框圖,采用VHDL語言,成功的編寫出了設計程序,并在MAX+PLUS Ⅱ軟件環境中,對編寫的VHDL程序進行了仿真,得到了很好的效果。最后,又討論了全同步頻率計的硬件設計并給出了電路原理圖和PCB圖。對構成全同步數字頻率計的每一個模塊,給出了較詳細的設計方法和完整的程序設計以及仿真結果。

    標簽: FPGA 數字頻率計

    上傳時間: 2013-04-24

    上傳用戶:qqoqoqo

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