附件為天正建筑8.0單機版安裝程序，內含天正建筑8.0單機版破解文件和天正注冊機。 天正建筑8.0免費下載TArch 8采用了全新的開發(fā)技術，對軟件技術核心進行了全面的提升，特別在自定義對象核心技術方面取得了革命性突破！傳統(tǒng)的以自定義對象為基礎的建筑軟件每次大版本的升級都會造成文件格式不兼容，TArch8引入了動態(tài)數據擴展的技術解決方案，突破了這一限制。以這一開放性技術創(chuàng)新為基礎，用戶再也不需要為之后大版本升級的文件格式兼容問題而煩惱，同時，這也必將極大地促進設計行業(yè)圖紙交流問題的解決。 天正建筑8.0是為 cad 2008 而準備的 計算機輔助設計而量身定制軟件工具。是CAD更加強大。 軟件功能設計的目標定位 天正建筑8.0應用專業(yè)對象技術，在三維模型與平面圖同步完成的技術基礎上，進一步滿足建筑施工圖需要反復修改的要求。 利用天正專業(yè)對象建模的優(yōu)勢，為規(guī)劃設計的日照分析提供日照分析模型(如下圖)和遮擋模型；為強制實施的建筑節(jié)能設計提供節(jié)能建筑分析模型。實現高效化、智能化、可視化始終是天正建筑CAD軟件的開發(fā)目標。 自定義對象構造專業(yè)構件 天正建筑8.0開發(fā)了一系列自定義對象表示建筑專業(yè)構件，具有使用方便、通用性強的特點。例如各種墻體構件具有完整的幾何和材質特征。可以像AutoCAD的普通圖形對象一樣進行操作， 可以用夾點隨意拉伸改變幾何形狀，與門窗按相互關系智能聯(lián)動（如下圖），顯著提高編輯效率。具有舊圖轉換的文件接口，可將TArch 3以下版本天正軟件繪制的圖形文件轉換為新的對象格式，方便原有用戶的快速升級。同時提供了圖形導出命令的文件接口，可將TArch 8.0 新版本繪制的圖形導出，作為下行專業(yè)條件圖使用。
上傳時間： 2013-10-23
上傳用戶：獨孤求源
本文是基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現（英文資料）
上傳時間： 2013-10-27
上傳用戶：yzy6007
關于Verilog中的可綜合語句和不可綜合語句的匯總介紹
標簽： verilog
上傳時間： 2013-11-27
上傳用戶：squershop
針對調制樣式在不同環(huán)境下的變化，采用了FPGA部分動態(tài)可重構的新方法，通過對不同調制樣式信號的解調模塊的動態(tài)加載，來實現了不同環(huán)境下針對不同調制樣式的解調。這種方式比傳統(tǒng)的設計方式具有更高的靈活性、可擴展性，并減低了成本和功耗。該設計方案同時也介紹了FPGA部分動態(tài)可重構的概念和特點，可以對其它通信信號處理系統(tǒng)設計提供一定的參考。
標簽： FPGA 部分動態(tài)可重構 信號解調系統(tǒng)
上傳時間： 2013-10-22
上傳用戶：liangliang123
EDA （Electronic Design Automation）即“電子設計自動化”，是指以計算機為工作平臺，以EDA軟件為開發(fā)環(huán)境，以硬件描述語言為設計語言，以可編程器件PLD為實驗載體(包括CPLD、FPGA、EPLD等)，以集成電路芯片為目標器件的電子產品自動化設計過程?！肮び破涫拢叵壤淦鳌?，因此，EDA工具在電子系統(tǒng)設計中所占的份量越來越高。下面就介紹一些目前較為流行的EDA工具軟件。 PLD 及IC設計開發(fā)領域的EDA工具，一般至少要包含仿真器（Simulator）、綜合器（Synthesizer）和配置器（Place and Routing, P&R）等幾個特殊的軟件包中的一個或多個，因此這一領域的EDA工具就不包括Protel、PSpice、Ewb等原理圖和PCB板設計及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法：一種是按公司類別進行分類，另一種是按功能進行劃分。 若按公司類別分，大體可分兩類：一類是EDA 專業(yè)軟件公司，業(yè)內最著名的三家公司是Cadence、Synopsys和Mentor Graphics；另一類是PLD器件廠商為了銷售其產品而開發(fā)的EDA工具，較著名的公司有Altera、Xilinx、lattice等。前者獨立于半導體器件廠商，具有良好的標準化和兼容性，適合于學術研究單位使用，但系統(tǒng)復雜、難于掌握且價格昂貴；后者能針對自己器件的工藝特點作出優(yōu)化設計，提高資源利用率，降低功耗，改善性能，比較適合產品開發(fā)單位使用。 若按功能分，大體可以分為以下三類。 (1) 集成的PLD/FPGA開發(fā)環(huán)境 由半導體公司提供，基本上可以完成從設計輸入（原理圖或HDL）→仿真→綜合→布線→下載到器件等囊括所有PLD開發(fā)流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ，Xilinx公司的ISE，Lattice公司的 ispDesignExpert等。其優(yōu)勢是功能全集成化，可以加快動態(tài)調試，縮短開發(fā)周期；缺點是在綜合和仿真環(huán)節(jié)與專業(yè)的軟件相比，都不是非常優(yōu)秀的。 (2) 綜合類 這類軟件的功能是對設計輸入進行邏輯分析、綜合和優(yōu)化，將硬件描述語句（通常是系統(tǒng)級的行為描述語句）翻譯成最基本的與或非門的連接關系（網表），導出給PLD/FPGA廠家的軟件進行布局和布線。為了優(yōu)化結果，在進行較復雜的設計時，基本上都使用這些專業(yè)的邏輯綜合軟件，而不采用廠家提供的集成PLD/FPGA開發(fā)工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類 這類軟件的功能是對設計進行模擬仿真，包括布局布線（P&R）前的“功能仿真”（也叫“前仿真”）和P&R后的包含了門延時、線延時等的“時序仿真”（也叫“后仿真”）。復雜一些的設計，一般需要使用這些專業(yè)的仿真軟件。因為同樣的設計輸入，專業(yè)軟件的仿真速度比集成環(huán)境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim，Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。 以上介紹了一些具代表性的EDA 工具軟件。它們在性能上各有所長，有的綜合優(yōu)化能力突出，有的仿真模擬功能強，好在多數工具能相互兼容，具有互操作性。比如Altera公司的 QuartusII集成開發(fā)工具，就支持多種第三方的EDA軟件，用戶可以在QuartusII軟件中通過設置直接調用Modelsim和 Synplify進行仿真和綜合。 如果設計的硬件系統(tǒng)不是很大，對綜合和仿真的要求不是很高，那么可以在一個集成的開發(fā)環(huán)境中完成整個設計流程。如果要進行復雜系統(tǒng)的設計，則常規(guī)的方法是多種EDA工具協(xié)調工作，集各家之所長來完成設計流程。
上傳時間： 2013-10-11
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針對重構文件的大小、動態(tài)容錯時隙的長短、實現的復雜性、模塊間通信方式、冗余資源的比例與布局等關鍵問題進行了分析。并對一些突出問題,提出了基于算法和資源多級分塊的解決方法,闡述了新方法的性能,及其具有的高靈活性高、粒度等參數可選擇、重構布線可靠性高、系統(tǒng)工作頻率有保障的優(yōu)點。
標簽： FPGA 動態(tài)可重構 容錯 技術研究
上傳時間： 2013-11-23
上傳用戶：cylnpy
WP369可擴展式處理平臺-各種嵌入式系統(tǒng)的理想解決方案 ：Delivering unrivaled levels of system performance,flexibility, scalability, and integration to developers,Xilinx's architecture for a new Extensible Processing Platform is optimized for system power, cost, and size. Based on ARM's dual-core Cortex™-A9 MPCore processors and Xilinx’s 28 nm programmable logic,the Extensible Processing Platform takes a processor-centric approach by defining a comprehensive processor system implemented with standard design methods. This approach provides Software Developers a familiar programming environment within an optimized, full featured,powerful, yet low-cost, low-power processing platform.
上傳時間： 2013-10-18
上傳用戶：cursor
本文簡單探討了verilog HDL設計中的可綜合性問題，適合HDL初學者閱讀 用組合邏輯實現的電路和用時序邏輯實現的 電路要分配到不同的進程中。 不要使用枚舉類型的屬性。 Integer應加范圍限制。 通常的可綜合代碼應該是同步設計。 避免門級描述，除非在關鍵路徑中。
上傳時間： 2013-11-18
上傳用戶：swaylong
賽靈思的新型可擴展式處理平臺架構可為開發(fā)人員提供無與倫比的系統(tǒng)性能、靈活性、可擴展性和集成度，并為降低系統(tǒng)功耗、成本和縮小尺寸進行了精心優(yōu)化。 可擴展式處理平臺基于 ARM 的雙核 Cortex™-A9MPCore 處理器以及賽靈思的 28nm 可編程邏輯之上，采用以處理器為核心的設計方案，并能定義通過標準設計方法實施的綜合處理器系統(tǒng)。這種方案可為軟件開發(fā)人員在功能齊備且強大的優(yōu)化型低成本低功耗處理平臺上提供熟悉的編程環(huán)境。
上傳時間： 2013-11-02
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介紹了,JB-30B型沖擊試驗機的工作原理，并運用西門子S7-200小型可編程序控制器（012）代替沖擊試驗機的繼電接觸控制系統(tǒng)，實現對原電器系統(tǒng)的改造。［關鍵詞］PLC；電氣控制系統(tǒng)；改造
標簽： 可編程序控制器 中的應用 電氣控制系統(tǒng)
上傳時間： 2013-10-23
上傳用戶：yuchunhai1990
