FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能，臺(tái)灣人寫(xiě)的，關(guān)于FPGA應(yīng)用的技術(shù)文章
標(biāo)簽： FPGA 嵌入式 系統(tǒng) 性能
上傳時(shí)間： 2013-08-20
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功能：返回雙精度參數(shù)的反全余弦的三角函數(shù)值 返回返回雙精度參數(shù)y和x的數(shù)值由公式y(tǒng)/x計(jì)算的反正切三角函數(shù)值
標(biāo)簽： 精度 參數(shù) 三角函數(shù) 數(shù)值
上傳時(shí)間： 2014-10-31
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LVDS技術(shù)： 低電壓差分訊號(hào)(LVDS)在對(duì)訊號(hào)完整性、低抖動(dòng)及共模特性要求較高的系統(tǒng)中得到了廣泛的應(yīng)用。本文針對(duì)LVDS與其他幾種介面標(biāo)準(zhǔn)之間的連接，對(duì)幾種典型的LVDS介面電路進(jìn)行了討論
上傳時(shí)間： 2014-01-13
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用C++中的MFC編程實(shí)現(xiàn)高斯投影正算和反算 即已知經(jīng)緯度求X,Y 已知X,Y求經(jīng)緯度
標(biāo)簽： MFC 編程實(shí)現(xiàn) 投影 正
上傳時(shí)間： 2016-02-17
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用TIGER SHARC DSP201實(shí)現(xiàn)反正切函數(shù),atan2(y,x) 高精度
標(biāo)簽： TIGER SHARC atan DSP
上傳時(shí)間： 2016-05-11
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摘要:分析了影響同步電動(dòng)機(jī)矢m:控制電流控制環(huán)動(dòng)態(tài)特性的主要因索.指出同步電動(dòng)機(jī)反電動(dòng)勢(shì)是 其中最重要的{一擾因索針對(duì)通常采用的F I(比例一積分)電流調(diào) y器因下作頻帶的限制無(wú)法在較高轉(zhuǎn)速時(shí) 抑制反電動(dòng)勢(shì)的影響.提出了前饋補(bǔ)償和變電流環(huán)增益的設(shè)計(jì)方法.少}應(yīng)用于基于數(shù)-f_信寫(xiě)處理器的矢m:控 制系統(tǒng)給出了系統(tǒng)結(jié)構(gòu)及軟硬件設(shè)計(jì)方案實(shí)驗(yàn)結(jié)果表明.該系統(tǒng)硬件簡(jiǎn)的一控制精l夏高.動(dòng)態(tài)}h I能良好（.caj)
標(biāo)簽： 同步電動(dòng)機(jī) 電流 分 動(dòng)態(tài)特性
上傳時(shí)間： 2016-05-22
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FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能，臺(tái)灣人寫(xiě)的，關(guān)于FPGA應(yīng)用的技術(shù)文章
標(biāo)簽： FPGA 嵌入式 系統(tǒng) 性能
上傳時(shí)間： 2014-01-17
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大家在應(yīng)用ORACLE的時(shí)候可能會(huì)遇到很多看起來(lái)不難的問(wèn)題, 特別對(duì)新手來(lái)說(shuō), 簡(jiǎn)單把它總結(jié)一下, 發(fā)布給大家, 希望對(duì)大家有幫助! 和大家一起探討, 共同進(jìn)步!
上傳時(shí)間： 2014-01-07
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在做2維度樣本分類的過(guò)程中,若我們能事先畫(huà)出訓(xùn)練樣本在空間中的分散情形,這將有助於我們?cè)谠O(shè)定SVM分類器的參數(shù)C的取值範(fàn)圍. 例如:若畫(huà)出的訓(xùn)練樣本的散佈較分散,我們可以得知此時(shí)採(cǎi)用的參數(shù)值可以取在較大的範(fàn)圍. 所以本程式也是讓想要畫(huà)出資料樣本在平面的散佈情形者之一各可行工具.
上傳時(shí)間： 2016-08-19
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在MATLAB上所使用的PCA程序，主要應(yīng)用於過(guò)濾相對(duì)較不重要的特徵值(dimension)，例如在三度空間的某些點(diǎn)具有(x,y,z)值，因?yàn)檫@些點(diǎn)有共同的一個(gè)持徵，就是z值相對(duì)於x,y值來(lái)得小很多(不明顯)，所以就以X,Y軸來(lái)表示這些點(diǎn)。此時(shí)就達(dá)成去除掉z的特徵值(dimension)。
上傳時(shí)間： 2014-01-02
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