對(duì)新型電動(dòng)自行車的關(guān)鍵動(dòng)力部件———直流無(wú)刷電機(jī)作了深入的剖析與設(shè)計(jì)。本文所介紹的電動(dòng)自行車中使用的直流無(wú)刷電機(jī),系參考英國(guó)Patscentre 國(guó)際實(shí)驗(yàn)室協(xié)作設(shè)計(jì)產(chǎn)品,采用全電子操縱系統(tǒng),電動(dòng)自行車
標(biāo)簽： 電動(dòng)自行車 控制 直流無(wú)刷電動(dòng)機(jī)
上傳時(shí)間： 2013-04-24
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自適應(yīng)濾波器是智能天線技術(shù)中核心部分-自適應(yīng)波束成形器的關(guān)鍵技術(shù)，算法的高效穩(wěn)定性及硬件時(shí)鐘速率的快慢是判斷波束成形器性能優(yōu)劣的主要標(biāo)準(zhǔn)。 首先選取工程領(lǐng)域最常用的自適應(yīng)橫向LMS濾波算法作為研究對(duì)象，提出了利用最小均方誤差意義下自適應(yīng)濾波器的輸出信號(hào)與主通道噪聲信號(hào)的等效關(guān)系，得到濾波器最佳自適應(yīng)參數(shù)的方法。并分析了在平穩(wěn)和非平穩(wěn)環(huán)境噪聲下，濾波器的收斂速度、權(quán)系數(shù)穩(wěn)定性、跟蹤輸入信號(hào)的能力和信噪比的改善等特性。 在分析梯度自適應(yīng)格型算法的基礎(chǔ)上，提出利用最佳反射系數(shù)的收斂性和穩(wěn)定性，得到了梯度自適應(yīng)格型濾波器的定步長(zhǎng)改進(jìn)方法；并以改進(jìn)的梯度自適應(yīng)格型和線性組合器組成梯度自適應(yīng)格型聯(lián)合處理算法，在同樣環(huán)境噪聲下，相比自適應(yīng)橫向LMS算法，其各項(xiàng)性能指標(biāo)都得到了極大地改善，而且有利于節(jié)省硬件資源。 設(shè)計(jì)了自適應(yīng)橫向LMS濾波器和梯度自適應(yīng)格型聯(lián)合處理濾波器的電路模型，并用馳豫超前技術(shù)對(duì)兩類濾波器進(jìn)行了流水線優(yōu)化。利用Altera公司的CycloneⅡ系列EP2C5T144C6芯片和多種EDA工具，完成了濾波器的FPGA硬件設(shè)計(jì)與仿真實(shí)現(xiàn)。并以FPGA實(shí)現(xiàn)的3節(jié)梯度自適應(yīng)格型聯(lián)合處理器為核心，設(shè)計(jì)了一種TD-SCDMA系統(tǒng)的自適應(yīng)波束成形器，分析表明可以很好地利用系統(tǒng)提供的參考信號(hào)對(duì)下行波束進(jìn)行自適應(yīng)成形。
標(biāo)簽： FPGA 自適應(yīng)濾波器 算法設(shè)計(jì)
上傳時(shí)間： 2013-07-16
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本書結(jié)合目前低壓電器的運(yùn)行、操作、維護(hù)及檢修中存在的問(wèn)題，系統(tǒng)地 介紹了低壓電器的基礎(chǔ)知識(shí)、電氣接觸、低壓隔離電器、熔斷器、低壓接觸器、 熱繼電器、低壓斷路器、電容器、漏電保護(hù)器、低壓成套開(kāi)關(guān)設(shè)備及低壓配電系 統(tǒng)等內(nèi)容，以問(wèn)答的形式深入淺出地闡述了低壓電器的運(yùn)行、維護(hù)、檢修中經(jīng)常 涉及的電工理論知識(shí)和實(shí)際操作技能。
標(biāo)簽： 低壓電器 實(shí)用技術(shù) 問(wèn)答
上傳時(shí)間： 2013-08-04
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基于布里淵散射的分布式光纖傳感器是當(dāng)前國(guó)內(nèi)外研究的熱點(diǎn)。本文介紹了基于布里淵散射的分布式光纖傳感器的的原理、應(yīng)用；布里淵時(shí)域反射技術(shù)(BOTDR)和布里淵時(shí)域分析技術(shù)(BOTDA)的原理。 受激布里淵散射(SBS)的過(guò)程中，入射光和散射光滿足耦合振幅方程組。我們對(duì)該方程組采用有限差分法進(jìn)行數(shù)值計(jì)算，并用Matlab模擬計(jì)算過(guò)程，對(duì)布里淵散射信號(hào)進(jìn)行分析。 根據(jù)布里淵散射信號(hào)的特點(diǎn)，我們采用基于Morlet小波變換的DSP信號(hào)算法來(lái)處理 BOTDR傳感信號(hào)。通過(guò)對(duì)該算法的核心單元——快速傅立葉變換(FFT)的硬件實(shí)現(xiàn)，我們?cè)赟tratix FPGA上實(shí)現(xiàn)了基于Morlet小波變換的DSP算法的硬件電路設(shè)計(jì)。 最后，在此基礎(chǔ)上，我們對(duì)電路功能進(jìn)行實(shí)際的仿真和驗(yàn)證，并和Matlab得到結(jié)果進(jìn)行比較和分析。
標(biāo)簽： Morlet BOTDR 小波分析 信號(hào)處理
上傳時(shí)間： 2013-07-22
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提出通過(guò)對(duì)分塊圖像的DCT 系數(shù)進(jìn)行動(dòng)態(tài)范圍壓縮來(lái)改進(jìn)傳統(tǒng)的基于DCT 變換的圖像自嵌入水印算法，并結(jié)合灰度變換函數(shù)與JPEG 標(biāo)準(zhǔn)量化表重新設(shè)計(jì)了DCT 系數(shù)碼長(zhǎng)分配表，大幅度提升了量化過(guò)程保留的圖
上傳時(shí)間： 2013-07-28
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基于FPGA技術(shù)的網(wǎng)絡(luò)入侵檢測(cè)是未來(lái)的發(fā)展方向，而網(wǎng)絡(luò)包頭的分類是入侵檢測(cè)系統(tǒng)的關(guān)鍵。 文章首先介紹了FPGA技術(shù)的基本原理以及其在信息安全方面的應(yīng)用，接著介紹入侵檢測(cè)系統(tǒng)以及FPGA技術(shù)在入侵檢測(cè)系統(tǒng)中的應(yīng)用。 分析了幾種比較出名的網(wǎng)絡(luò)包分類算法，包括軟件分類方法、TCAM分類算法、BV算法、Tree Bitmap算法以及端口范圍分類算法。 在此基礎(chǔ)上，文章設(shè)計(jì)了一個(gè)基于FPGA技術(shù)的入侵檢測(cè)系統(tǒng)包分類的基本框架圖，實(shí)現(xiàn)框架圖中的各個(gè)基本功能模塊。在實(shí)現(xiàn)過(guò)程中，提出了一類結(jié)合三態(tài)內(nèi)容可尋址內(nèi)存(TCAM)和普通存儲(chǔ)器(RAM)的網(wǎng)絡(luò)包包頭分類方案。我們將檢測(cè)規(guī)則編號(hào)并位圖化，使用RAM存儲(chǔ)與包頭結(jié)構(gòu)相關(guān)的規(guī)則位圖，通過(guò)TCAM上的數(shù)據(jù)匹配操作，快速關(guān)聯(lián)待分析的網(wǎng)絡(luò)數(shù)據(jù)包與入侵檢測(cè)規(guī)則。文章還討論了網(wǎng)包頭分類方法的優(yōu)化算法，將優(yōu)化算法與未優(yōu)化算法在速度和空間上進(jìn)行比較。此外，還討論了對(duì)Snort的規(guī)則庫(kù)進(jìn)行整理和規(guī)則化的問(wèn)題。 最后，對(duì)所設(shè)計(jì)的包頭分類匹配模塊在Quartus II進(jìn)行仿真評(píng)估，將實(shí)驗(yàn)結(jié)果與已有的一些分類算法進(jìn)行了比較。結(jié)果說(shuō)明，本設(shè)計(jì)在匹配速度和更新速度上有優(yōu)勢(shì)，但消耗了較多的存儲(chǔ)空間．
標(biāo)簽： 入侵檢測(cè)系統(tǒng) 網(wǎng)絡(luò) 包分類 技術(shù)研究
上傳時(shí)間： 2013-07-17
上傳用戶：gonuiln
偽隨機(jī)序列 (Pseudo-Random Sequence，PRS)廣泛應(yīng)用于密碼學(xué)、擴(kuò)頻通信、雷達(dá)、導(dǎo)航等領(lǐng)域，其設(shè)計(jì)和分析一直是國(guó)際上的研究熱點(diǎn)。混沌序列作為一種性能優(yōu)良的偽隨機(jī)序列，近年來(lái)受到越來(lái)越多的關(guān)注。尋找一種性能更為良好的混沌偽隨機(jī)序列(ChaosPseudo Random Sequence，CPRS)并且完成其硬件實(shí)現(xiàn)，在理論研究與工程應(yīng)用上都是十分有價(jià)值的。基于切延遲橢圓反射腔映射混沌系統(tǒng)(Tangent-Delay Ellipse Reflecting Cavity map System，TD-ERCS)已被理論分析和測(cè)試證明具有良好的密碼學(xué)性質(zhì)。本文介紹了一種基于TD-ERCS構(gòu)造偽隨機(jī)序列發(fā)生器 (Pseudo Random SequenceGenerator，PRSG)的新方法；并基于這種方法，提出了以現(xiàn)場(chǎng)可編程門陣列 (Field Programmable Gate Array，F(xiàn)PGA)為平臺(tái)的硬件設(shè)計(jì)實(shí)現(xiàn)方案，采用硬件描述語(yǔ)言 (VHSIC Hardware DescriptionLanguage，VHDL )完成了整個(gè)系統(tǒng)的設(shè)計(jì)，通過(guò)了仿真與適配，完成了硬件調(diào)試；詳細(xì)地論述了系統(tǒng)總體框架及內(nèi)部模塊設(shè)計(jì)，重點(diǎn)介紹了TD-ERCS算法實(shí)現(xiàn)單元的設(shè)計(jì)，并在系統(tǒng)中設(shè)計(jì)加入了異步串行接口，完善了整個(gè)系統(tǒng)的模塊化，可使系統(tǒng)嵌入到現(xiàn)有的各類密碼系統(tǒng)與設(shè)備中；基于FDELPHI編程環(huán)境，完成了計(jì)算機(jī)應(yīng)用軟件的設(shè)計(jì)，為使用基于TD-ERCS開(kāi)發(fā)的PRSG硬件產(chǎn)品提供了人機(jī)交互界面，也為分析與測(cè)試硬件系統(tǒng)產(chǎn)生的CPRS提供了方便；同時(shí)依據(jù)美國(guó)國(guó)家標(biāo)準(zhǔn)與技術(shù)研究院 (National Institute of Standards andTechnology，NIST)提出的偽隨機(jī)序列性能指標(biāo)，對(duì)軟件與硬件系統(tǒng)產(chǎn)生的CPRS進(jìn)行了標(biāo)準(zhǔn)測(cè)試，軟件方法所得序列各項(xiàng)性能指標(biāo)完全合格，硬件FPGA所得序列僅三項(xiàng)測(cè)試未能通過(guò)，其原因有待進(jìn)一步研究。
標(biāo)簽： FPGA 偽隨機(jī)序列 發(fā)生器
上傳時(shí)間： 2013-06-20
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基于Linux操作系統(tǒng)具有良好的開(kāi)放性和較強(qiáng)的可移植性，在當(dāng)前嵌入式操作系統(tǒng)中被廣泛采用；同時(shí)USB也具有極佳的通用性，是當(dāng)前最為流行的通用外設(shè)接口。本文詳細(xì)的介紹編寫嵌入式USB驅(qū)動(dòng)程序的結(jié)
標(biāo)簽： Linux USB 嵌入式 驅(qū)動(dòng)
上傳時(shí)間： 2013-04-24
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計(jì)算機(jī)圖形學(xué)中真實(shí)感成像包括兩部分內(nèi)容：物體的精確圖形表示；場(chǎng)景中光照效果的適當(dāng)?shù)拿枋觥９庹招Чü獾姆瓷洹⑼该餍浴⒈砻婕y理和陰影。對(duì)物體進(jìn)行投影，然后再可見(jiàn)面上產(chǎn)生自然光照效果，可以實(shí)現(xiàn)場(chǎng)景的真實(shí)感顯示。光照明模型主要用于物體表面某點(diǎn)處的光強(qiáng)度計(jì)算。面繪制算法是通過(guò)光照模型中的光強(qiáng)度計(jì)算，以確定場(chǎng)景中物體表面的所有投影像素點(diǎn)的光強(qiáng)度。Phong明暗處理算法是生成真實(shí)感3D圖像最佳算法之一。但是由于其大量的像素級(jí)運(yùn)算和硬件難度而在實(shí)現(xiàn)實(shí)時(shí)真實(shí)感圖形繪制中被Gotuaud明暗處理算法所取代。VLSI技術(shù)的發(fā)展以及對(duì)于高真實(shí)感實(shí)時(shí)圖形的需求使得Phong明暗處理算法的實(shí)現(xiàn)成為可能。利用泰勒級(jí)數(shù)近似的Fast Phong明暗處理算法適合硬件實(shí)現(xiàn)。此算法需要存儲(chǔ)大量數(shù)據(jù)的ROM。這增加了實(shí)現(xiàn)的難度。 本文完成了以下工作： 1、本文簡(jiǎn)述了實(shí)時(shí)真實(shí)感圖形繪制管線，詳細(xì)敘述了所用到的光照明模型和明暗處理方法，并對(duì)幾種明暗處理方法的效果作了比較，實(shí)驗(yàn)結(jié)果表明Fast Phong明暗處理算法適用于實(shí)時(shí)真實(shí)感圖形繪制。 2、在熟悉Xilinx公司FPGA芯片結(jié)構(gòu)及其開(kāi)發(fā)流程的基礎(chǔ)上，結(jié)合Xilinx公司提供的FPGA開(kāi)發(fā)工具ISE 7.1i，仿真工具為ISE simulator，綜合工具為XST；完成了Fast Phong明暗處理模塊的FPGA設(shè)計(jì)與實(shí)現(xiàn)。綜合得到的電路的最高頻率為54.058MHz。本文的Fast Phong明暗處理硬件模塊適用于實(shí)時(shí)真實(shí)感圖形繪制。 3、本文通過(guò)誤差分析，提出了優(yōu)化的查找表結(jié)構(gòu)。通過(guò)在FPGA上對(duì)本文所提結(jié)構(gòu)進(jìn)行驗(yàn)證。結(jié)果表明，本方案在提高速度、精度的同時(shí)將ROM的數(shù)據(jù)量從64K*8bit減少至13K*8bit。
上傳時(shí)間： 2013-06-21
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本文利用史密斯圓圖作為RF阻抗匹配的設(shè)計(jì)指南。文中給出了反射系數(shù)、阻抗和導(dǎo)納的作圖范例，并用作圖法設(shè)計(jì)了一個(gè)頻率為60MHz的匹配網(wǎng)絡(luò)。
上傳時(shí)間： 2013-06-18
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