基于FPGA的MMC卡實(shí)現(xiàn)，內(nèi)部包含了C++仿真調(diào)試代碼以及FPGA的實(shí)現(xiàn)代碼，建立工程后可以之間編譯調(diào)試
標(biāo)簽： FPGA MMC
上傳時(shí)間： 2013-08-20
上傳用戶：swz13842860183
一個(gè)關(guān)于4CAN卡的硬件程序,用VHDL編寫.就是4路CAN總線
標(biāo)簽： VHDL CAN 硬件 程序
上傳用戶：jiiszha
基于QUARTUSII軟件 實(shí)現(xiàn)FPGA（ATERA CYCLONE II系列）與SD卡SD模式通信\r\n所用語言位verilog HDL
標(biāo)簽： QUARTUSII CYCLONE ATERA FPGA
上傳用戶：it男一枚
一種基于CPLD和PC I總線的視頻采集卡的設(shè)計(jì)方案
標(biāo)簽： CPLD 總線 卡的設(shè)計(jì) 視頻采集
上傳時(shí)間： 2013-08-24
上傳用戶：123啊
基于FPGA的高速圖像采集和處理卡 能用于視覺檢測系統(tǒng)
標(biāo)簽： FPGA 高速圖像采集 視覺檢測
上傳時(shí)間： 2013-08-28
上傳用戶：Shaikh
數(shù)據(jù)采集 基于DSP和FPGA的高精度數(shù)據(jù)采集卡設(shè)計(jì)
標(biāo)簽： FPGA DSP 高精度 數(shù)據(jù)采集卡
上傳時(shí)間： 2013-08-29
上傳用戶：2728460838
是關(guān)于對數(shù)據(jù)采集卡的基于PC104總線的讀寫程序，開發(fā)環(huán)境Quarters , 用VHDL語言編寫。
標(biāo)簽： 104 PC 數(shù)據(jù)采集卡 總線
上傳用戶：qw12
MMC卡的VHDL源代碼實(shí)現(xiàn)，經(jīng)過大批量生產(chǎn)驗(yàn)證
標(biāo)簽： VHDL MMC 源代碼
上傳時(shí)間： 2013-09-04
上傳用戶：ikemada
Allegro中網(wǎng)絡(luò)表的導(dǎo)入以及回編到Capture中的一些注意事項(xiàng)
標(biāo)簽： Allegro Capture 網(wǎng)絡(luò)表 注意事項(xiàng)
上傳用戶：hulee
解決ORCAD無法輸出網(wǎng)表問題
標(biāo)簽： ORCAD 無法輸出 網(wǎng)表
上傳時(shí)間： 2013-09-09
上傳用戶：sz_hjbf
蟲蟲下載站版權(quán)所有 京ICP備2021023401號-1
