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半加器

用VHDL語言設計四位全加器

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分別用分頻比交錯法及累加器分頻法完成非整數分頻器設計。

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這是一個基于嵌入式的利用硬件高級描述語言編寫的全加器程序

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一位全加器源碼實現了MAX及其一系列器件實現全加的功能

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全加器

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這是一個8位全加器

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4 級流水方式的8 位全加器。。。。。。

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8位全加器8位全加器8位全加器8位全加器8位全加器8位全加器8位全加器8位全加器8位全加器

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累加器

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相位累加器

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