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十進制計數器

帶復位和時鐘使能的十進制計數器 verilo 描述

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一位十進制全加器

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十進制除法器

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十進制計算器

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采用VHDL語言編寫的二-十進制編碼器

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實現十進制的一般運算和科學運算,計算器大小可變

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題目：電子時鐘的設計一、實驗目的： 1．掌握多位計數器相連的設計方法。 2．掌握十進制、六十進制、二十四進制計數器的設計方法。 3．繼續鞏固多位數碼管的驅動及編碼。 4．掌握揚聲器

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用VHDL 設計的單時鐘同步十進制可逆計數器的設計

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四位十進制頻率計設計包含測頻控制器（TESTCTL）

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在硬體上將十進制轉二進制

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