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動(dòng)態(tài)(tài)加載

  • 基于FPGA的通用加擾算法(CSA)的設(shè)計和實現(xiàn).rar

    隨著數(shù)字視頻廣播的發(fā)展,觀眾將會面對越來越多綜合或?qū)iT頻道的選擇,欣賞到更高品質(zhì),更多服務(wù)的節(jié)目。而廣播業(yè)者則要為這些節(jié)目的版權(quán)購買,制作而承受更高的成本,單純的廣告收入已經(jīng)不夠。要求對用戶收取一定的收視費用,而另一方面,調(diào)查也顯示用戶是愿意預(yù)付一定費用以獲得更好服務(wù)的。條件接受系統(tǒng)(Conditional Access system)就是為了商業(yè)目的而對某些廣播服務(wù)實施接入控制,決定一個數(shù)字接受設(shè)備能否將特定的廣播節(jié)目展現(xiàn)給最終用戶的系統(tǒng)。CA技術(shù)要求既能使用戶自由選擇收看節(jié)目又能保護廣播業(yè)者的利益,確算只有已支付了或即將支付費用的用戶才能收看到所選的電視節(jié)目。在數(shù)字電視領(lǐng)域中,CA系統(tǒng)無疑將成為發(fā)展新服務(wù)的必需條件。但是在不同的運營商可能會使用不同的CA系統(tǒng),在不同的CA系統(tǒng)之間進行互操作所必需共同遵守的最基本條件是:通用的加擾算法。每個用戶接收設(shè)備中應(yīng)集成相應(yīng)的解擾模塊。在我國國家標準--數(shù)字電視條件接收系統(tǒng)GY/Z 175-2001的附錄H中有詳細的描述。 FPGA是英文Field Programmable Gate Array的縮寫,即現(xiàn)場可編程門陣列,它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。可以說,F(xiàn)PGA芯片是小批量系統(tǒng)提高系統(tǒng)集成度、可靠性的最佳選擇之一。 首先本文簡要介紹CA系統(tǒng)的目的和組成,F(xiàn)PGA的結(jié)構(gòu)和原理,優(yōu)勢。然后介紹了利用FPGA來實現(xiàn)CA系統(tǒng)主要組成部分即加擾的原理和步驟,分析算法,劃分邏輯結(jié)構(gòu),軟件仿真,劃分硬件模塊,硬件性能分析,驗證平臺構(gòu)建,硬件實現(xiàn)等。 然后對以上各個部分做詳細的闡述。同時為了指導(dǎo)FPGA設(shè)計,給出了FPGA的結(jié)構(gòu)和原理與FPGA設(shè)計的基本原則、設(shè)計的基本技巧、設(shè)計的基本流程; 最后給出了該加擾系統(tǒng)的測試與驗證方法以及驗證和測試結(jié)果。

    標簽: FPGA CSA 算法

    上傳時間: 2013-06-22

    上傳用戶:chongchong2016

  • 2009年全國大學(xué)生電子設(shè)計競賽TI優(yōu)秀作品精選集

    2009年全國大學(xué)生電子設(shè)計競賽TI優(yōu)秀作品精選集

    標簽: 2009 大學(xué)生電子設(shè)計競賽

    上傳時間: 2013-04-24

    上傳用戶:yan2267246

  • TI公司的2812dsp所有程序

    TI公司的2812dsp所有程序,是學(xué)習(xí)2812必備資料,也是初學(xué)者的入門資料

    標簽: 2812 dsp TI公司 程序

    上傳時間: 2013-06-14

    上傳用戶:zzbin_2000

  • ti 公司的wifi模組在LINUX下的驅(qū)動

    ti 公司的wifi模組在LINUX下的驅(qū)動

    標簽: LINUX wifi ti 模組

    上傳時間: 2013-04-24

    上傳用戶:lixinxiang

  • AES加、解密算法的FPGA優(yōu)化設(shè)計

    2000年10月2日,美國國家標準與技術(shù)研究所宣布采用Rijndael算法作為高級加密標準,并于2002年5月26日正式生效,AES算法將在今后很長一段時間內(nèi),在信息安全中扮演重要角色。因此,對AES算法實現(xiàn)的研究就成為了國內(nèi)外的熱點,會在信息安全領(lǐng)域得到廣泛的應(yīng)用。用FPGA實現(xiàn)AES算法具有快速、靈活、開發(fā)周期短等優(yōu)點。 本論文就是針對AES加、解密算法在同一片F(xiàn)PGA中的優(yōu)化實現(xiàn)問題,在深入分析了AES算法的整體結(jié)構(gòu)、基本變換以及加、解密流程的基礎(chǔ)上,對AES算法的加、解密系統(tǒng)的FPGA優(yōu)化設(shè)計進行了研究。主要內(nèi)容為: 1.確定了實現(xiàn)方案以及關(guān)鍵技術(shù),在比較了常用的結(jié)構(gòu)后,采用了適合高速并行實現(xiàn)AES加、解密算法的結(jié)構(gòu)——內(nèi)外混合的流水線結(jié)構(gòu),并給出了總體的設(shè)計框圖。由于流水線結(jié)構(gòu)不適用于反饋模式,為了達到較高的運算速度,該系統(tǒng)使用的是電碼本模式(ECB)的工作方式; 2.對各個子模塊的設(shè)計分別予以詳細分析,結(jié)合算法本身和FPGA的特點,采用查表法優(yōu)化處理了字節(jié)代換運算,列混合運算和密鑰擴展運算。同時,考慮到應(yīng)用環(huán)境的不同,本設(shè)計支持數(shù)據(jù)分組為128比特,密鑰長度為128比特、192比特以及256比特三種模式下的AES算法加、解密過程。完成了AES加、解密算法在同一片F(xiàn)PGA中實現(xiàn)的這個系統(tǒng)的優(yōu)化設(shè)計; 3.利用QLJARTUSII開發(fā)工具進行代碼的編寫工作和綜合編譯工作,在 MODELSIM中進行仿真并給出仿真結(jié)果,給出了各個模塊和整個設(shè)計的仿真測試結(jié)果; 4.和其他類似的設(shè)計做了橫向?qū)Ρ龋贸鼋Y(jié)論:本設(shè)計在保證了速度的基礎(chǔ)上實現(xiàn)了資源和速度的均衡,在性能上具有較大的優(yōu)勢。

    標簽: FPGA AES 解密 算法

    上傳時間: 2013-05-25

    上傳用戶:wcl168881111111

  • PSLIB21

    pb開發(fā)soket所需要的一個關(guān)鍵動態(tài)庫,我找了很久的,現(xiàn)在份享一下-pb socket dll

    標簽: PSLIB 21

    上傳時間: 2013-04-24

    上傳用戶:refent

  • 加密卡的研制與加密算法的FPGA實現(xiàn)

    隨著安全通信數(shù)據(jù)速率的提高,關(guān)鍵數(shù)據(jù)加密算法的軟件實施成為重要的系統(tǒng)瓶頸.基于FPGA的高度優(yōu)化的可編程的硬件安全性解決方案提供了并行處理能力,并且可以達到所要求的加密處理性能(每秒的SSL或RSA運算次數(shù))基準.網(wǎng)絡(luò)的迅速發(fā)展,對安全性的需要變得越來越重要.然而,盡管網(wǎng)絡(luò)技術(shù)進步很快,安全性問題仍然相對落后.由于FPGA所提供的設(shè)計優(yōu)勢,特別是新的高速版本,網(wǎng)絡(luò)系統(tǒng)設(shè)計人員可以在這些網(wǎng)絡(luò)設(shè)備中經(jīng)濟地實現(xiàn)安全性支持.FPGA是實現(xiàn)設(shè)計靈活性和功能升級的關(guān)鍵,對于容錯、IPSec協(xié)議和系統(tǒng)接口問題而言這兩點非常重要.而且,FPGA還為網(wǎng)絡(luò)系統(tǒng)設(shè)計人員提供了適應(yīng)不同安全處理功能以及隨著安全技術(shù)的發(fā)展方便地增加對新技術(shù)支持的能力.標準加密/解決以及認證算法,如RC-4、DES、三次DES、MD-5以及安全哈希算法-1(SHA-1)被廣泛用于全球網(wǎng)絡(luò)安全系統(tǒng)中.本文介紹了基于PCI總線的加密卡的研制,硬件板卡的結(jié)構(gòu),著重論述了加密卡上加密模塊的實現(xiàn),即用FPGA實現(xiàn)3DES及IDEA、MD5算法的過程,加密卡的工作原理,加密卡中多種密碼算法的配置原理,最后對3DES算法及IDEA、MD5算法的實現(xiàn)進行仿真,并繪制了板卡的原理圖,對PCI接口原理進行了闡述.在論文中,首先闡述了數(shù)據(jù)加密原理.介紹了數(shù)據(jù)加密的算法和數(shù)據(jù)加密的技術(shù)發(fā)展趨勢,并重點說明了3DES的算法.由于加密卡的生存空間在于其高速的加密性能與便捷的使用方式,所以,我們的加密卡采用的是基于PCI插槽的結(jié)構(gòu),遵從的是PCI2.2規(guī)范,理解并掌握PCI總線的規(guī)范是了解整個系統(tǒng)的重要一環(huán),本文講述了PCI總線的特點和性能,以及總線的信號.由于遵從高速性的要求,我們在硬件選型的時候,選用的是TI公司高速DSP T M S 3 2 0 C 5 4 x:T I公司新推出的T M S 3 2 0 C 6 x系列D S P功能強,速度也非常快,但目前價格仍然太高,不適合一般加解密使用.而TMS3 2 0 C 5 4 x系列具有性能適中,價格低廉,產(chǎn)品成熟等特點,是較好的選擇.FPGA選用的XILINX公司的XC2V3000,在隨后的文章中,我們將會對這些器件特性做相應(yīng)說明.并由此得出電路原理圖的繪制.文章的重點之一在于3DES算法及IDEA、MD5算法的FPGA實現(xiàn),以Xilinx公司VIRTEXII結(jié)構(gòu)的VXC2V3000為例,闡述用FPGA高速實現(xiàn)3DES算法及IDEA、MD5算法的設(shè)計要點及關(guān)鍵部分的設(shè)計.

    標簽: FPGA 加密卡 加密算法

    上傳時間: 2013-04-24

    上傳用戶:qazwsc

  • Ti.Code.Composer.Studio.Ver.3.1

    Code Composer Studio是TI eXpressDSPTM實時軟件技術(shù)的重要組成部分,它可以使開發(fā)人員充分應(yīng)用DSP的強大弁遄C隨著TI的TMS320C5000 和TMS320C6000 DSP平臺的應(yīng)用范圍不斷擴大,已經(jīng)由其應(yīng)用于下載視頻流的手持因特網(wǎng)接入產(chǎn)品擴展到蜂窩通信網(wǎng)路和光網(wǎng)絡(luò)的通信基礎(chǔ)設(shè)施,eXpressDSPTM也便獲得了越來越多軟件工程師的青睞。eXpressDSP還包含了DSP/BIOS可伸縮內(nèi)核,TMS320TMDSP標準算法的應(yīng)用互操作性和可重復(fù)使用性以及400多家第三

    標簽: Composer Studio Code 3.1

    上傳時間: 2013-06-23

    上傳用戶:zzy7826

  • TI標準SPI例程

    TI標準SPI例程(帶中斷的例程)應(yīng)用芯片為TMS320F28035 TI公司TMS320F28035的最小系統(tǒng)版電路圖,dxp的,...在ABB的發(fā)展歷程和技術(shù)概述,對正在開發(fā)或應(yīng)用IEC61850的人會有參考和啟發(fā)作用。...

    標簽: SPI TI標準

    上傳時間: 2013-05-28

    上傳用戶:木子葉1

  • TI放大器和數(shù)據(jù)轉(zhuǎn)換器選擇指南

    德州儀器(TI)通過多種不同的處理工藝提供了寬范圍的運算放大器產(chǎn)品,其類型包括了高精度、微功耗、低電壓、高電壓、高速以及軌至軌。TI還開發(fā)了業(yè)界最大的低功耗及低電壓運算放大器產(chǎn)品選集,其設(shè)計特性可滿足寬范圍的多種應(yīng)用

    標簽: 放大器 數(shù)據(jù)轉(zhuǎn)換器 選擇指南

    上傳時間: 2013-06-16

    上傳用戶:不挑食的老鼠

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