自制邏輯筆、信號發生器,電路圖加程序 可作為汽車儀表跑表器
標簽： 邏輯筆 信號發生器 電路圖 汽車儀表
上傳時間： 2017-05-02
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32位全加器 在querters II 下面運行成功 仿真 驗證均已成功
標簽： querters II 全加器 仿真
上傳時間： 2017-05-03
上傳用戶：cc1915
N分頻器則是一個簡單的除N 計數器。分頻器對脈沖加減電路的輸出脈沖再進行N分頻，得到整個環路的輸出信號Fout。
標簽： N分頻 計數器 分頻器 減
上傳時間： 2017-05-04
上傳用戶：royzhangsz
4位全加器設計，包含半加器構成全加器，由全加器構成4位全加器及其拓展
標簽： 全加器
上傳時間： 2017-05-06
上傳用戶：dreamboy36
八位全加器，實現自動加法，哈哈哈，大家共享
上傳時間： 2013-12-16
上傳用戶：zhangjinzj
一位全加器，VERILOG實現，包括測試文件，測試可用，歡迎下載，共同學習
上傳時間： 2013-12-24
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一個全加器的systemc代碼，包括模塊的定義以及測試平臺
標簽： systemc 全加器 代碼
上傳時間： 2017-05-20
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FPGA 開發板源碼。芯片為Mars EP1C6F.VHDL語言。可實現一些基本的功能。如乘法器、加法器、多路選擇器等。
標簽： FPGA Mars VHDL EP
上傳時間： 2017-05-25
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FPGA開發板配套Verilog HDL代碼。芯片為Mars EP1C6F。是基礎實驗的源碼。包括加法器、減法器、乘法器、多路選擇器等。
標簽： Verilog EP1C6F FPGA Mars
上傳時間： 2014-11-10
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8位全加器的VHDL語言描述，有需要的頂一下。
標簽： VHDL 8位 全加器 語言
上傳時間： 2017-05-30
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