冷壓端子與電源線的裝接工藝
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GJB 6403-2008 電線電纜端接用手動(dòng)模壓式壓接工具總規(guī)范
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《沿著塞納河到翡冷翠》[黃永玉][北京三聯(lián)版.1999][PDF]
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Cadence后端教程
上傳時(shí)間： 2013-06-07
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LM317三端可調(diào)穩(wěn)壓器 PDF版
上傳時(shí)間： 2013-06-04
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專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G LM317三端可調(diào)穩(wěn)壓器-10頁(yè)-0.8M-PDF版.pdf
上傳時(shí)間： 2013-08-01
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該文主要研究開(kāi)發(fā)了適用于電力有源濾波器、開(kāi)關(guān)磁阻電機(jī)調(diào)速系統(tǒng)等現(xiàn)代電力電子裝置的開(kāi)關(guān)穩(wěn)壓電源.該電源采用雙端反激式功率變換電路,降低了功率MOSFET截止期間的所承受電壓應(yīng)力,減小了管子的耐壓要求.該文首先詳細(xì)分析了多輸出電流型雙端反激式開(kāi)關(guān)電源的基本工作原理,并在此基礎(chǔ)上建立了一套系統(tǒng)的、準(zhǔn)確的穩(wěn)態(tài)數(shù)學(xué)模型及動(dòng)態(tài)小信號(hào)模型.根據(jù)所建立的數(shù)學(xué)模型,結(jié)合自動(dòng)控制原理,對(duì)閉環(huán)控制系統(tǒng)進(jìn)行了穩(wěn)定性分析研究,提出了穩(wěn)定運(yùn)行條件,給出了閉環(huán)系統(tǒng)的參數(shù)設(shè)計(jì).然后根據(jù)已建立的數(shù)學(xué)模型,利用MATLAB軟件仿真分析了系統(tǒng)的穩(wěn)定性,同時(shí)建立了PSPICE實(shí)時(shí)仿真電路模型,進(jìn)行了深入細(xì)致的計(jì)算機(jī)仿真研究,驗(yàn)證了理論設(shè)計(jì)的正確性、合理性.最后設(shè)計(jì)了一套38W、六路輸出的原理樣機(jī),給出了相關(guān)的實(shí)驗(yàn)波形和實(shí)驗(yàn)結(jié)果分析.
標(biāo)簽： 電流型 雙端 反激式開(kāi)關(guān)電源
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永磁電動(dòng)機(jī)相比其他類型的電動(dòng)機(jī)其性能指標(biāo)突出，將廣泛應(yīng)用于各個(gè)行業(yè)。但是隨著電機(jī)工業(yè)朝著大容量、高功率密度、小體積的趨勢(shì)發(fā)展，永磁電動(dòng)機(jī)溫升與其它各項(xiàng)指標(biāo)在配合上發(fā)生了分歧。為了解決這些問(wèn)題，就要對(duì)永磁電機(jī)進(jìn)行合理的冷卻設(shè)計(jì)及溫度計(jì)算。永磁電機(jī)的溫升計(jì)算除了要考察定子繞組處的受熱，同時(shí)也要兼顧永磁體的溫度情況‰本文對(duì)永磁電機(jī)的溫度計(jì)算及冷卻系統(tǒng)進(jìn)行了如下分析設(shè)計(jì)： 首先，通過(guò)電磁學(xué)與傳熱學(xué)、流體力學(xué)等邊緣學(xué)科，對(duì)永磁電機(jī)進(jìn)行溫度場(chǎng)分析。其中對(duì)自冷徑向永磁電機(jī)溫度場(chǎng)進(jìn)行詳細(xì)地分析與計(jì)算。利用等效熱網(wǎng)絡(luò)法，即離散網(wǎng)格，使參數(shù)集中化，列出方程組，解出各剖分點(diǎn)的溫度值。采用與其相對(duì)應(yīng)的經(jīng)驗(yàn)公式及實(shí)驗(yàn)結(jié)果確定永磁電機(jī)的散熱系數(shù)。 其次對(duì)徑向永磁電機(jī)的損耗分布進(jìn)行說(shuō)明，不僅從數(shù)量上對(duì)槽內(nèi)繞組損耗和端部繞組損耗做出了區(qū)分，而且從理論上對(duì)定子軛部和定子齒部的損耗進(jìn)行分析，以確保在損耗分布上盡量使誤差減少。其次利用ANSYS、ANSOFT軟件，采用有限元方法對(duì)永磁電機(jī)穩(wěn)態(tài)、瞬態(tài)時(shí)的溫度分布情況進(jìn)行分析。利用上述方法對(duì)TYJS機(jī)床電機(jī)4.4kW-3000進(jìn)行分析，比較其理論值與實(shí)驗(yàn)值之問(wèn)的誤差，結(jié)果比較滿意。 最后，本文對(duì)5kW-450雙定子-單轉(zhuǎn)子盤(pán)式電機(jī)的溫度場(chǎng)進(jìn)行分析。由于徑向電機(jī)與盤(pán)式電機(jī)在結(jié)構(gòu)上的區(qū)別，分別對(duì)盤(pán)式電機(jī)的損耗分布、散熱系數(shù)的求取等不同之處與徑向電機(jī)進(jìn)行比較。對(duì)盤(pán)式電動(dòng)機(jī)外部冷卻系統(tǒng)的設(shè)計(jì)上，采用假定系數(shù)法，反推風(fēng)扇結(jié)構(gòu)，合理地設(shè)計(jì)了該樣機(jī)的冷卻系統(tǒng)。通過(guò)以上的分析，能夠較準(zhǔn)確計(jì)算電機(jī)的溫度值，從中得出其局部過(guò)熱點(diǎn)。這樣給電機(jī)的改進(jìn)和研制都帶來(lái)了方便。
標(biāo)簽： 永磁電機(jī) 冷卻 溫升計(jì)算
上傳時(shí)間： 2013-06-14
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應(yīng)用于煤礦、石化等易燃易爆環(huán)境的電子設(shè)備必須滿足防爆的要求，本質(zhì)安全型是最佳的防爆形式。本質(zhì)安全型開(kāi)關(guān)電源具有重量輕、體積小、制造工藝簡(jiǎn)單、成本低、安全性能高等優(yōu)點(diǎn)，因而具有廣闊的發(fā)展前景。單端反激變換器是開(kāi)關(guān)變換器的一種基本的拓?fù)浣Y(jié)構(gòu)，在實(shí)際中應(yīng)用比較廣泛，因此對(duì)單端反激變換器進(jìn)行本質(zhì)安全特性分析是本質(zhì)安全開(kāi)關(guān)電源設(shè)計(jì)的重要基礎(chǔ)。本質(zhì)安全型開(kāi)關(guān)變換器的設(shè)計(jì)，主要是對(duì)變換器中的儲(chǔ)能元件進(jìn)行設(shè)計(jì)，即變換器中的電感和輸出濾波電容進(jìn)行設(shè)計(jì)。 本文對(duì)變換器的靜態(tài)特性進(jìn)行了深入分析，指出反激變換器存在三種工作模式：CISM-CCM、IISM-CCM和DCM：得出了變換器工作在整個(gè)動(dòng)態(tài)范圍內(nèi)的最大輸出紋波電壓、最大電感電流和最大輸出短路釋放能量。對(duì)單端反激變換器的本質(zhì)安全特性進(jìn)行了分析，得出輸出本質(zhì)安全型單端反激變換器的非爆炸判斷方法，并通過(guò)安全火花試驗(yàn)裝置對(duì)變換器進(jìn)行爆炸性試驗(yàn)，驗(yàn)證了輸出本安判據(jù)的正確性。得出輸出本質(zhì)安全型單端反激變換器的設(shè)計(jì)方法，以同時(shí)滿足輸出紋波電壓和輸出本安要求作為約束條件，得到了本質(zhì)安全型單端反激變換器電感、電容參數(shù)的設(shè)計(jì)范圍。給出了具體實(shí)例，并進(jìn)行仿真和試驗(yàn)研究，仿真和實(shí)驗(yàn)結(jié)果驗(yàn)證了理論分析的正確性和設(shè)計(jì)方法的可行性。
上傳時(shí)間： 2013-06-25
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現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA，F(xiàn)ield Programmable Gate Array)是可編程邏輯器件的一種，它的出現(xiàn)是隨著微電子技術(shù)的發(fā)展，設(shè)計(jì)與制造集成電路的任務(wù)已不完全由半導(dǎo)體廠商來(lái)獨(dú)立承擔(dān)。系統(tǒng)設(shè)計(jì)師們更愿意自己設(shè)計(jì)專用集成電路(ASIC，Application Specific Integrated Circuit)．芯片，而且希望ASIC的設(shè)計(jì)周期盡可能短，最好是在實(shí)驗(yàn)室里就能設(shè)計(jì)出合適的ASIC芯片，并且立即投入實(shí)際應(yīng)用之中。現(xiàn)在，F(xiàn)PGA已廣泛地運(yùn)用于通信領(lǐng)域、消費(fèi)類電子和車(chē)用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個(gè)大模塊之一，它的主要作用是提供封裝引腳到CLB之間的接口，將外部信號(hào)引入FPGA內(nèi)部進(jìn)行邏輯功能的實(shí)現(xiàn)并把結(jié)果輸出給外部電路，并且根據(jù)需要可以進(jìn)行配置來(lái)支持多種不同的接口標(biāo)準(zhǔn)。FPGA允許使用者通過(guò)不同編程來(lái)配置實(shí)現(xiàn)各種邏輯功能，在IO端口中它可以通過(guò)選擇配置方式來(lái)兼容不同信號(hào)標(biāo)準(zhǔn)的I/O緩沖器電路。總體而言，可選的I/O資源的特性包括：IO標(biāo)準(zhǔn)的選擇、輸出驅(qū)動(dòng)能力的編程控制、擺率選擇、輸入延遲和維持時(shí)間控制等。 本文是關(guān)于FPGA中多標(biāo)準(zhǔn)兼容可編程輸入輸出電路(Input/Output Block)的設(shè)計(jì)和實(shí)現(xiàn)，該課題是成都華微電子系統(tǒng)有限公司FPGA大項(xiàng)目中的一子項(xiàng)，目的為在更新的工藝水平上設(shè)計(jì)出能夠兼容單端標(biāo)準(zhǔn)的I/O電路模塊；同時(shí)針對(duì)以前設(shè)計(jì)的I/O模塊不支持雙端標(biāo)準(zhǔn)的缺點(diǎn)，要求新的電路模塊中擴(kuò)展出雙端標(biāo)準(zhǔn)的部分。文中以低壓雙端差分標(biāo)準(zhǔn)(LVDS)為代表構(gòu)建雙端標(biāo)準(zhǔn)收發(fā)轉(zhuǎn)換電路，與單端標(biāo)準(zhǔn)比較，LVDS具有很多優(yōu)點(diǎn)： (1)LVDS傳輸?shù)男盘?hào)擺幅小，從而功耗低，一般差分線上電流不超過(guò)4mA，負(fù)載阻抗為100Ω。這一特征使它適合做并行數(shù)據(jù)傳輸。 (2)LVDS信號(hào)擺幅小，從而使得該結(jié)構(gòu)可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號(hào)電壓可以從0V到2.4V變化，單端信號(hào)擺幅為400mV，這樣允許輸入共模電壓從0.2V到2.2V范圍內(nèi)變化，也就是說(shuō)LVDS允許收發(fā)兩端地電勢(shì)有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝，輔助Xilinx公司FPGA開(kāi)發(fā)軟件ISE，設(shè)計(jì)完成了可以用于Virtex系列各低端型號(hào)FPGA的IOB結(jié)構(gòu)，它有靈活的可配置性和出色的適應(yīng)能力，能支持大量的I/O標(biāo)準(zhǔn)，其中包括單端標(biāo)準(zhǔn)，也包括雙端標(biāo)準(zhǔn)如LVDS等。它具有適應(yīng)性的優(yōu)點(diǎn)、可選的特性和考慮到被文件描述的硬件結(jié)構(gòu)特征，這些特點(diǎn)可以改進(jìn)和簡(jiǎn)化系統(tǒng)級(jí)的設(shè)計(jì)，為最終的產(chǎn)品設(shè)計(jì)和生產(chǎn)打下基礎(chǔ)。設(shè)計(jì)中對(duì)包括20種IO標(biāo)準(zhǔn)在內(nèi)的各電器參數(shù)按照用戶手冊(cè)描述進(jìn)行仿真驗(yàn)證，性能參數(shù)已達(dá)到預(yù)期標(biāo)準(zhǔn)。
標(biāo)簽： FPGA 標(biāo)準(zhǔn) 可編程
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