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全自動生化分析儀

  • 33個畢業設計單片機類.rar

    16×16點陣(滾動顯示)論文+程序.rar cdma通信系統中的接入信道部分進行仿真與分析.rar LED顯示屏動態顯示和遠程監控的實現.rar MCS-51單片機溫度控制系統.rar USB接口設計.rar 畢業設計(論文)OFDM通信系統基帶數據.rar 倉庫溫濕度的監測系統.rar 單片機串行通信發射機.rar 單片機課程設計__電子密碼鎖報告.rar 單片機控制交通燈.rar 電動智能小車(完整論文).rar 電氣工程系06屆畢業設計開題報告.rar 電信運營商收入保障系統設計與實現.rar 電子設計大賽點陣電子顯示屏(A題)..rar 電子時鐘.rar 火災自動報警系統設計.rar 基于GSM短信模塊的家庭防盜報警系統.rar 基于GSM模塊的車載防盜系統設計 TC35i 資料.rar 基于網絡的虛擬儀器測試系統.rar 門控自動照明電路.rar 全遙控數字音量控制的D類功率放大器.rar 數控直流穩壓電源完整論文.rar 數字密碼鎖設計.rar 數字搶答器(數字電路).rar 數字時鐘.rar 水箱單片機控制系統.rar 同步電機模型的MATLAB仿真.rar 溫度監控系統的設計.rar 用單片機控制直流電機.rar 用單片機實現溫度遠程顯示.rar 智能家用電熱水器控制器.rar 智能型充電器電源和顯示的設計.rar 自動加料機控制系統.rar 每個設計包含論文、原代碼,個別的有PCB

    標簽: 畢業設計 單片機

    上傳時間: 2013-07-05

    上傳用戶:riiqg1989

  • 集成運放線性應用電路分析方法的研究.rar

    集成運放線性應用電路分析方法的研究 集成運放線性應用電路分析方法的研究

    標簽: 集成運放 線性應用 電路分析

    上傳時間: 2013-06-06

    上傳用戶:gxf2016

  • 常用運放電路范例及分析.rar

    一些常用的運放電路及分析。國家半導體公司的應用筆記。

    標簽: 運放電路 范例

    上傳時間: 2013-05-28

    上傳用戶:YYRR

  • AN-6076供高電壓柵極驅動器IC使用的自舉電路的設計和使用準則

    本文講述了一種運用于功率型MOSFET 和IGBT 設計性能自舉式柵極驅動電路的系統方法,適用于高頻率,大功率及高效率的開關應用場合。不同經驗的電力電子工程師們都能從中獲益。在大多數開關應用中

    標簽: 6076 AN 高電壓 柵極驅動器IC

    上傳時間: 2013-04-24

    上傳用戶:520

  • OrCAD/PSpice9偏壓點和直流掃描分析(歐姆定律)

    OrCAD/PSpice9偏壓點和直流掃描分析(歐姆定律)一、學習目的:1、使用電路繪制程序Capture繪制所須要的電路圖2、學習偏壓點分析

    標簽: PSpice OrCAD 偏壓 直流掃描分析

    上傳時間: 2013-04-24

    上傳用戶:xfbs821

  • 應用EDA 技術仿真電子線路分析

    應用EDA 技術仿真電子線路分析 摘 要 介紹了電子電路仿真軟件Elect ronicsWo rkbench 在EDA 中的應用, 給出了仿真實

    標簽: EDA 仿真 電子線路

    上傳時間: 2013-07-27

    上傳用戶:變形金剛

  • 應用VHDL基于FPGA設計FIR濾波器

    伴隨高速DSP技術的廣泛應用,實時快速可靠地進行數字信號處理成為用戶追求的目標。同時,由于可編程器件在速度和集成度方面的飛速提高,使得利用硬件實現數字信號實時快速可靠處理有了新的途徑。 FIR濾波器是數字信號處理中常用部件,它的最大優點在于:設計任何幅頻特性時,可以具有嚴格的線性相位,這一點對數字信號的實時處理非常關鍵。 FPGA是常用的可編程器件,它所具有的查找表結構非常適用于實現實時快速可靠的FIR濾波器,在加上VHDL語言靈活的描述方法以及與硬件無關的特點,使得使用VHDL語言基于FPGA芯片實現FIR濾波器成為研究的方向。 本文對基于FPGA的FIR數字濾波器實現進行了研究,并設計了一個16階的FIR低通濾波器。所做的主要工作為: 1.以FIR數字濾波器的基本理論為依據,使用分布式算法作為濾波器的硬件實現算法,并對其進行了詳細的討論。針對分布式算法中查找表規模過大的缺點,采用多塊查找表的方式減小硬件規模。 2.在設計中采用了自頂向下的層次化、模塊化的設計思想,將整個濾波器劃分為多個模塊,利用VHDL語言的描述方法進行了各個功能模塊的設計,最終完成了FIR數字濾波器的系統設計。 3.采用FLEX10K系列器件實現一個16階的FIR低通濾波器的設計實例,用MAX+PLUSII軟件進行了仿真,并用MATLAB對仿真結果進行了分析,證明所設計的FIR數字濾波器功能正確。 仿真結果表明,本論文所設計的FIR濾波器硬件規模較小,采樣率達到了17.73MHz。同時只要將查找表進行相應的改動,就能分別實現低通、高通、帶通FIR濾波器,體現了設計的靈活性。

    標簽: VHDL FPGA FIR 濾波器

    上傳時間: 2013-04-24

    上傳用戶:zdluffy

  • 基于FPGA的自適應濾波器設計與實現

    自適應濾波器是統計信號處理的一個重要組成部分。在實際應用中,由于沒有充足的信息來設計固定系數的數字濾波器,或者設計規則會在濾波器正常運行時改變,因此我們需要研究自適應濾波器。凡是需要處理未知統計環境下運算結果所產生的信號或需要處理非平穩信號時,自適應濾波器可以提供一種吸引人的解決方法,而且其性能通常遠優于用常規方法設計的固定濾波器。此外,自適應濾波器還能提供非自適應方法所不可能提供的新的信號處理能力。 本論文從自適應濾波器研究的重要意義入手,介紹了線性自適應濾波器的基本原理、算法及設計方法,對幾種基于最小均方誤差準則或最小平方誤差準則的自適應濾波器算法進行研究,最終基于一改近的LMS算法設計復數自適應濾波器,并以VHDL語言編寫在maxplus平臺上進行仿真測試。

    標簽: FPGA 自適應濾波器

    上傳時間: 2013-07-11

    上傳用戶:W51631

  • 雙信號快速測頻技術及FPGA實現

    建立在數據率轉換技術之上的寬帶數字偵察接收機要求能夠實現高截獲概率、高靈敏度、近乎實時的信號處理能力。雙信號數據率轉換技術是寬帶數字偵察接收機關鍵技術之一,是解決寬帶數字接收機中前端高速ADC采樣的高速數據流與后端DSP處理速度之間瓶頸問題的可行方案。測頻技術以及帶通濾波,即寬帶數字下變頻技術,是實現數據率轉換系統的關鍵技術。本文首先介紹了寬帶數字偵察接收關鍵技術之一的數據率轉換技術,著重研究了快速、高精度雙信號測頻算法以及實驗系統硬件實現。論文主要工作如下: (1)分析了現代電子偵察環境下的信號特征,指出寬帶數字接收機必須滿足寬監視帶寬、流水作業以及近實時的響應時間。給出了一種頻率引導式的數字接收機方案,簡要介紹這種接收機的關鍵技術——快速、高精度頻率估計以及高效的數據率轉換。 (2)介紹了FFT技術在測頻算法中的應用,比較了FFT專用芯片及其優點和缺點,指出為了滿足實時處理要求,必須選用FPGA設計FFT模塊。 (3)在分析常規的插值算法基礎上,提出了一種單信號的快速插值頻率估計方法,只需三個FFT變換系數的實部構造頻率修正項,計算量低。該方法具有精度高、測頻速率快的特點。 (4)基于DFT理論和自相關理論,提出了結合FFT和自相關的雙信號頻率估計算法。該方法先用DFT估計其中一個信號的頻率和幅度,以此頻率對信號解調并對消該頻率成分,最后利用自相關理論估計出另一個信號的頻率。 (5)基于DFT理論和FFT技術,研究了信號平方與FFT結合的雙信號頻率估計算法。根據信號中兩頻率分量的幅度比,只需一次一維平方信號譜峰搜索,就可以得到雙信號的和頻與差頻分量的估計值,并利用插值技術提高測頻精度。該算法能夠精確地估計頻率間隔小的雙信號頻率,且容易地擴展到復信號,FPGA硬件實現容易。 (6)基于現代譜分析理論,研究了基于AR(2)模型的雙信號頻率估計算法。方法在利用AR(2)模型系數估計雙正弦信號頻率之和的同時,利用FFT快速測頻算法估計其中強信號分量的頻率值。算法仿真驗證和性能分析表明了提出的算法能快速高精度地估計雙信號頻率。 (7)給出了基于頻譜重心算法的雷達雙信號頻率估計的FPGA硬件實現架構,并進行了時序仿真。 (8)討論了雙信號帶寬匹配接收系統的硬件設計方案,給出了快速測頻及帶寬估計模塊設計。

    標簽: FPGA 信號 測頻

    上傳時間: 2013-06-02

    上傳用戶:youke111

  • 基于FPGA的高速采樣自適應濾波系統的研究

    自適應濾波器的硬件實現一直是自適應信號處理領域研究的熱點。隨著電子技術的發展,數字系統功能越來越強大,對器件的響應速度也提出更高的要求。 本文針對用通用DSP 芯片實現的自適應濾波器處理速度低和用HDL語言編寫底層代碼用FPGA實現的自適應濾波器開發效率低的缺點,提出了一種基于DSP Builder系統建模的設計方法。以隨機2FSK信號作為研究對象,首先在matlab上編寫了LMS去噪自適應濾波器的點M文件,改變自適應參數,進行了一系列的仿真,對算法迭代步長、濾波器的階數與收斂速度和濾波精度進行了研究,得出了最佳自適應參數,即迭代步長μ=0.0057,濾波器階數m=8,為硬件實現提供了參考。 然后,利用最新DSP Builder工具建立了基于LMS算法的8階2FSK信號去噪自適應濾波器的模型,結合多種EDA工具,在EPFlOKl00EQC208-1器件上設計出了最高數據處理速度為36.63MHz的8階LMS自適應濾波器,其速度是文獻[3]通過編寫底層VHDL代碼設計的8階自適應濾波器數據處理速度7倍多,是文獻[50]采用DSP通用處理器TMS320C54X設計的8階自適應濾波器處理速度25倍多,開發效率和器件性能都得到了大大地提高,這種全新的設計理念與設計方法是EDA技術的前沿與發展方向。 最后,采用異步FIFO技術,設計了高速采樣自適應濾波系統,完成了對雙通道AD器件AD9238與自適應濾波器的高速匹配控制,在QuartusⅡ上進行了仿真,給出了系統硬件實現的原理框圖,并將采樣濾波控制器與異步FIF0集成到同一芯片上,既能有效降低高頻可能引起的干擾又降低了系統的成本。

    標簽: FPGA 高速采樣 自適應濾波

    上傳時間: 2013-06-01

    上傳用戶:ynwbosss

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