這是一本關(guān)于Intel 80C51 以及廣大的51 系列單片機的書這本書介紹給讀者一些新的技術(shù)使你的8051 工程和開發(fā)過程變得簡單請注意這本書的目的可不是教你各種8051 嵌入式系統(tǒng)的解決方法為使問題討論更加清晰在適當?shù)牡胤浇o出了程序代碼我們以討論項目的方法來說明每章碰到的問題所有的代碼都可在附帶的光盤上找到你必須熟系C 和8051 匯編因為本書不是一本C 和匯編的指導(dǎo)書你可以買到不少關(guān)于ANSI C 的書最佳選擇當然是Intel的數(shù)據(jù)書可從你的芯片供應(yīng)商處免費索取和隨編譯工具附送的手冊附送光盤中有我為這本書編寫和收集的程序這些程序已經(jīng)通過測試這并不意味著你可以隨時把這些程序加到你的應(yīng)用系統(tǒng)或工程中有些地方必須首先經(jīng)過修改才能結(jié)合到你的程序中這本書將教你充分使用你的工具如果你只有8051 的匯編程序你也可以學習該書和使用這些例子但是你必須把C 語言的程序裝入你的匯編程序中這對懂得C 語言和8051匯編程序指令的人來說并不是一件困難的事如果你有C 編譯器的話那恭喜你使用C 語言進行開發(fā)是一個好的決定你會發(fā)現(xiàn)使用C 進行開發(fā)將使你的工程開發(fā)和維護的時間大大減少如果你已經(jīng)擁有Keil C51 那你已經(jīng)選擇了一個非常好的開發(fā)工具我發(fā)現(xiàn)Keil 軟件包能夠提供最好的支持本書支持Keil C 的擴展如果你有其它的開發(fā)工具像Archimedes 和Avocet 這本書也能很好地為你服務(wù)但你必須根據(jù)你所用的開發(fā)工具改變一些Keil 的特殊指令在書的一些地方有硬件圖實例程序在這些硬件上運行這些圖繪制地不是很詳細主要是方框圖但足以使讀者明白軟件和硬件之間的接口讀者應(yīng)該把這本書看成工具書而不是用來學習各種系統(tǒng)設(shè)計通過本書你可以了解給定一定的硬件和軟件設(shè)計之后8051 的各種性能希望你能從本書中獲取靈感并有助于你的設(shè)計使你豁然開朗當然我希望你也能夠從本書中學到有用的知識使之能夠提升你的設(shè)計 8051 系列微處理器基于簡化的嵌入式控制系統(tǒng)結(jié)構(gòu)被廣泛應(yīng)用于從軍事到自動控制再到PC 機上的鍵盤上的各種應(yīng)用系統(tǒng)上僅次于Motorola 68HC11 在 8 位微控制器市場上的銷量很多制造商都可提供8051 系列單片機像Intel Philips Siemens 等這些制造商給51 系列單片機加入了大量的性能和外部功能像I2C 總線接口模擬量到數(shù)字量的轉(zhuǎn)換看門狗PWM 輸出等不少芯片的工作頻率達到40M 工作電壓下降到1.5V 基于一個內(nèi)核的這些功能使得8051 單片機很適合作為廠家產(chǎn)品的基本構(gòu)架它能夠運行各種程序而且開發(fā)者只需要學習這一個平臺8051 系列的基本結(jié)構(gòu)如下1 一個8 位算術(shù)邏輯單元2 32 個I/O 口4 組8 位端口可單獨尋址3 兩個16 位定時計數(shù)器4 全雙工串行通信5 6 個中斷源兩個中斷優(yōu)先級6 128 字節(jié)內(nèi)置RAM7 獨立的64K 字節(jié)可尋址數(shù)據(jù)和代碼區(qū)每個8051 處理周期包括12 個振蕩周期每12 個振蕩周期用來完成一項操作如取指令和計算指令執(zhí)行時間可把時鐘頻率除以12 取倒數(shù)然后指令執(zhí)行所須的周期數(shù)因此如果你的系統(tǒng)時鐘是11.059MHz 除以12 后就得到了每秒執(zhí)行的指令個數(shù)為921583條指令取倒數(shù)將得到每條指令所須的時間1.085ms
上傳時間： 2013-11-09
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C8051Fxxx 系列單片機是完全集成的混合信號系統(tǒng)級芯片，具有與8051 兼容的微控制器內(nèi)核，與MCS-51 指令集完全兼容。除了具有標準8052 的數(shù)字外設(shè)部件之外，片內(nèi)還集成了數(shù)據(jù)采集和控制系統(tǒng)中常用的模擬部件和其它數(shù)字外設(shè)及功能部件。參見表1.1 的產(chǎn)品選擇指南可快速查看每個MCU 的特性。 MCU 中的外設(shè)或功能部件包括模擬多路選擇器、可編程增益放大器、ADC、DAC、電壓比較器、電壓基準、溫度傳感器、SMBus/ I2C、UART、SPI、可編程計數(shù)器/定時器陣列（PCA）、定時器、數(shù)字I/O 端口、電源監(jiān)視器、看門狗定時器（WDT）和時鐘振蕩器等。所有器件都有內(nèi)置的FLASH 程序存儲器和256 字節(jié)的內(nèi)部RAM，有些器件內(nèi)部還有位于外部數(shù)據(jù)存儲器空間的RAM，即XRAM。C8051Fxxx 單片機采用流水線結(jié)構(gòu)，機器周期由標準的12 個系統(tǒng)時鐘周期降為1 個系統(tǒng)時鐘周期，處理能力大大提高，峰值性能可達25MIPS。C8051Fxxx 單片機是真正能獨立工作的片上系統(tǒng)（SOC）。每個MCU 都能有效地管理模擬和數(shù)字外設(shè)，可以關(guān)閉單個或全部外設(shè)以節(jié)省功耗。FLASH 存儲器還具有在系統(tǒng)重新編程能力，可用于非易失性數(shù)據(jù)存儲，并允許現(xiàn)場更新8051 固件。應(yīng)用程序可以使用MOVC 和MOVX 指令對FLASH 進行讀或改寫，每次讀或?qū)懸粋€字節(jié)。這一特性允許將程序存儲器用于非易失性數(shù)據(jù)存儲以及在軟件控制下更新程序代碼。片內(nèi)JTAG 調(diào)試支持功能允許使用安裝在最終應(yīng)用系統(tǒng)上的產(chǎn)品MCU 進行非侵入式（不占用片內(nèi)資源）、全速、在系統(tǒng)調(diào)試。該調(diào)試系統(tǒng)支持觀察和修改存儲器和寄存器，支持斷點、單步、運行和停機命令。在使用JTAG 調(diào)試時，所有的模擬和數(shù)字外設(shè)都可全功能運行。每個MCU 都可在工業(yè)溫度范圍（-45℃到+85℃）內(nèi)用2.7V-3.6V（F018/019 為2.8V-3.6V）的電壓工作。端口I/O、/RST 和JTAG 引腳都容許5V 的輸入信號電壓。
上傳時間： 2013-11-14
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[CPLD-FPGA]《深入淺出玩轉(zhuǎn)FPGA視頻學習課程》35講全[wmv] 附件比較大所以整理了視頻迅雷種子。
上傳時間： 2013-10-31
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用QUARTUS_II做FPGA開發(fā)全流程
標簽： QUARTUS_II FPGA 流程 傻瓜式
上傳時間： 2013-11-18
上傳用戶：DXM35
使用QUARTUS II做開發(fā)全流程,傻瓜式詳細教程
上傳時間： 2013-10-12
上傳用戶：731140412
WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現(xiàn)方案： High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs
上傳時間： 2013-11-07
上傳用戶：defghi010
目前，大型設(shè)計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發(fā)沿設(shè)計，對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設(shè)計的要求，一般在FPGA設(shè)計中采用全局時鐘資源驅(qū)動設(shè)計的主時鐘，以達到最低的時鐘抖動和延遲。 FPGA全局時鐘資源一般使用全銅層工藝實現(xiàn)，并設(shè)計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu)，從而使全局時鐘到達芯片內(nèi)部的所有可配置單元(CLB)、I/O單元 (IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應(yīng)復(fù)雜設(shè)計的需要，Xilinx的FPGA中集成的專用時鐘資源與數(shù)字延遲鎖相環(huán)(DLL)的數(shù)目不斷增加，最新的 Virtex II器件最多可以提供16個全局時鐘輸入端口和8個數(shù)字時鐘管理模塊(DCM)。與全局時鐘資源相關(guān)的原語常用的與全局時鐘資源相關(guān)的Xilinx器件原語包括：IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等，如圖1所示。
上傳時間： 2014-01-01
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介紹了應(yīng)用VHDL技術(shù)設(shè)計嵌入式全數(shù)字鎖相環(huán)路的方法。詳細描述了其工作原理和設(shè)計思想，并用可編程邏輯器件FPGA加以實面。
標簽： FPGA 全數(shù)字 鎖相環(huán)路
上傳時間： 2014-12-28
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針對實時型相機對系統(tǒng)小型化、通用化及數(shù)據(jù)高速率可靠傳輸?shù)男枨螅闹性谘芯扛咚俅衅?解串器（SerDes）器件TLK2711工作原理的基礎(chǔ)上，提出了高速串行全雙工通信協(xié)議總體設(shè)計方案。文章以TLK2711為物理層、FPGA為鏈路層設(shè)計了高速串行全雙工通信協(xié)議，對協(xié)議的實現(xiàn)進行了詳細的描述。協(xié)議的在定制中力求做到了最簡化，為上層用戶提供簡單的數(shù)據(jù)接口。試驗中通過兩塊電路板的聯(lián)調(diào)，完成了數(shù)據(jù)率為2.5Gbps的點對點高速傳輸，采用發(fā)送偽隨機碼測試，系統(tǒng)工作2小時，所測誤碼率小于10-12。
上傳時間： 2014-12-28
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實驗三 連續(xù)時間周期信號的傅里葉級數(shù)
上傳時間： 2013-10-16
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