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全國計算機(jī)等級考試

  • 一款基于SRAM的FPGA器件設(shè)計

    FPGA是一種可通過用戶編程來實(shí)現(xiàn)各種數(shù)字電路的集成電路器件。用FPGA設(shè)計數(shù)字系統(tǒng)有設(shè)計靈活、低成本,低風(fēng)險、面市時間短等好處。本課題在結(jié)合國際上FPGA器件方面的各種研究成果基礎(chǔ)上,對FPGA器件結(jié)構(gòu)進(jìn)行了深入的探討,重點(diǎn)對FPGA的互連結(jié)構(gòu)進(jìn)行了分析與優(yōu)化。FPGA器件速度和面積上相對于ASIC電路的不足很大程度上是由可編程布線結(jié)構(gòu)造成的,F(xiàn)PGA一般用大量的可編程傳輸管開關(guān)和通用互連線段實(shí)現(xiàn)門器件的連接,而全定制電路中僅用簡單的金屬線實(shí)現(xiàn),傳輸管開關(guān)帶來很大的電阻和電容參數(shù),因而速度要慢于后者。這也說明,通過優(yōu)化可編程連接方式和布線結(jié)構(gòu),可大大改善電路的性能。本文研究了基于SRAM編程技術(shù)的FPGA器件中邏輯模塊、互連資源等對FPGA性能和面積的影響。論文中在介紹FPGA器件的體系構(gòu)架后,首先對開關(guān)矩陣進(jìn)行了研究,結(jié)合Wilton開關(guān)矩陣和Disioint開關(guān)矩陣的特點(diǎn),得到一個連接更加靈活的開關(guān)矩陣,提高了FPGA器件的可布線性,接著本課題中又對通用互連線長度、通用互連線間的連接方式和布線通道的寬度等進(jìn)行了探討,并針對本課題中的FPGA器件,得出了一套適合于中小規(guī)模邏輯器件的通用互連資源結(jié)構(gòu),仿真顯示新的互連方案有較好的速度和面積性能,在互連資源的面積和性能上達(dá)到一個很好的折中。 接下來課題中對FPGA電路的可編程邏輯資源進(jìn)行了研究,得到了一種邏輯規(guī)模適中的粗粒度邏輯塊簇,該邏輯塊簇采用類似Xilinx 公司的FPGA產(chǎn)品的LUT加觸發(fā)器結(jié)構(gòu),使邏輯塊簇內(nèi)部基本邏輯單元的聯(lián)系更加緊密,提高了邏輯資源的功能和利用率。隨后我們還研究了IO模塊數(shù)目的確定和分布式SRAM結(jié)構(gòu)中編程電路結(jié)構(gòu)的設(shè)計,并簡單介紹了SRAM單元的晶體管級設(shè)計原理。最后,在對FPGA構(gòu)架研究基礎(chǔ)上,完成了一款FPGA電路的設(shè)計并設(shè)計了相應(yīng)的電路測試方案,該課題結(jié)合CETC58研究所的一個重要項目進(jìn)行,目前已成功通過CSMC0.6μm 2P2M工藝成功流片,測試結(jié)果顯示其完全達(dá)到了預(yù)期的性能。

    標(biāo)簽: SRAM FPGA 器件設(shè)計

    上傳時間: 2013-04-24

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  • 基于FPGA的感應(yīng)加熱電源控制系統(tǒng)

    感應(yīng)加熱電源以其環(huán)保、節(jié)能等優(yōu)點(diǎn)在工業(yè)生產(chǎn)中得到了廣泛的應(yīng)用,逆變控制電路是直接影響感應(yīng)加熱電源能否安全、高效運(yùn)行的關(guān)鍵因素。目前的感應(yīng)加熱裝置很多采用模擬電路控制,而模擬控制電路觸點(diǎn)多,焊點(diǎn)多,系統(tǒng)可靠性低,對一些元件的工藝性要求高,電路中控制參數(shù)不容易進(jìn)行修改,靈活性較差。近年來隨著微處理機(jī)的發(fā)展,數(shù)字式控制精確,軟件設(shè)計靈活,因而整個控制系統(tǒng)容易實(shí)現(xiàn),在感應(yīng)加熱領(lǐng)域中運(yùn)用數(shù)字式控制已是一個發(fā)展方向。 本文在模擬逆變控制系統(tǒng)的基礎(chǔ)上,在可編程邏輯器件(FPGA)上進(jìn)行了數(shù)字式并聯(lián)逆變控制系統(tǒng)的研究。 首先,本文針對感應(yīng)加熱并聯(lián)逆變控制的數(shù)字化進(jìn)行了詳細(xì)的研究。在參閱國內(nèi)外相關(guān)文獻(xiàn)的基礎(chǔ)上,結(jié)合已有模擬并聯(lián)逆變控制電路的工作原理,設(shè)計了全數(shù)字鎖相環(huán)、它激轉(zhuǎn)自激掃頻啟動模塊等逆變控制功能模塊,并對各個模塊進(jìn)行了相關(guān)的數(shù)學(xué)分析和功能仿真,結(jié)果證明可以達(dá)到預(yù)定的功能指標(biāo)和設(shè)計要求。 然后,分析了感應(yīng)加熱電源的整體工作流程,針對模擬控制電路中控制參數(shù)不易進(jìn)行修改、靈活性較差等問題,設(shè)計了數(shù)據(jù)采集、存儲、顯示等功能模塊,有利于系統(tǒng)的調(diào)試,參數(shù)修改等實(shí)際操作。 最后,以模擬逆變控制策略為基礎(chǔ),分析了數(shù)字控制器的控制要求和策略。由硬件狀態(tài)機(jī)實(shí)現(xiàn)數(shù)字控制器的設(shè)計,完成對整個逆變控制系統(tǒng)的整體控制操作。通過自上而下的總體設(shè)計,將各個部分組合起來,構(gòu)成一個SOC系統(tǒng)。在FPGA集成軟件中進(jìn)行了各部分和整體的仿真驗證,結(jié)果證明該設(shè)計可以完成逆變控制的各項需求和預(yù)定的人機(jī)交互操作。

    標(biāo)簽: FPGA 感應(yīng)加熱電源 控制系統(tǒng)

    上傳時間: 2013-07-09

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  • 1553B總線接口技術(shù)研究及FPGA實(shí)現(xiàn)

    本論文在詳細(xì)研究MIL-STD-1553B數(shù)據(jù)總線協(xié)議以及參考國外芯片設(shè)計的基礎(chǔ)上,結(jié)合目前新興的EDA技術(shù)和大規(guī)模可編程技術(shù),提出了一種全新的基于FPGA的1553B總線接口芯片的設(shè)計方法。 從專用芯片實(shí)現(xiàn)的具體功能出發(fā),結(jié)合自頂向下的設(shè)計思想,給出了總線接口的總體設(shè)計方案,考慮到電路的具體實(shí)現(xiàn)對結(jié)構(gòu)進(jìn)行模塊細(xì)化。在介紹模擬收發(fā)器模塊的電路設(shè)計后,重點(diǎn)介紹了基于FPGA的BC、RT、MT三種類型終端設(shè)計,最終通過工作方式選擇信號以及其他控制信號將此三種終端結(jié)合起來以達(dá)到通用接口的功能。同時給出其設(shè)計邏輯框圖、算法流程圖、引腳說明以及部分模塊的仿真結(jié)果。為了資源的合理利用,對其中相當(dāng)部分模塊進(jìn)行復(fù)用。在設(shè)計過程中采用自頂向下、碼型轉(zhuǎn)換中的全數(shù)字鎖相環(huán)、通用異步收發(fā)器UART等關(guān)鍵技術(shù)。本設(shè)計使用VHDL描述,在此基礎(chǔ)之上采用專門的綜合軟件對設(shè)計進(jìn)行了綜合優(yōu)化,在FPGA芯片EP1K100上得以實(shí)現(xiàn)。通過驗證證明該設(shè)計能夠完成BC/RT/MT三種模式的工作,能處理多種消息格式的傳輸,并具有較強(qiáng)的檢錯能力。 最后設(shè)計了總線接口芯片測試系統(tǒng),選擇TMS320LF2407作為主處理器,測試主要包括主處理器的自發(fā)自收驗證,加入RS232串口調(diào)試過程提高測試數(shù)據(jù)的直觀性。驗證的結(jié)果表明本文提出的設(shè)計方案是合理的。

    標(biāo)簽: 1553B FPGA 總線接口 技術(shù)研究

    上傳時間: 2013-04-24

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  • 基于FPGA的數(shù)字合成信號發(fā)生器

    直接數(shù)字頻率合成(DDS)技術(shù)采用全數(shù)字的合成方法,所產(chǎn)生的信號具有頻率分辨率高、頻率切換速度快、頻率切換時相位連續(xù)、輸出相位噪聲低和可以產(chǎn)生任意波形等諸多優(yōu)點(diǎn)。 在理論上對DDS的原理及其輸出信號的性能進(jìn)行了分析,采用FPGA實(shí)現(xiàn)了任意波形發(fā)生器,能夠產(chǎn)生三角波、鋸齒波、調(diào)頻波、調(diào)相波、調(diào)幅波和碎發(fā)等十幾種波形,并能通過串行口下載任意波形。在設(shè)計頻率調(diào)制電路時采用了頻率字運(yùn)算單元和相位累加器相結(jié)合的結(jié)構(gòu),該方法既可實(shí)現(xiàn)寬帶線性調(diào)頻,又可實(shí)現(xiàn)非線性調(diào)頻。完成了軟件和硬件的設(shè)計和調(diào)試。對實(shí)驗樣機(jī)進(jìn)行了測試,結(jié)果表明性能指標(biāo)達(dá)到了設(shè)計要求。

    標(biāo)簽: FPGA 數(shù)字 合成 信號發(fā)生器

    上傳時間: 2013-05-26

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  • 圖像處理算法研究及硬件設(shè)計

    隨著圖像分辨率的越來越高,軟件實(shí)現(xiàn)的圖像處理無法滿足實(shí)時性的需求;同時FPGA等可編程器件的快速發(fā)展使得硬件實(shí)現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國內(nèi)外的一個熱門領(lǐng)域。 本文在FPGA平臺上,用Verilog HDL實(shí)現(xiàn)了一個研究圖像處理算法的可重復(fù)配置的硬件模塊架構(gòu),架構(gòu)包括PC機(jī)預(yù)處理和通信軟件,控制模塊,計算單元,存儲器模塊和通信適配模塊五個部分。其中的計算模塊負(fù)責(zé)具體算法的實(shí)現(xiàn),根據(jù)不同的圖像處理算法可以獨(dú)立實(shí)現(xiàn)。架構(gòu)為計算模塊實(shí)現(xiàn)了一個可添加、移出接口,不同的算法設(shè)計只要符合該接口就可以方便的加入到模塊架構(gòu)中來進(jìn)行調(diào)試和運(yùn)行。 在硬件架構(gòu)的基礎(chǔ)上本文實(shí)現(xiàn)了排序濾波,中值濾波,卷積運(yùn)算及高斯濾波,形態(tài)學(xué)算子運(yùn)算等經(jīng)典的圖像處理算法。討論了FPGA的圖像處理算法的設(shè)計方法及優(yōu)化策略,通過性能分析,F(xiàn)PGA實(shí)現(xiàn)圖像處理在時間上比軟件處理有了很大的提高;通過結(jié)果的比較,發(fā)現(xiàn)FPGA的處理結(jié)果達(dá)到了軟件處理幾乎同等的效果水平。最后本文在實(shí)現(xiàn)較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進(jìn),提高了算法的可用性,同時為進(jìn)一步的研究提供了更加便利的平臺。 整個設(shè)計都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開發(fā)的,在xilinx的Spartan-3E XC3S500E硬件平臺上實(shí)現(xiàn)。在軟件仿真過程中利用了ISE8.2自帶仿真工具和ModelSim結(jié)合使用。 本課題為制造FPGA的專用圖像處理芯片做了有益的探索性研究,為實(shí)現(xiàn)FPGA為核心處理芯片的實(shí)時圖像處理系統(tǒng)有著積極的作用。

    標(biāo)簽: 圖像處理 算法研究 硬件設(shè)計

    上傳時間: 2013-05-30

    上傳用戶:水瓶kmoon5

  • 基于FPGA的旋轉(zhuǎn)變壓器解碼算法

    由于旋轉(zhuǎn)變壓器的高精度高可靠性等特點(diǎn),廣泛的應(yīng)用于如航空、航天、船舶、兵器、雷達(dá)、通訊等領(lǐng)域。旋轉(zhuǎn)變壓器輸出模擬量交流信號,經(jīng)過數(shù)字處理轉(zhuǎn)換為數(shù)字角度信號才能進(jìn)入計算機(jī)或其他控制系統(tǒng),而這種數(shù)字處理比較復(fù)雜,采用專用的旋轉(zhuǎn)變壓器解碼芯片想達(dá)到理想的精度通常需要較高的成本,限制了它在其他領(lǐng)域的應(yīng)用。傳統(tǒng)的角測量系統(tǒng)面臨的問題有:體積、重量、功耗偏大,調(diào)試、誤差補(bǔ)償試驗復(fù)雜,費(fèi)用較高。 現(xiàn)場可編程門陣列(FPGA)是近年來迅速發(fā)展起來的新型可編程器件。隨著它的不斷應(yīng)用和發(fā)展,也使電子設(shè)計的規(guī)模和集成度不斷提高。同時也帶來了電子系統(tǒng)設(shè)計方法和設(shè)計思想的不斷推陳出新。 本文的目的是研究利用FPGA實(shí)現(xiàn)旋轉(zhuǎn)變壓器的硬件解碼算法,設(shè)計基于FPGA的旋轉(zhuǎn)變壓器解碼系統(tǒng)。 在本文所設(shè)計的系統(tǒng)中,通過FPGA芯片產(chǎn)生旋轉(zhuǎn)變壓器的激勵信號,再控制A/D轉(zhuǎn)換器對旋轉(zhuǎn)變壓器的模擬信號的數(shù)據(jù)進(jìn)行采樣和轉(zhuǎn)換,并對轉(zhuǎn)換完的數(shù)據(jù)進(jìn)行濾波處理,使用基于CORDIC算法流水線結(jié)構(gòu)設(shè)計的反正切函數(shù)模塊解算出偏轉(zhuǎn)角θ,最后通過串行口將解算的偏差角數(shù)據(jù)輸出。本文還分析了該系統(tǒng)誤差產(chǎn)生的原因和提高系統(tǒng)精度的方法。 實(shí)驗結(jié)果表明,本文所設(shè)計的旋轉(zhuǎn)變壓器解碼器的硬件組成和軟件實(shí)現(xiàn)基本能夠較精確的完成上述的信號轉(zhuǎn)換和數(shù)據(jù)運(yùn)算。

    標(biāo)簽: FPGA 旋轉(zhuǎn)變壓器 解碼 算法

    上傳時間: 2013-05-23

    上傳用戶:gdgzhym

  • 基于FPGA的遺傳算法硬件實(shí)現(xiàn)研究

    遺傳算法是基于自然選擇的一種魯棒性很強(qiáng)的解決問題方法。遺傳算法已經(jīng)成功地應(yīng)用于許多難優(yōu)化問題,現(xiàn)已成為尋求滿意解的最佳工具之一。然而,較慢的運(yùn)行速度也制約了其在一些實(shí)時性要求較高場合的應(yīng)用。利用硬件實(shí)現(xiàn)遺傳算法能夠充分發(fā)揮硬件的并行性和流水線的特點(diǎn),從而在很大程度上提高算法的運(yùn)行速度。 本文對遺傳算法進(jìn)行了理論介紹和分析,結(jié)合硬件自身的特點(diǎn),選用了適合硬件化的遺傳算子,設(shè)計了標(biāo)準(zhǔn)遺傳算法硬件框架;為了進(jìn)一步利用硬件自身的并行特性,同時提高算法的綜合性能,本文還對現(xiàn)有的一些遺傳算法的并行模型進(jìn)行了研究,討論了其各自的優(yōu)缺點(diǎn)及研究現(xiàn)狀,并在此基礎(chǔ)上提出一種適合硬件實(shí)現(xiàn)的粗粒度并行遺傳算法。 我們構(gòu)建的基于FPGA構(gòu)架的標(biāo)準(zhǔn)遺傳算法硬件框架,包括初始化群體、適應(yīng)度計算、選擇、交叉、變異、群體存儲和控制等功能模塊。文中詳細(xì)分析了各模塊的功能和端口連接,并利用硬件描述語言編寫源代碼實(shí)現(xiàn)各模塊功能。經(jīng)過功能仿真、綜合、布局布線、時序仿真和下載等一系列步驟,實(shí)現(xiàn)在Altera的Cyclone系列FPGA上。并且用它嘗試解決一些函數(shù)的優(yōu)化問題,給出了實(shí)驗結(jié)果。這些硬件模塊可以被進(jìn)一步綜合映射到ASIC或做成IP核方便其他研究者調(diào)用。 最后,本文對硬件遺傳算法及其在函數(shù)優(yōu)化中的一些尚待解決的問題進(jìn)行了討論,并對本課題未來的研究進(jìn)行了展望。

    標(biāo)簽: FPGA 算法 硬件 實(shí)現(xiàn)研究

    上傳時間: 2013-07-22

    上傳用戶:誰偷了我的麥兜

  • 基于FPGA的視頻圖像處理系統(tǒng)

    隨著電子技術(shù)和計算機(jī)技術(shù)的飛速發(fā)展,視頻圖像處理技術(shù)近年來得到極大的重視和長足的發(fā)展,其應(yīng)用范圍主要包括數(shù)字廣播、消費(fèi)類電子、視頻監(jiān)控、醫(yī)學(xué)成像及文檔影像處理等領(lǐng)域。當(dāng)前視頻圖像處理主要問題是當(dāng)處理的數(shù)據(jù)量很大時,處理速度慢,執(zhí)行效率低。而且視頻算法的軟件和硬件仿真和驗證的靈活性低。 本論文首先根據(jù)視頻信號的處理過程和典型視頻圖像處理系統(tǒng)的構(gòu)成提出了基于FPGA的視頻圖像處理系統(tǒng)總體框圖;其次選擇視頻轉(zhuǎn)換芯片SAA7113,完成視頻圖像采集模塊的設(shè)計,主要分三步完成:1)配置視頻轉(zhuǎn)換芯片的工作模式,完成視頻轉(zhuǎn)化芯片SAA7113的初始化:2)通過分析輸出數(shù)據(jù)流的格式標(biāo)準(zhǔn),來識別奇偶場信號、場消隱信號和有效行數(shù)據(jù)的開始和結(jié)束信號三種控制信號,并根據(jù)控制信號,用Verilog硬件描述語言編程實(shí)現(xiàn)圖像數(shù)據(jù)的采集;3)分析SRAM的讀寫控制時序,采用兩塊SRAM完成圖像數(shù)據(jù)的存儲。然后編寫軟件測試文件,在ISE Simulator仿真環(huán)境進(jìn)行程序測試與運(yùn)行,并分析仿真結(jié)果,驗證了數(shù)據(jù)采集和存儲的正確性;最后,對常用視頻圖像算法的MATLAB仿真,選擇適當(dāng)?shù)乃阕樱捎霉ぞ進(jìn)ATLAB、System Generator for DSP和ISE,利用模塊構(gòu)建方式,搭建視頻算法平臺,實(shí)現(xiàn)圖像平滑濾波、銳化濾波算法,在Simulink中仿真并自動生成硬件描述語言和網(wǎng)表,對資源的消耗做簡要分析。 本論文的創(chuàng)新點(diǎn)是采用新的開發(fā)環(huán)境System Generator for DSP實(shí)現(xiàn)視頻圖像算法。這種開發(fā)視頻圖像算法的方式靈活性強(qiáng)、設(shè)計周期短、驗證方便、是視頻圖像處理發(fā)展的必然趨勢。

    標(biāo)簽: FPGA 視頻圖像 處理系統(tǒng)

    上傳時間: 2013-07-28

    上傳用戶:lingzhichao

  • 基于FPGA全數(shù)字OFDM收發(fā)信機(jī)

    正交頻分復(fù)用(OFDM,Orthogonal Frequency Division Multiplexing)技術(shù)作為一種可以有效對抗信號波形間干擾的高速傳輸技術(shù),引起了廣泛關(guān)注。它利用許多并行的、傳輸?shù)退俾蕯?shù)據(jù)的子載波來實(shí)現(xiàn)高速率的通信。它的特點(diǎn)是各子載波相互正交,所以擴(kuò)頻調(diào)制后的頻譜可以相互重疊,不但減小了子載波問的相互干擾,還大大提高了頻譜利用率。由于OFDM的高頻譜利用率、易于硬件實(shí)現(xiàn)、對抗頻率選擇性衰落和窄帶干擾的能力突出等優(yōu)點(diǎn),它成為第四代移動通信的首選技術(shù),是當(dāng)前移動通信技術(shù)研究的熱點(diǎn)問題。 本文概括的介紹了OFDM系統(tǒng)的基本概念、基本工作原理和關(guān)鍵技術(shù),重點(diǎn)討論了如何在FPGA上實(shí)現(xiàn)OFDM低中頻收發(fā)信機(jī)。基于這些理論知識,確定了OFDM低中頻收發(fā)信機(jī)系統(tǒng)實(shí)現(xiàn)方案,并選擇ALTERA公司的Cyclone

    標(biāo)簽: FPGA OFDM 全數(shù)字 收發(fā)信機(jī)

    上傳時間: 2013-06-29

    上傳用戶:水瓶kmoon5

  • 橢圓曲線密碼體制的數(shù)字簽名算法

    隨著計算機(jī)運(yùn)算速度的提高和計算機(jī)網(wǎng)絡(luò)的發(fā)展,基于離散對數(shù)問題和大整數(shù)因子分解問題的數(shù)字簽名算法越來越不能滿足信息安全的需要。為了滿足信息安全的要求,安全性依賴于橢圓曲線離散對數(shù)困難問題(ECDLP)的橢圓曲線密碼體制是當(dāng)前密碼學(xué)界研究的熱點(diǎn)之一。現(xiàn)有的求解ECDLP的算法都是全指數(shù)時間復(fù)雜度的算法。由于專用集成電路具有速度快、性能好、安全性高等優(yōu)勢,使得采用專用集成電路來實(shí)現(xiàn)橢圓曲線密碼體制己成為主要趨勢。因此,本課題著眼于應(yīng)用,針對基于橢圓曲線數(shù)字簽名算法的FPGA實(shí)現(xiàn)進(jìn)行了較為深入的探討與研究。 本課題從實(shí)際應(yīng)用的需要出發(fā),以初等數(shù)論、有限域理論、數(shù)字簽名技術(shù)和橢圓曲線理論為依據(jù),確定了如下基于橢圓曲線數(shù)字簽名算法的硬件實(shí)現(xiàn)方案:首先,對實(shí)現(xiàn)基于橢圓曲線數(shù)字簽名算法所需的算法和技術(shù)進(jìn)行了剖析和系統(tǒng)設(shè)計。然后,按照層次化、模塊化的設(shè)計思想,在Xinlinx公司的ISE 7.1工具中,采用硬件描述語言VHDL作為設(shè)計輸入,對各運(yùn)算器和控制模塊進(jìn)行電路設(shè)計;采用Menter公司的ModelSim SE 6.2b工具對之進(jìn)行功能仿真,以保證底層設(shè)計的正確性。最后,在確保每個模塊的設(shè)計正確的前提下,完成電路的總體設(shè)計,再進(jìn)行總體設(shè)計的仿真與測試。 本課題對Schnorr數(shù)字簽名算法的改進(jìn),實(shí)現(xiàn)了比未改進(jìn)前的Schnorr數(shù)字簽名算法平均節(jié)省三分之一的運(yùn)行時間。對基于橢圓曲線數(shù)字簽名算法的設(shè)計也獲得了良好的指標(biāo):產(chǎn)生簽名只需要1ms多的時間,驗證簽名也需要不到3ms。本課題的研究對實(shí)現(xiàn)電子交易安全方面有重要的作用,尤其是在密鑰分配、電子貨幣、電子證券、電子商務(wù)和電子政務(wù)等領(lǐng)域都有重要的應(yīng)用價值,其成果具有廣泛的應(yīng)用前景。

    標(biāo)簽: 橢圓曲線 密碼體制 數(shù)字簽名算法

    上傳時間: 2013-04-24

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