IP核生成器生成 ip 后有兩個(gè)文件對(duì)我們比較有用，假設(shè)生成了一個(gè) asyn_fifo 的核，則 asyn_fifo.veo 給出了例化該核方式（或者在 Edit－>Language Template->COREGEN 中找到 verilog/VHDL 的例化方式）。asyn_fifo.v 是該核的行為模型，主要調(diào)用了 xilinx 行為模型庫 的模塊，仿真時(shí)該文件也要加入工程。
標(biāo)簽： ip IP核 生成器 比較
上傳時(shí)間： 2014-01-05
上傳用戶：頂?shù)弥?/p>
Xilinx FPGA 的IP核，實(shí)現(xiàn)FFT功能的
標(biāo)簽： Xilinx FPGA IP核
上傳時(shí)間： 2013-12-12
上傳用戶：han_zh
求取系統(tǒng)的絕對(duì)幅度響應(yīng)、相對(duì)的db值幅度響應(yīng)、相位響應(yīng)和群延時(shí)響應(yīng)的函數(shù) ％ ％db為相對(duì)振幅(dB) ％mag為絕對(duì)振幅 ％pha為相位響應(yīng) ％grd為群延時(shí) ％w為頻率樣本點(diǎn)向量 ％b為Ha(z)分子多項(xiàng)式系數(shù)(對(duì)FIR而言，b=h) ％a為Hz(z)分母多項(xiàng)式系數(shù)(對(duì)FIR而言，a=1) ％
標(biāo)簽： mag grd pha 幅度
上傳時(shí)間： 2014-01-21
上傳用戶：ryb
手機(jī)撥接上網(wǎng)一個(gè)小範(fàn)例希望能對(duì)大家有幫助
標(biāo)簽： 家
上傳時(shí)間： 2015-07-23
上傳用戶：yd19890720
針對(duì)51核的實(shí)驗(yàn)程序，包括匯編語言核C語言，有交通燈，步進(jìn)電機(jī)，濾波器等
標(biāo)簽： 實(shí)驗(yàn) 程序
上傳用戶：yyq123456789
數(shù)字預(yù)失真在通信領(lǐng)域內(nèi)IP核的開發(fā)文檔，包括數(shù)學(xué)表達(dá)式及硬件框圖
標(biāo)簽： 數(shù)字預(yù)失真 IP核 通信領(lǐng)域 文檔
上傳用戶：水口鴻勝電器
mcs51的vhdl IP核,是每個(gè)學(xué)習(xí)FPGA的必經(jīng)之路，希望一起探討
標(biāo)簽： FPGA vhdl mcs 51
上傳時(shí)間： 2014-01-14
上傳用戶：wuyuying
8051的VHDL IP核，很不錯(cuò)的東西
標(biāo)簽： 8051 VHDL IP核
上傳時(shí)間： 2014-01-09
上傳用戶：小碼農(nóng)lz
8051微控制器的ip 核的vhdl源代碼,其中包含了相應(yīng)的測(cè)試程序.
標(biāo)簽： 8051 vhdl 微控制器 源代碼
上傳時(shí)間： 2014-01-22
上傳用戶：784533221
leon2是一個(gè)源碼開放的嵌入式32位處理器ip核,該文件是leon2-1.0.20-xst.tar的源代碼
標(biāo)簽： leon2 leon xst tar
上傳時(shí)間： 2014-01-10
上傳用戶：佳期如夢(mèng)
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