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元數(shù)據(jù)邊下載邊播放

  • 動態(tài)電路在方波下形成的波形的解析

    這是一階二階電路在方波下形成的波形解析

    標(biāo)簽: 動態(tài)電路 方波 波形

    上傳時間: 2013-11-24

    上傳用戶:uuuuuuu

  • 基于System Generator的數(shù)字下變頻設(shè)計

    Xilinx公司推出的DSP設(shè)計開發(fā)工具System Generator是在Matlab環(huán)境中進行建模,是DSP高層系統(tǒng)設(shè)計與Xilinx FPGA之間實現(xiàn)的“橋梁”。在分析了FPGA傳統(tǒng)級設(shè)計方法的基礎(chǔ)上,提出了基于System Generator的系統(tǒng)級設(shè)計新方法,并應(yīng)用新方法設(shè)計驗證了一套數(shù)字下變頻系統(tǒng),通過仿真和實驗結(jié)果驗證了該方法的有效性和準確性。

    標(biāo)簽: Generator System 數(shù)字 變頻設(shè)計

    上傳時間: 2013-11-18

    上傳用戶:小草123

  • 華為公司電子工程師培訓(xùn)教材之模擬電子下

    華為公司電子工程師培訓(xùn)教材之模擬電子下

    標(biāo)簽: 華為公司 電子工程師 培訓(xùn)教材 模擬電子

    上傳時間: 2013-11-24

    上傳用戶:shus521

  • 時鐘抖動時域分析(下)

    時鐘抖動時域分析(下):

    標(biāo)簽: 時鐘抖動 時域分析

    上傳時間: 2013-11-18

    上傳用戶:rocketrevenge

  • CMOS工藝下高擺幅共源共柵偏置電路

    共源共柵級放大器可提供較高的輸出阻抗和減少米勒效應(yīng),在放大器領(lǐng)域有很多的應(yīng)用。本文提出一種COMS工藝下簡單的高擺幅共源共柵偏置電路,且能應(yīng)用于任意電流密度。根據(jù)飽和電壓和共源共柵級電流密度的定義,本文提出器件寬長比與輸出電壓擺幅的關(guān)系,并設(shè)計一種高擺幅的共源共柵級偏置電路。

    標(biāo)簽: CMOS 工藝 共源共柵 偏置電路

    上傳時間: 2013-10-08

    上傳用戶:debuchangshi

  • 設(shè)計實例2:MP3播放器硬件電路設(shè)計

    MP3播放器硬件電路設(shè)計實例

    標(biāo)簽: MP3 設(shè)計實例 播放器 硬件電路設(shè)計

    上傳時間: 2013-11-25

    上傳用戶:13788529953

  • win7下在Protel99se中添加PCB封裝庫的方法

    win7下如何添加PCB封裝庫

    標(biāo)簽: Protel win7 PCB 99

    上傳時間: 2014-01-04

    上傳用戶:cursor

  • WIN7操作系統(tǒng)下,protel99se添加元件庫的操作方法

    WIN7操作系統(tǒng)下,protel99se添加元件庫的操作方法

    標(biāo)簽: protel WIN7 99 se

    上傳時間: 2013-11-11

    上傳用戶:1966640071

  • Cadence完全學(xué)習(xí)手冊(下)

    這是蘭吉昌編寫的《Cadence完全自學(xué)手冊》的電子版,分上,中,下三冊,每冊17M左右,較大,資料相當(dāng)全哦!

    標(biāo)簽: Cadence 學(xué)習(xí)手冊

    上傳時間: 2013-11-02

    上傳用戶:qq521

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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