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儀的設(shè)(shè)計(jì)
使用VHDL設(shè)計一個適用於ETSI OFDM的時間和頻率同步處理器
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用來設(shè)定中斷TIMER0把計算出來的秒數(shù)輸出
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wdm驅(qū)動開發(fā)設(shè)計手冊的完整源碼, 網(wǎng)上少有
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經(jīng)典教程,錢能的c++程序設(shè)計教程,找了好久的
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TC&MSC高階函式庫設(shè)計技術(shù), 如何在DOS下作出圖形介面的程式, 備有豐富的程式庫.
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這一篇論文的標題為「適應(yīng)性BIC-MIMO-OFDM系統(tǒng)的性能分析和接收器設(shè)計」是2007發(fā)表的
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將Verilog設(shè)計轉(zhuǎn)成VHDL設(shè)計的程式
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將VHDL設(shè)計轉(zhuǎn)換成Verilog設(shè)計的程式
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JPEG的硬體設(shè)計採用的是VHDL設(shè)計,有源碼
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一個簡單的游戲設(shè)計...好好玩的
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