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信號(hào)(hào)隔離器

  • 有線數(shù)字電視廣播系統(tǒng)信道編碼

    隨著數(shù)字電視全國范圍丌播時(shí)間表的臨近,數(shù)字電視技術(shù)得到很大發(fā)展,數(shù)字電視信號(hào)在信源基帶數(shù)據(jù)和信道傳輸?shù)确矫嬉呀?jīng)進(jìn)一步標(biāo)準(zhǔn)化,數(shù)字電視傳播途徑也越來越廣,在衛(wèi)星、地面及有線電視網(wǎng)中傳輸數(shù)字電視信號(hào)得到迅速發(fā)展。借著2008年奧運(yùn)的東風(fēng),數(shù)字電視領(lǐng)域的應(yīng)用研究方興未艾。 本課題目的是完成有線數(shù)字電視廣播系統(tǒng)的重要設(shè)備--調(diào)制器的設(shè)計(jì)和實(shí)現(xiàn),核心器件選用FPGA芯片。系統(tǒng)硬件實(shí)現(xiàn)以國家標(biāo)準(zhǔn)GY/T 170-2001(有線數(shù)字電視廣播信道編碼與調(diào)制規(guī)范)為主要依據(jù),以Xilinx公司的Virtex系列(Virtex 4,Virtex 5)芯片及相關(guān)開發(fā)板(ML402、ML506)為平臺(tái),主要任務(wù)是基于相關(guān)標(biāo)準(zhǔn)對(duì)其實(shí)用技術(shù)進(jìn)行研究和開發(fā)。完成了信道編碼和調(diào)制的模塊劃分、Verilog HLD程序的編寫(或IP核的調(diào)用)和仿真以及在板調(diào)試和聯(lián)調(diào)等工作,設(shè)計(jì)目的是在提高整個(gè)系統(tǒng)集成度的前提下實(shí)現(xiàn)多頻點(diǎn)調(diào)制。 本文在研究現(xiàn)有數(shù)字電視網(wǎng)絡(luò)技術(shù)和相關(guān)產(chǎn)品的基礎(chǔ)上,以國標(biāo)GY/T170-2001為主要依據(jù)并參閱了其他的相關(guān)標(biāo)準(zhǔn),提出了多頻點(diǎn)QAM調(diào)制器的實(shí)現(xiàn)方案。整個(gè)工作包括:模塊劃分,完成了基帶物理接口(輸入)、包頭反轉(zhuǎn)與隨機(jī)化、RS編碼、卷積交織、碼流變換、差分編碼、星座映射、基帶成型(包括Nyquist濾波器、半帶濾波器、CIC濾波器的設(shè)計(jì)或模塊調(diào)用)、高端DAC的配置(輸出)等模塊的Verilog HLD程序的編寫(或者IP核調(diào)用)和仿真等工作;成功進(jìn)行了開發(fā)板板級(jí)調(diào)試,調(diào)試的過程中充分利用Xilinx公司的開發(fā)板和調(diào)試軟件ChipScope,成功設(shè)計(jì)了驗(yàn)證方案并進(jìn)行了模塊驗(yàn)證;最后進(jìn)行了各模塊聯(lián)調(diào)工作,設(shè)計(jì)了系統(tǒng)驗(yàn)證方案并成功完成對(duì)整個(gè)系統(tǒng)的驗(yàn)證工作。 經(jīng)測試表明,該系統(tǒng)主要性能達(dá)到國家相關(guān)標(biāo)準(zhǔn)GY/T 198-2003(有線數(shù)字電視廣播QAM調(diào)制器技術(shù)要求和測量方法)規(guī)定的技術(shù)指標(biāo),可以進(jìn)入樣機(jī)試生產(chǎn)環(huán)節(jié)。

    標(biāo)簽: 有線數(shù)字電視 廣播系統(tǒng) 信道編碼

    上傳時(shí)間: 2013-04-24

    上傳用戶:jiangfire

  • C8051編程器資料

    c8051編程器資料,u-ec2,u-ec5,u-pdc 資料

    標(biāo)簽: C8051 編程器

    上傳時(shí)間: 2013-05-31

    上傳用戶:1134473521

  • 卷積Turbo碼編譯碼器FPGA實(shí)現(xiàn)

    卷積Turbo碼因其優(yōu)異的糾錯(cuò)性能越來越受人門的關(guān)注,而編碼器和譯碼器是編碼理論實(shí)際應(yīng)用的重點(diǎn)和難點(diǎn)。論文根據(jù)IEEE802.16e標(biāo)準(zhǔn),以低時(shí)延、高吞吐量、支持高時(shí)鐘頻率、參數(shù)可配置為目標(biāo),對(duì)卷積Turbo碼編碼器和譯碼器的FPG...

    標(biāo)簽: Turbo FPGA 卷積 編譯碼器

    上傳時(shí)間: 2013-05-19

    上傳用戶:cuibaigao

  • 555定時(shí)器電路設(shè)計(jì)軟件

    555定時(shí)器電路設(shè)計(jì)軟件,有很多555電路參數(shù)的計(jì)算

    標(biāo)簽: 555 定時(shí)器電路 設(shè)計(jì)軟件

    上傳時(shí)間: 2013-04-24

    上傳用戶:戀天使569

  • 基于vhdl的移位寄存器設(shè)計(jì)

    16位帶有并行預(yù)置功能的右移移位寄存器,CLK1是時(shí)鐘信號(hào), LOAD是并行數(shù)據(jù)使能信號(hào),QB是串行輸出端口

    標(biāo)簽: vhdl 移位寄存器

    上傳時(shí)間: 2013-04-24

    上傳用戶:diamondsGQ

  • 直流斬波器工作原理

    簡介直流斬波器工作原理,有直流展播電路阿四分紅派個(gè) 一個(gè)一個(gè)

    標(biāo)簽: 直流 斬波器 工作原理

    上傳時(shí)間: 2013-06-12

    上傳用戶:guh000

  • LM4229電子書閱讀器

    LM4229電子書閱讀器,單片機(jī)做的,里面在有源代碼與proteus仿真模型,可以學(xué)習(xí)之用也可以做為畢設(shè),希望對(duì)學(xué)習(xí)者有所幫助^_^

    標(biāo)簽: 4229 LM 電子書閱讀器

    上傳時(shí)間: 2013-08-02

    上傳用戶:關(guān)外河山

  • 基于FPGA的ADC并行測試方法研究

    高性能ADC產(chǎn)品的出現(xiàn),給混合信號(hào)測試領(lǐng)域帶來前所未有的挑戰(zhàn)。并行ADC測試方案實(shí)現(xiàn)了多個(gè)ADC測試過程的并行化和實(shí)時(shí)化,減少了單個(gè)ADC的平均測試時(shí)間,從而降低ADC測試成本。本文實(shí)現(xiàn)了基于FPGA的ADC并行測試方法。在閱讀相關(guān)文獻(xiàn)的基礎(chǔ)上,總結(jié)了常用ADC參數(shù)測試方法和測試流程。使用FPGA實(shí)現(xiàn)時(shí)域參數(shù)評(píng)估算法和頻域參數(shù)評(píng)估算法,并對(duì)2個(gè)ADC在不同樣本數(shù)條件下進(jìn)行并行測試。    本研究通過在FPGA內(nèi)部實(shí)現(xiàn)ADC測試時(shí)域算法和頻域算法相結(jié)合的方法來搭建測試系統(tǒng),完成了音頻編解碼器WM8731L的控制模式接口、音頻數(shù)據(jù)接口、ADC測試時(shí)域算法和頻域算法的FPGA實(shí)現(xiàn)。整個(gè)測試系統(tǒng)使用Angilent33220A任意信號(hào)發(fā)生器提供模擬激勵(lì)信號(hào),共用一個(gè)FPGA內(nèi)部實(shí)現(xiàn)的采樣時(shí)鐘控制模塊。并行測試系統(tǒng)將WM8731.L片內(nèi)的兩個(gè)獨(dú)立ADC的串行輸出數(shù)據(jù)分流成左右兩通道,并對(duì)其進(jìn)行串并轉(zhuǎn)換。然后對(duì)左右兩個(gè)通道分別配置一個(gè)FFT算法模塊和時(shí)域算法模塊,并行地實(shí)現(xiàn)了ADC參數(shù)的評(píng)估算法。在樣本數(shù)分別為128和4096的實(shí)驗(yàn)條件下,對(duì)WM8731L片內(nèi)2個(gè)被測.ADC并行地進(jìn)行參數(shù)評(píng)估,被測參數(shù)包括增益GAIN、偏移量OFFSET、信噪比SNR、信號(hào)與噪聲諧波失真比SINAD、總諧波失真THD等5個(gè)常用參數(shù)。實(shí)驗(yàn)結(jié)果表明,通過在FPGA內(nèi)配置2個(gè)獨(dú)立的參數(shù)計(jì)算模塊,可并行地實(shí)現(xiàn)對(duì)2個(gè)相同ADC的參數(shù)評(píng)估,減小單個(gè)ADC的平均測試時(shí)間。FPGA片內(nèi)實(shí)時(shí)評(píng)估算法的實(shí)現(xiàn)節(jié)省了測試樣本傳輸至自動(dòng)測試機(jī)PC端的時(shí)間。而且只需將HDL代碼多次復(fù)制,就可實(shí)現(xiàn)多個(gè)被測ADC在同一時(shí)刻并行地被評(píng)估,配置靈活。基于FPGA的ADC并行測試方法易于實(shí)現(xiàn),具有可行性,但由于噪聲的影響,測試精度有待進(jìn)一步提高。該方法可用于自動(dòng)測試機(jī)的混合信號(hào)選項(xiàng)卡或測試子系統(tǒng)。

    標(biāo)簽: FPGA ADC 并行測試 方法研究

    上傳時(shí)間: 2013-06-07

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  • Actions 炬力MP3播放器2071/2073系列主控芯片

    ·詳細(xì)說明:Actions 炬力 MP3 播放器2071、2073系列主控芯片 參考電路圖,完整電路圖。-Actions the torch strength MP3 player 2,071, 2,073 series hosts control the chip reference circuit diagram, complete circuit diagram.

    標(biāo)簽: Actions 2071 2073 nbsp

    上傳時(shí)間: 2013-04-24

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  • 500W太陽能光伏并網(wǎng)逆變器電路設(shè)計(jì)圖

    500W太陽能光伏并網(wǎng)逆變器電路設(shè)計(jì)圖.由實(shí)驗(yàn)波形可以看出,所設(shè)計(jì)的光伏并網(wǎng)逆變器工作穩(wěn)定。性能良好。由于采用了以TMS320F240型:DSP為主的控制電路,系統(tǒng)具有較好的動(dòng)態(tài)響應(yīng)特性。采用了具有最大功率跟蹤和反孤島控制功能的軟件設(shè)計(jì),因而能充分利用太陽能電池的能源且能檢測孤島效應(yīng)的發(fā)生。

    標(biāo)簽: 500W 太陽能光伏 并網(wǎng)逆變器 電路設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

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