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信號(hào)流程

  • 可重構24bit音頻過采樣DAC的FPGA

    基于過采樣和∑-△噪聲整形技術的DAC能夠可靠地把數字信號轉換為高精度的模擬信號(大于等于16位)。采用這一架構進行數模轉換具有諸多優點,例如極低的失配噪聲和更高的可靠性,便于實現嵌入式集成等,最重要的是可以得到其他DAC結構所無法達到的精度和動態范圍。在高精度測量,音頻轉換,汽車電子等領域有著廣泛的應用價值。 本文采用∑-△結構以FPGA方式實現了一個具有高精度的數模轉換器,在24比特的輸入信號下,達到了約150dB的信噪比。作為一個靈活的音頻DAC實現方案。該DAC可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進行處理,接受并轉換采樣率為32/44.1/48/88.2/96/192kHz,字長為16/18/20/24比特的PCM數據,具備良好的兼容性和通用性。 由于非線性和不穩定性的存在,高階∑-△調制器的設計與實現存在較大的難度。本文綜合大量文獻中的經驗原則和方法,闡述了穩定的高階高精度調制器的設計流程;并據此設計了達到24bit精度和滿量程輸入范圍的的5階128倍調制器。本文創新性地提出了∑-△調制器的一種高效率流水線實現結構。分析表明,與其他常見的∑-△調制器實現結構相比,本方案具有結構簡單、運算單元少等優點;此外在同樣信號采樣率下,調制器所需的時鐘頻率大大降低。 文中的過采樣濾波模塊采用三級半帶濾波器和一個可變CIC濾波器級聯組成,可以達到最高128倍的過采樣比,同時具有良好的通帶和阻帶特性。在半帶濾波器的設計中采用了CSD編碼,使結構得到了充分的簡化。 本文提出的過采樣DAC方案具有可重配置結構,讓使用者能夠方便地控制過采樣比和調制器階數。通過積分梳狀濾波器的配置,能夠獲得32/64/128倍的不同過采樣比,從而實現對于32~192kHz多種采樣率輸入的處理。在不同輸入字長情況下,通過調制器的重構,則可以將調制器由高精度的5階模式改變為功耗更低的3階模式,滿足不同分辨率信號輸入時的不同精度要求。這是本文的另一創新之處。 目前,該過采樣DAC已經在XilinxVirtexⅡ系列FPGA器件下得到硬件實現和驗證。測試表明,對于從32kHz到192kHz的不同輸入信號,該DAC模塊輸出1比特碼流的帶內信噪比均能滿足24比特數據轉換應用的分辨率要求。

    標簽: FPGA bit DAC 24

    上傳時間: 2013-07-08

    上傳用戶:從此走出陰霾

  • 基于FPGA的ADC并行測試方法研究

    高性能ADC產品的出現,給混合信號測試領域帶來前所未有的挑戰。并行ADC測試方案實現了多個ADC測試過程的并行化和實時化,減少了單個ADC的平均測試時間,從而降低ADC測試成本。本文實現了基于FPGA的ADC并行測試方法。在閱讀相關文獻的基礎上,總結了常用ADC參數測試方法和測試流程。使用FPGA實現時域參數評估算法和頻域參數評估算法,并對2個ADC在不同樣本數條件下進行并行測試。    本研究通過在FPGA內部實現ADC測試時域算法和頻域算法相結合的方法來搭建測試系統,完成了音頻編解碼器WM8731L的控制模式接口、音頻數據接口、ADC測試時域算法和頻域算法的FPGA實現。整個測試系統使用Angilent33220A任意信號發生器提供模擬激勵信號,共用一個FPGA內部實現的采樣時鐘控制模塊。并行測試系統將WM8731.L片內的兩個獨立ADC的串行輸出數據分流成左右兩通道,并對其進行串并轉換。然后對左右兩個通道分別配置一個FFT算法模塊和時域算法模塊,并行地實現了ADC參數的評估算法。在樣本數分別為128和4096的實驗條件下,對WM8731L片內2個被測.ADC并行地進行參數評估,被測參數包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個常用參數。實驗結果表明,通過在FPGA內配置2個獨立的參數計算模塊,可并行地實現對2個相同ADC的參數評估,減小單個ADC的平均測試時間。FPGA片內實時評估算法的實現節省了測試樣本傳輸至自動測試機PC端的時間。而且只需將HDL代碼多次復制,就可實現多個被測ADC在同一時刻并行地被評估,配置靈活。基于FPGA的ADC并行測試方法易于實現,具有可行性,但由于噪聲的影響,測試精度有待進一步提高。該方法可用于自動測試機的混合信號選項卡或測試子系統。

    標簽: FPGA ADC 并行測試 方法研究

    上傳時間: 2013-06-07

    上傳用戶:gps6888

  • 51單片機的GSM收發短信C程序

    :51單片機的GSM收發短信C程序,包括了字庫轉換及IIC通信程序

    標簽: GSM 51單片機 C程序 收發

    上傳時間: 2013-04-24

    上傳用戶:change0329

  • 無線電中自適應調制解調器的FPGA實現

    隨著無線通信技術的不斷發展,人們對移動通信及寬帶無線接入業務需求的不斷增長,無線頻譜資源顯得日益匱乏。因此,如何提高頻譜利用率,一直以來就是無線通信領域研究的主要任務。認知無線電的提出成為當下解決頻譜資源稀缺的一個有效方法。而認知無線電的特性要求認知無線系統必須具備一個可重構的自適應調制解調器。因此,對于認知無線電平臺中自適應可重構調制解調器的深入研究具有重大的意義。    軟件無線電是實現認知無線電的理想平臺。本文首先闡述了軟件無線電的基本工作原理及關鍵技術,對多速率信號處理中的內插和抽取、帶通采樣、數字下變頻、濾波等技術進行了分析與探討,為設計自適應可重構調制解調器的設計提供了理論基礎。然后介紹了認知無線電系統的構成和基本工作方式,接著重點研究了其中通信模塊的FPGA實現。在通信模塊的實現中,研究了基于認知無線電的BPSK、π/4 DQPSK、8PSK及16QAM調制解調技術,簡要論述了他們的基本概念和原理,并給出了設計方案。接著按信號流程逐一介紹了各個功能模塊在DSP+FPGA硬件平臺上的實現,并對得到的數據進行了分析,給出了性能測試結果。在此基礎上,結合認知無線電系統的要求,提出了可變調制方式,可變傳輸帶寬的自適應可重構調制解調器的設計方案,并對其中一些關鍵模塊的硬件實現給出了分析,同時給出了收端波特率識別的策略。最后,論文提出了一些新的自適應技術,如波特率估計、信噪比估計等,并給出了應用這些技術的自適應調制解調器的改進方案。

    標簽: FPGA 無線 調制解調器

    上傳時間: 2013-06-17

    上傳用戶:alan-ee

  • android wifi開發流程和關鍵點分析

    作者:華清遠見3G學院。androidwifi開發流程和關鍵點分析--華清遠見android培訓課件教程。

    標簽: android wifi 開發流程

    上傳時間: 2013-04-24

    上傳用戶:大融融rr

  • 觸摸屏生產流程

    介紹觸摸屏的蝕刻加工及生產過程、測試過程、檢驗流程及成品出貨等整個流程詳細介紹,配以流程圖說明.

    標簽: 觸摸屏 生產流程

    上傳時間: 2013-04-24

    上傳用戶:hjkhjk

  • 美信半導體產品選型指南

    美信半導體是全球領先的半導體制造供應商,Maxim的電能計量方案提供全面的SoC器件選擇, 是多芯片方案的高精度、高性價比替代產品。無與倫比的動態范圍和獨特的32位可編程測量引擎,使 得我們的單芯片方案能夠滿足不同用戶的需求。為各種類型的表計開發提供了一條高效、便捷的途 徑,以滿足ANSI和IEC的市場要求。 ● 產品滿足不同國家對智能表系統以及低端瓦時(Wh)表、防篡改設計以及預付費設備的要求; ● 完備的開發工具加快軟件開發、測試和原型設計,縮短研發周期和產品上市時間。

    標簽: 美信 半導體產品 選型指南

    上傳時間: 2013-04-24

    上傳用戶:lgnf

  • 《通信原理》樊昌信(第五版)

    ·《通信原理》樊昌信(第五版)

    標簽: 通信原理

    上傳時間: 2013-06-29

    上傳用戶:lgnf

  • PROTEL99SE布線流程(超詳細)

    PROTEL99SE布線流程(超詳細) ----- 得到正確的原理圖和網絡表手工更改網絡表將一些元件的固定用腳等原理圖上沒有的焊盤定義到與它相通的網絡上沒任何物理連接的可定義到地或保護地等

    標簽: PROTEL 99 SE 布線

    上傳時間: 2013-05-24

    上傳用戶:lanwei

  • PDU短信編碼器

    一種pdu短信編碼工具,可以將數據轉換成unlcode碼,方便gsm方面的開發

    標簽: PDU 短信 編碼器

    上傳時間: 2013-05-21

    上傳用戶:wangdean1101

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