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使用知識

  • 使用FPGA模擬實現8051單片機及其外設的功能

    隨著電子技術的發展,當前數字系統的設計正朝著速度快、容量大、體積小、重量輕的方向發展.FPGA以其功能強大,開發過程投資少、周期短,可反復修改,保密性能好,開發工具智能化等特點成為當今硬件設計的首選方式之一.由于Intel公司的MCS-51系列單片機被公認為8位機的工業標準,因此,使用FPGA模擬實現8051單片機及其外設的功能便成為大規模復雜數字系統設計中的重要課題.該文首先介紹了FPGA及Xilinx公司關于硬件設計開發的工具ISE系統,繼而用VHDL語言編寫了8051單片機功能實現的源代碼,然后為其設計了與部分外設連接的接口模塊,包括8255并行接口、SCI串行接口和KBC鍵盤接口模塊.并將它們封裝到一塊FPGA之中,最終實現了8051單片機的大部分功能.

    標簽: FPGA 8051 模擬 單片機

    上傳時間: 2013-07-28

    上傳用戶:erkuizhang

  • 英飛凌公司DAVE2.O軟件的使用

    介紹了Infineon(英飛凌)公司DAVE2.O軟件的使用方法和一些需注意的要點,并按照流程編寫了一個“Infineon XC164CM”的閃燈測試程序

    標簽: DAVE2 英飛凌 軟件

    上傳時間: 2013-07-13

    上傳用戶:牛布牛

  • CCS中的graph詳細使用說明

    CCS中的graph詳細使用說明

    標簽: graph CCS 使用說明

    上傳時間: 2013-07-30

    上傳用戶:1043041441

  • Keil_uvision_4基本使用教程

    Keil_uvision_4軟件使用

    標簽: Keil_uvision 使用教程

    上傳時間: 2013-04-24

    上傳用戶:jxfzjh

  • FilterLab 2.0使用手冊(pdf)

    FilterLab2.0使用教程,好東西哦

    標簽: FilterLab 2.0 使用手冊

    上傳時間: 2013-07-19

    上傳用戶:lw852826

  • IAR使用教程

    IAR使用教程,IAR使用教程,IAR使用教程

    標簽: IAR 使用教程

    上傳時間: 2013-06-18

    上傳用戶:哈哈hah

  • RS485使用手冊與指南

    RS485使用手冊與指南RS485使用手冊與指南RS485使用手冊與指南RS485使用手冊與指南

    標簽: 485 RS 使用手冊

    上傳時間: 2013-07-05

    上傳用戶:dwzjt

  • Pspice中變壓器的使用

    教你如何在Cadence Pspice中使用變壓器

    標簽: Pspice 變壓器

    上傳時間: 2013-05-23

    上傳用戶:飛翔的胸毛

  • Protues使用總線方式畫電路的方法

    Protues使用總線方式畫電路的方法 使用教程 適合初級新手

    標簽: Protues 總線 方式 電路

    上傳時間: 2013-05-24

    上傳用戶:bcjtao

  • 卷積編碼和維特比譯碼的FPGA實現

    由于其很強的糾錯性能和適合硬件實現的編譯碼算法,卷積編碼和軟判決維特比譯碼目前已經廣泛應用于衛星通信系統。然而隨著航天事業的發展,衛星有效載荷種類的增多和分辨率的不斷提高,信息量越來越大。如何在低信噪比的功率受限信道條件下提高傳輸速率成為目前亟待解決的問題。本論文結合在研項目,在編譯碼算法、編譯碼器的設計與實現、編譯碼器性能提高三個方面對卷積編碼和維特比譯碼進行了深入研究,并進一步介紹了使用VHDL語言和原理圖混合輸入的方式,實現一種(7,3/4)增信刪余方式的高速卷積編碼器和維特比譯碼器的詳細過程;然后將設計下載到XILINX的Virtex2 FPGA內部進行功能和時序確認,最終在整個數據傳輸系統中測試其性能。本文所實現的維特比譯碼器速率達160Mbps,遠遠高于目前國內此領域內的相關產品速率。 首先,論文具體介紹了卷積編碼和維特比譯碼的算法,研究卷積碼的各種參數(約束長度、生成多項式、碼率以及增信刪余等)對其譯碼性能的影響;針對項目需求,確定卷積編碼器的約束長度、生成多項式格式、碼率和相應的維特比譯碼器的回歸長度。 其次,論文介紹了編解碼器的軟、硬件設計和調試一根據已知條件,使用VHDL語言和原理圖混合輸入的方式設計卷積編碼和維特比譯碼的源代碼和原理圖,分別采用功能和電路級仿真,確定卷積編碼和維特比譯碼分別需要占用的資源,考慮卷積編碼器和維特比譯碼器的具體設計問題,包括編譯碼的基本結構,各個模塊的功能及實現策略,編譯碼器的時序、邏輯綜合等;根據軟件仿真結果,分別確定卷積編碼器和維特比譯碼器的接口、所需的FPGA器件選型和進行各自的印制板設計。利用卷積碼本身的特點,結合FPGA內部結構,采用并行卷積編碼和譯碼運算,設計出高速編譯碼器;對軟、硬件分別進行驗證和調試,并將驗證后的軟件下載到FPGA進行電路級調試。 最后,論文討論了卷積編碼和維特比譯碼的性能:利用已有的測試設備在整個數據傳輸系統中測試其性能(與沒有采用糾錯編碼的數傳系統進行比對);在信道中加入高斯白噪聲,模擬高斯信道,進行誤碼率和信噪比測試。

    標簽: FPGA 卷積 編碼 譯碼

    上傳時間: 2013-04-24

    上傳用戶:mingaili888

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