詳細(xì)介紹了開關(guān)電源的設(shè)計(jì),再勵(lì)磁回路串接約為勵(lì)磁繞組電阻值10倍的附加電阻來構(gòu)成閉合電路，把同步電動機(jī)的定子直接接入電網(wǎng)，使之按異步電動機(jī)啟動，當(dāng)轉(zhuǎn)速達(dá)到亞同步轉(zhuǎn)速（95%）時(shí)，再切除附加電阻。
標(biāo)簽： 勵(lì)磁 開關(guān)電源 回路 繞組
上傳時(shí)間： 2014-01-14
上傳用戶：從此走出陰霾
設(shè)計(jì)一個(gè)比例控制器去對閉迴路轉(zhuǎn)移函數(shù)做控制。
標(biāo)簽： 比例 控制器 控制
上傳時(shí)間： 2015-05-08
上傳用戶：拔絲土豆
大型電子製造業(yè)后臺數(shù)據(jù)庫的詳細(xì)設(shè)計(jì)!絕對好東西!(部分刪減)
標(biāo)簽： 大型 后臺 分
上傳時(shí)間： 2015-05-17
上傳用戶：aa54
設(shè)計(jì)VHDL24小時(shí)的時(shí)鐘，去除了按鍵彈跳現(xiàn)象
標(biāo)簽： VHDL 24
上傳時(shí)間： 2013-12-23
上傳用戶：hzy5825468
Oracle9iデータベース物理設(shè)計(jì)方針表領(lǐng)域編
標(biāo)簽： Oracle9i 物理
上傳時(shí)間： 2015-05-23
上傳用戶：liansi
檔案系統(tǒng)FAT讀寫USB pen driver sample code
標(biāo)簽： driver sample code FAT
上傳用戶：tedo811
PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 為確保產(chǎn)品之製造性, R&D在設(shè)計(jì)階段必須遵循Layout相關(guān)規(guī)範(fàn), 以利製造單位能順利生產(chǎn), 確保產(chǎn)品良率, 降低因設(shè)計(jì)而重工之浪費(fèi).
標(biāo)簽： Layout 1.70 Rule PCB
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LVDS技術(shù)： 低電壓差分訊號(LVDS)在對訊號完整性、低抖動及共模特性要求較高的系統(tǒng)中得到了廣泛的應(yīng)用。本文針對LVDS與其他幾種介面標(biāo)準(zhǔn)之間的連接，對幾種典型的LVDS介面電路進(jìn)行了討論
標(biāo)簽： LVDS 差分 模 系統(tǒng)
上傳時(shí)間： 2014-01-13
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Audacity是一款用於錄音和編輯聲音的、免費(fèi)的開放源碼軟體。它可以執(zhí)行於Mac OS X、Microsoft Windows、GNU/Linux和其它作業(yè)系統(tǒng)
標(biāo)簽： Microsoft Audacity Windows Linux
上傳時(shí)間： 2013-12-18
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臺灣自然人憑證登入系統(tǒng)java card login 走PKCS-15
標(biāo)簽： login java card PKCS
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