詳細(xì)介紹了開(kāi)關(guān)電源的設(shè)計(jì),再勵(lì)磁回路串接約為勵(lì)磁繞組電阻值10倍的附加電阻來(lái)構(gòu)成閉合電路,把同步電動(dòng)機(jī)的定子直接接入電網(wǎng),使之按異步電動(dòng)機(jī)啟動(dòng),當(dāng)轉(zhuǎn)速達(dá)到亞同步轉(zhuǎn)速(95%)時(shí),再切除附加電阻。
標(biāo)簽: 勵(lì)磁 開(kāi)關(guān)電源 回路 繞組
上傳時(shí)間: 2014-01-14
上傳用戶:從此走出陰霾
大型電子製造業(yè)后臺(tái)數(shù)據(jù)庫(kù)的詳細(xì)設(shè)計(jì)!絕對(duì)好東西!(部分刪減)
標(biāo)簽: 大型 后臺(tái) 分
上傳時(shí)間: 2015-05-17
上傳用戶:aa54
設(shè)計(jì)VHDL24小時(shí)的時(shí)鐘,去除了按鍵彈跳現(xiàn)象
標(biāo)簽: VHDL 24
上傳時(shí)間: 2013-12-23
上傳用戶:hzy5825468
Oracle9iデータベース物理設(shè)計(jì)方針表領(lǐng)域編
標(biāo)簽: Oracle9i 物理
上傳時(shí)間: 2015-05-23
上傳用戶:liansi
PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 為確保產(chǎn)品之製造性, R&D在設(shè)計(jì)階段必須遵循Layout相關(guān)規(guī)範(fàn), 以利製造單位能順利生產(chǎn), 確保產(chǎn)品良率, 降低因設(shè)計(jì)而重工之浪費(fèi).
標(biāo)簽: Layout 1.70 Rule PCB
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用ecipse編輯的入門(mén)程式簡(jiǎn)單易懂可以試練習(xí)一下。
標(biāo)簽: ecipse 程式
上傳時(shí)間: 2014-09-03
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DelphiPackage實(shí)用集錦 動(dòng)態(tài)數(shù)據(jù)模組 設(shè)計(jì)模式重整技術(shù)運(yùn)用實(shí)例 以DelphiPackage架構(gòu)多人開(kāi)發(fā)應(yīng)用程式環(huán)境
標(biāo)簽: DelphiPackage 集錦 動(dòng)態(tài)數(shù)據(jù) 模組
上傳時(shí)間: 2014-11-22
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IBM 出的eclipse 介紹入門(mén)手冊(cè),希望對(duì)大家有幫助,請(qǐng)參考。
標(biāo)簽: eclipse IBM 手冊(cè)
上傳時(shí)間: 2014-01-24
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freescale c 入門(mén)的很好教程,仔細(xì)閱讀
標(biāo)簽: freescale 教程
上傳時(shí)間: 2015-07-03
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codewarrior的入門(mén)教程,請(qǐng)仔細(xì)閱讀
標(biāo)簽: codewarrior 教程
上傳時(shí)間: 2014-07-13
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