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是一個用verilog寫成的加法器電路,可把七個元件加起來
標簽： verilog 加法器 元件
上傳時間： 2014-01-07
上傳用戶：zhangzhenyu
案例一 貪吃蛇游戲 案例二 計算器 案例三 黑白棋游戲 案例四 迷宮問題 案例五 掃地雷游戲 案例六 速算24 案例七 數(shù)據(jù)結構CAI系統(tǒng) 案例八 進程調度 案例九 存儲管理分區(qū)分配算法 案例十 通訊錄 案例十一 學生成績管理 案例十二 工資管理 案例十三 圖書借閱管理 案例十四 教師工作量計算
標簽： 案例 CAI 數(shù)據(jù)結構 存儲管理
上傳時間： 2013-12-24
上傳用戶：qq521
sudoku 九直行九橫列，共分成九個九宮格，每行列都由１到９、不能重復的阿拉伯數(shù)字組成，每個九宮格亦然。但數(shù)獨游戲難易等級很多，每個只有一個解法。 可?BR> [九宮格.zip] - 九宮格的A*算法實現(xiàn) 可以選擇兩個估價函數(shù)，完成九宮格的自動求解。
標簽： sudoku
上傳時間： 2016-04-26
上傳用戶：xzt
Cisco 電話概論文章,語音技術概略
標簽： Cisco
上傳用戶：weixiao99
這是一個Verilog的電梯控制程序碼,控制樓層為1~4樓,關開門...等
標簽： Verilog 控制 程序
上傳時間： 2016-05-04
上傳用戶：wyc199288
使用硬體描述語言HDL 設計硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設計入門學習。VHDL基本語法架構，VHDL的零件庫(Library)及包裝(Package)等內容。
標簽： HDL
上傳時間： 2014-01-22
上傳用戶：cxl274287265
電子書Absolute.C.plus.plu
標簽： Absolute plus plu
上傳時間： 2013-12-23
上傳用戶：yph853211
5 bits 的加法器與減法器合併電路之原始程式製作
標簽： bits 加法器 法器 程式
上傳時間： 2016-05-18
上傳用戶：ippler8
第九章 本書是網(wǎng)絡原理和工程實踐的絕佳教科書，不僅適用于教師備課和課程實踐的安排，而且有利于網(wǎng)絡工程人員自學。該書涉及網(wǎng)絡方方面面，包括標準，協(xié)議，設備，軟件配置，安全和系統(tǒng)集成等，能使你在短時間內從外門漢成為令人羨慕的網(wǎng)絡高手。根據(jù)學習特點進行內容編排也是本書一大特色，本書提供現(xiàn)實生活中的實例，并配有大量實踐練習，不僅能讓你在短時間內輕松掌握網(wǎng)絡基本原理，而且能在學習基本原理的同時及時進行網(wǎng)絡實踐，使你成為名副其實的“理論家”和“實踐家”。
標簽： 網(wǎng)絡 工程實踐
上傳時間： 2014-01-01
上傳用戶：葉山豪
,《EVC高級編程及其應用開發(fā)》第九章代碼
標簽： EVC 高級編程 應用開發(fā) 代碼
上傳時間： 2014-01-12
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