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串擾分析

  • 單片機定時器t0 1計算、串口設置、波特率誤差分析

    單片機定時器t0\t1計算、串口設置、波特率誤差分析

    標簽: 單片機定時器 串口 計算 波特率

    上傳時間: 2013-12-23

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  • 數據結構十日談 第一日 緒論 第二日 算法的描述和分析 第三日 線性表 第四日 棧和隊列 第五日 串 第六日 數組 第七日 樹 第八日 圖 第九日 查找 第十日 排序

    數據結構十日談 第一日 緒論 第二日 算法的描述和分析 第三日 線性表 第四日 棧和隊列 第五日 串 第六日 數組 第七日 樹 第八日 圖 第九日 查找 第十日 排序

    標簽: 數據結構 排序 算法

    上傳時間: 2013-12-15

    上傳用戶:牛津鞋

  • 非常詳細地分析了linux下串口通信的程序

    非常詳細地分析了linux下串口通信的程序,有具體的方法思路以及完整的源代碼。

    標簽: linux 串口通信 程序

    上傳時間: 2017-06-05

    上傳用戶:skfreeman

  • 適用于銀行票據手寫數字串切分的滴水算法 摘要:在連通域提取與屬性判別的基礎上,得到不固定長度的粘連字串,利用波形分析的方法對字串個數進行判 斷,用具有指導信息的改進滴水切分算法解決了覆蓋、粘連

    適用于銀行票據手寫數字串切分的滴水算法 摘要:在連通域提取與屬性判別的基礎上,得到不固定長度的粘連字串,利用波形分析的方法對字串個數進行判 斷,用具有指導信息的改進滴水切分算法解決了覆蓋、粘連等非約束不確定位數的手寫數字串切分問題.該切分算 法在實際的銀行票據自動識別系統中取得了實用化的效果. 關 鍵 詞: 票據識別 數字切分 字串個數判斷

    標簽: 算法 數字 判別

    上傳時間: 2017-07-14

    上傳用戶:sardinescn

  • 普通方法設計單片機串行接口波特率時, 需要使用晶振。在分析8051 單片機串行硬件工作原理的基礎 上, 通過軟件編程實現所需的波特率。

    普通方法設計單片機串行接口波特率時, 需要使用晶振。在分析8051 單片機串行硬件工作原理的基礎 上, 通過軟件編程實現所需的波特率。

    標簽: 8051 波特率 單片機 串行接口

    上傳時間: 2017-07-16

    上傳用戶:wxhwjf

  • 基于VC++串口通信的實現的畢業論文和分析

    基于VC++串口通信的實現的畢業論文和分析

    標簽: VC 串口通信 畢業論文

    上傳時間: 2017-09-17

    上傳用戶:源弋弋

  • 0038STM32微控制器的可靠串口通信技術分析

    0038STM32微控制器的可靠串口通信技術分析

    標簽: stm32 微控制器 串口通信

    上傳時間: 2021-10-20

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  • PC終端調試工具軟件:Windows網絡分析工具網絡設置工具POP 4.1+串口調試助手ComPor

    PC終端調試工具軟件:Windows網絡分析工具網絡設置工具POP 4.1+串口調試助手ComPort-0P地址動態綁定功能;路由信息查詢和配置功能;MAC地址信息查詢、更改功能;MAC、主機信息掃描功能;MAC地址與廠家對應表;本機網絡報文統計功能;本機端口列表、遠程端口掃描功能;常用端口對照表;端口映射功能;網卡流量統計和指示功能;

    標簽: pc 終端調試 windows 網絡分析

    上傳時間: 2021-12-26

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  • 智能型航空蓄電池充電放電分析系統.rar

    航空蓄電池是重要的機載設備,在飛機安全飛行中起著重要的作用。蓄電池充電設備的性能直接影響著蓄電池的電氣性能和使用壽命,因此近年來航空蓄電池充電設備的研制已經成為研究的熱點之一。論文研究一種采用上下位機聯合控制的航空蓄電池充放電系統,對鉛酸蓄電池和鎘鎳蓄電池進行智能充電、放電和容量分析。 論文在綜合分析航空蓄電池充電器技術要求的基礎上,運用現代電力電子技術,設計了集充電、放電功能于一體的功率電路,并研制了基于DSP芯片TMS320F2812的充放電控制系統。論文詳細闡述了系統的設計方案、參數計算和控制方法。 論文以Visual Basic 6.0為開發環境,編制了航空蓄電池充放電系統的上位機軟件,實現了顯示、報警、打印、數據存儲與管理等功能。根據系統上下位機通信的需求,制定了通信協議并設計了基于RS-232串口的通信程序,實現了信息的交換與控制。 論文基于電路原理、自動控制原理等理論,建立了充電器控制系統的模型,并設計了以Buck電路為控制對象的系統仿真軟件。通過仿真分析,調整PID控制器的參數,優化控制器的性能,并縮短了調試的周期。

    標簽: 智能型 放電

    上傳時間: 2013-08-02

    上傳用戶:Amos

  • SATA協議分析及其FPGA實現.rar

    并行總線PATA從設計至今已快20年歷史,如今它的缺陷已經嚴重阻礙了系統性能的進一步提高,已被串行ATA(Serial ATA)即SATA總線所取代。SATA作為新一代磁盤接口總線,采用點對點方式進行數據傳輸,內置數據/命令校驗單元,支持熱插拔,具有150MB/s(SATA1.0)或300MB/s(SATA2.0)的傳輸速度。目前SATA已在存儲領域廣泛應用,但國內尚無獨立研發的面向FPGA的SATAIP CORE,在這樣的條件下設計面向FPGA應用的SATA IP CORE具有重要的意義。 本論文對協議進行了詳細的分析,建立了SATA IP CORE的層次結構,將設備端SATA IP CORE劃分成應用層、傳輸層、鏈路層和物理層;介紹了實現該IPCORE所選擇的開發工具、開發語言和所選用的芯片;在此基礎上著重闡述協議IP CORE的設計,并對各個部分的設計予以分別闡述,并編碼實現;最后進行綜合和測試。 采用FPGA集成硬核RocketIo MGT(RocketIo Multi-Gigabit Transceiver)實現了1.5Gbps的串行傳輸鏈路;設計滿足協議需求、適合FPGA設計的并行結構,實現了多狀態機的協同工作:在高速設計中,使用了流水線方法進行并行設計,以提高速度,考慮到系統不同部分復雜度的不同,設計采用部分流水線結構;采用在線邏輯分析儀Chipscope pro與SATA總線分析儀進行片上調試與測試,使得調試工作方便快捷、測試數據準確;嚴格按照SATA1.0a協議實現了SATA設備端IP CORE的設計。 最終測試數據表明,本論文設計的基于FPGA的SATA IP CORE滿足協議需求。設計中的SATA IP CORE具有使用方便、集成度高、成本低等優點,在固態電子硬盤SSD(Solid-State Disk)開發中應用本設計,將使開發變得方便快捷,更能夠適應市場需求。

    標簽: SATA FPGA 協議分析

    上傳時間: 2013-06-21

    上傳用戶:xzt

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