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串并聯(lián)電路

  • 基于FPGA的ADC并行測試方法研究

    高性能ADC產(chǎn)品的出現(xiàn),給混合信號測試領(lǐng)域帶來前所未有的挑戰(zhàn)。并行ADC測試方案實現(xiàn)了多個ADC測試過程的并行化和實時化,減少了單個ADC的平均測試時間,從而降低ADC測試成本。本文實現(xiàn)了基于FPGA的ADC并行測試方法。在閱讀相關(guān)文獻的基礎(chǔ)上,總結(jié)了常用ADC參數(shù)測試方法和測試流程。使用FPGA實現(xiàn)時域參數(shù)評估算法和頻域參數(shù)評估算法,并對2個ADC在不同樣本數(shù)條件下進行并行測試。    本研究通過在FPGA內(nèi)部實現(xiàn)ADC測試時域算法和頻域算法相結(jié)合的方法來搭建測試系統(tǒng),完成了音頻編解碼器WM8731L的控制模式接口、音頻數(shù)據(jù)接口、ADC測試時域算法和頻域算法的FPGA實現(xiàn)。整個測試系統(tǒng)使用Angilent33220A任意信號發(fā)生器提供模擬激勵信號,共用一個FPGA內(nèi)部實現(xiàn)的采樣時鐘控制模塊。并行測試系統(tǒng)將WM8731.L片內(nèi)的兩個獨立ADC的串行輸出數(shù)據(jù)分流成左右兩通道,并對其進行串并轉(zhuǎn)換。然后對左右兩個通道分別配置一個FFT算法模塊和時域算法模塊,并行地實現(xiàn)了ADC參數(shù)的評估算法。在樣本數(shù)分別為128和4096的實驗條件下,對WM8731L片內(nèi)2個被測.ADC并行地進行參數(shù)評估,被測參數(shù)包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個常用參數(shù)。實驗結(jié)果表明,通過在FPGA內(nèi)配置2個獨立的參數(shù)計算模塊,可并行地實現(xiàn)對2個相同ADC的參數(shù)評估,減小單個ADC的平均測試時間。FPGA片內(nèi)實時評估算法的實現(xiàn)節(jié)省了測試樣本傳輸至自動測試機PC端的時間。而且只需將HDL代碼多次復制,就可實現(xiàn)多個被測ADC在同一時刻并行地被評估,配置靈活。基于FPGA的ADC并行測試方法易于實現(xiàn),具有可行性,但由于噪聲的影響,測試精度有待進一步提高。該方法可用于自動測試機的混合信號選項卡或測試子系統(tǒng)。

    標簽: FPGA ADC 并行測試 方法研究

    上傳時間: 2013-06-07

    上傳用戶:gps6888

  • 基于FPGA的工頻干擾實時濾波技術(shù)

    生物醫(yī)學信號是源于一個生物系統(tǒng)的一類信號,像心音、腦電、生物序列和基因以及神經(jīng)活動等,這些信號通常含有與生物系統(tǒng)生理和結(jié)構(gòu)狀態(tài)相關(guān)的信息,它們對這些系統(tǒng)狀態(tài)的研究和診斷具有很大的價值。信號拾取、采集和處理的正確與否直接影響到生物醫(yī)學研究的準確性,如何有效地從強噪聲背景中提取有用的生物醫(yī)學信號是信號處理技術(shù)的重要問題。    設(shè)計自適應(yīng)濾波器對帶有工頻干擾的生物醫(yī)學信號進行濾波,從而消除工頻干擾,獲得最佳的濾波效果是本研究要解決的問題。生物醫(yī)學信號具有信號弱、噪聲強、頻率范圍較低、隨機性強等特點。由于心電(electrocardiogram,ECG)信號的確定性、穩(wěn)定性、規(guī)則性都比其他生物信號高,便于準確評估和檢測濾波效果,本研究采用ECG信號作為原始的模板信號。    本研究將新的電子芯片技術(shù)與現(xiàn)代信號處理技術(shù)相結(jié)合,從過去單一的軟件算法研究,轉(zhuǎn)向軟件與硬件結(jié)合,從而提高自適應(yīng)速度和精度,而且可以使系統(tǒng)的開發(fā)周期縮短、成本降低、容易升級和變更。    采用現(xiàn)場可編程邏輯器件(Field Programmable Gate Array,F(xiàn)PGA)作為新的ECG快速提取算法的硬件載體,加快信號處理的速度。為了將ECG快速提取算法轉(zhuǎn)換為常用的適合于FPGA芯片的定點數(shù)算法,研究中詳細分析了定點數(shù)的量化效應(yīng)對自適應(yīng)噪聲消除器的影響,以及對浮點數(shù)算法和定點數(shù)算法的復合自適應(yīng)濾波器的各種參數(shù)的選擇,如步長因子和字長選擇。研究中以定點數(shù)算法中的步長因子和字長選擇,作為FPGA設(shè)計的基礎(chǔ),利用串并結(jié)合的硬件結(jié)構(gòu)實現(xiàn)自適應(yīng)濾波器,并得到了預期的效果,準確提取改善后的ECG信號。    研究中,在MATLAB(Matrix Laboratry)軟件的環(huán)境下模擬,選取帶有50Hz工頻干擾的不同信噪比的ECG原始信號,在浮點數(shù)情況下,原始信號通過采用最小均方LMS(LeastMean Squares)算法的浮點數(shù)自適應(yīng)濾波器后,根據(jù)信噪比的改善和收斂速度,確定不同的最佳μ值,并在定點數(shù)情況下,在最佳μ值的情況下,原始信號通過采用LMs算法的定點數(shù)自適應(yīng)濾波器后,根據(jù)信噪比的改善效果和采用硬件的經(jīng)濟性,確定最佳的定點數(shù)。并了解LMS算法中步長因子、定點數(shù)字長值對信號信噪比、收斂速度和硬件經(jīng)濟性的影響。從而得出針對含有工頻干擾的不同信噪比的原始ECG,應(yīng)該采用什么樣的μ值和什么樣的定點數(shù)才能對原始ECG的改善和以后的硬件實現(xiàn)取得最佳的效果,并根據(jù)所得到的數(shù)據(jù)和結(jié)果,在FPGA上實現(xiàn)自適應(yīng)濾波器,使自適應(yīng)濾波器能對帶有工頻干擾的ECG原始信號有最佳的濾波效果。

    標簽: FPGA 工頻干擾 濾波技術(shù)

    上傳時間: 2013-04-24

    上傳用戶:gzming

  • 期刊論文:基于dsPIC30F的微機繼電保護裝置

    ·論文摘要:由dsPIC30F 組成的微機繼電保護裝置,采用雙CPU 系統(tǒng)的硬件、軟件結(jié)構(gòu),并以12 路模擬量的采集、改進的傅氏算法,系統(tǒng)外圍器件少,結(jié)構(gòu)簡單,能夠進行復雜的保護算法,滿足多種通信要求,具有良好的市場前景。

    標簽: dsPIC 30F 30 論文

    上傳時間: 2013-04-24

    上傳用戶:lwx1888

  • 10Gbits GPON系統(tǒng)的完整,緊湊型APD偏置解決方案

    雪崩光電二極管 (APD) 接收器模塊在光纖通信繫統(tǒng)中被廣泛地使用。APD 模塊包含 APD 和一個信號調(diào)理放大器,但並不是完全獨立。它仍舊需要重要的支持電路,包括一個高電壓、低噪聲電源和一個用於指示信號強度的精準電流監(jiān)視器

    標簽: Gbits GPON APD 10

    上傳時間: 2013-11-22

    上傳用戶:zhangyigenius

  • 基于FPGA的MSK調(diào)制器設(shè)計與實現(xiàn)

    介紹了MSK信號的優(yōu)點,并分析了其實現(xiàn)原理,提出一種MSK高性能數(shù)字調(diào)制器的FPGA實現(xiàn)方案;采用自頂向下的設(shè)計思想,將系統(tǒng)分成串/并變換器、差分編碼器、數(shù)控振蕩器、移相器、乘法電路和加法電路等6大模塊,重點論述了串/并變換、差分編碼、數(shù)控振蕩器的實現(xiàn),用原理圖輸入、VHDL語言設(shè)計相結(jié)合的多種設(shè)計方法,分別實現(xiàn)了各模塊的具體設(shè)計,并給出了其在QuartusII環(huán)境下的仿真結(jié)果。結(jié)果表明,基于FPGA的MSK調(diào)制器,設(shè)計簡單,便于修改和調(diào)試,性能穩(wěn)定。

    標簽: FPGA MSK 制器設(shè)計

    上傳時間: 2013-11-23

    上傳用戶:dvfeng

  • IC封裝製程簡介(IC封裝制程簡介)

    半導體的產(chǎn)品很多,應(yīng)用的場合非常廣泛,圖一是常見的幾種半導體元件外型。半導體元件一般是以接腳形式或外型來劃分類別,圖一中不同類別的英文縮寫名稱原文為   PDID:Plastic Dual Inline Package SOP:Small Outline Package SOJ:Small Outline J-Lead Package PLCC:Plastic Leaded Chip Carrier QFP:Quad Flat Package PGA:Pin Grid Array BGA:Ball Grid Array         雖然半導體元件的外型種類很多,在電路板上常用的組裝方式有二種,一種是插入電路板的銲孔或腳座,如PDIP、PGA,另一種是貼附在電路板表面的銲墊上,如SOP、SOJ、PLCC、QFP、BGA。    從半導體元件的外觀,只看到從包覆的膠體或陶瓷中伸出的接腳,而半導體元件真正的的核心,是包覆在膠體或陶瓷內(nèi)一片非常小的晶片,透過伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件,從上方的玻璃窗可看到內(nèi)部的晶片,圖三是以顯微鏡將內(nèi)部的晶片放大,可以看到晶片以多條銲線連接四周的接腳,這些接腳向外延伸並穿出膠體,成為晶片與外界通訊的道路。請注意圖三中有一條銲線從中斷裂,那是使用不當引發(fā)過電流而燒毀,致使晶片失去功能,這也是一般晶片遭到損毀而失效的原因之一。   圖四是常見的LED,也就是發(fā)光二極體,其內(nèi)部也是一顆晶片,圖五是以顯微鏡正視LED的頂端,可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線,若以LED二支接腳的極性來做分別,晶片是貼附在負極的腳上,經(jīng)由銲線連接正極的腳。當LED通過正向電流時,晶片會發(fā)光而使LED發(fā)亮,如圖六所示。     半導體元件的製作分成兩段的製造程序,前一段是先製造元件的核心─晶片,稱為晶圓製造;後一段是將晶中片加以封裝成最後產(chǎn)品,稱為IC封裝製程,又可細分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟,在本章節(jié)中將簡介這兩段的製造程序。

    標簽: 封裝 IC封裝 制程

    上傳時間: 2014-01-20

    上傳用戶:蒼山觀海

  • 電路板維修相關(guān)技術(shù)資料

    電路板故障分析 維修方式介紹 ASA維修技術(shù) ICT維修技術(shù) 沒有線路圖,無從修起 電路板太複雜,維修困難 維修經(jīng)驗及技術(shù)不足 無法維修的死板,廢棄可惜 送電中作動態(tài)維修,危險性極高 備份板太多,積壓資金 送國外維修費用高,維修時間長 對老化零件無從查起無法預先更換 維修速度及效率無法提升,造成公司負擔,客戶埋怨 投資大量維修設(shè)備,操作複雜,績效不彰

    標簽: 電路板維修 技術(shù)資料

    上傳時間: 2013-10-26

    上傳用戶:neu_liyan

  • 采用集成電流檢測來監(jiān)視和保護汽車系統(tǒng)

    對於集成電路而言,汽車是一種苛刻的使用環(huán)境,這裡,引擎罩下的工作溫度範圍可寬達 -40°C 至 125°C,而且,在電池電壓總線上出現(xiàn)大瞬變偏移也是預料之中的事

    標簽: 集成 電流檢測 保護 汽車系統(tǒng)

    上傳時間: 2013-11-20

    上傳用戶:zhaiye

  • 10A高性能負載點DCDC微型模塊

    電路板裝配、PCB 布局和數(shù)字 IC 集成的進步造就了新一代的高密度安裝、高性能繫統(tǒng)。

    標簽: DCDC 10A 性能 微型模塊

    上傳時間: 2013-10-17

    上傳用戶:RQB123

  • 小型DFN封裝的電子電路斷路器免除了檢測電阻器

    一直以來, 電子電路斷路器( E C B ) 都是由一個MOSFET、一個 MOSFET 控制器和一個電流檢測電阻器所組成的。

    標簽: DFN 封裝 電子電路 斷路器

    上傳時間: 2013-10-18

    上傳用戶:qwerasdf

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