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七段數(shù)碼管 VHDL

  • 用vhdl做得CPLD靜態(tài)兩位數(shù)碼管掃描 顯示“10”兩位數(shù)碼管公用段選

    用vhdl做得CPLD靜態(tài)兩位數(shù)碼管掃描 顯示“10”兩位數(shù)碼管公用段選

    標(biāo)簽: vhdl CPLD 數(shù)碼管

    上傳時(shí)間: 2016-11-08

    上傳用戶:偷心的海盜

  • 八段數(shù)碼管的顯示的小程序,環(huán)境是VHDL

    八段數(shù)碼管的顯示的小程序,環(huán)境是VHDL

    標(biāo)簽: VHDL 數(shù)碼管 程序 環(huán)境

    上傳時(shí)間: 2013-12-27

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  • FPGA開發(fā)板配套VHDL代碼。芯片為Mars EP1C6F。一些接口通信的源碼。包括7段數(shù)碼管、I2C通訊等。

    FPGA開發(fā)板配套VHDL代碼。芯片為Mars EP1C6F。一些接口通信的源碼。包括7段數(shù)碼管、I2C通訊等。

    標(biāo)簽: EP1C6F FPGA VHDL Mars

    上傳時(shí)間: 2017-05-25

    上傳用戶:jkhjkh1982

  • 7段數(shù)碼管譯碼器,用VHDL在FPGA2000上顯示

    7段數(shù)碼管譯碼器,用VHDL在FPGA2000上顯示

    標(biāo)簽: VHDL FPGA 2000 數(shù)碼管

    上傳時(shí)間: 2013-12-11

    上傳用戶:kiklkook

  • 利用一塊芯片完成除時(shí)鐘源、按鍵、揚(yáng)聲器和顯示器(數(shù)碼管)之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計(jì)具有體積小、設(shè)計(jì)周期短(設(shè)計(jì)過程中即可實(shí)現(xiàn)時(shí)序仿真)、調(diào)試

    利用一塊芯片完成除時(shí)鐘源、按鍵、揚(yáng)聲器和顯示器(數(shù)碼管)之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計(jì)具有體積小、設(shè)計(jì)周期短(設(shè)計(jì)過程中即可實(shí)現(xiàn)時(shí)序仿真)、調(diào)試方便、故障率低、修改升級(jí)容易等特點(diǎn)。 本設(shè)計(jì)采用自頂向下、混合輸入方式(原理圖輸入—頂層文件連接和VHDL語言輸入—各模塊程序設(shè)計(jì))實(shí)現(xiàn)數(shù)字鐘的設(shè)計(jì)、下載和調(diào)試。 一、 功能說明 已完成功能 1. 完成秒/分/時(shí)的依次顯示并正確計(jì)數(shù); 2. 秒/分/時(shí)各段個(gè)位滿10正確進(jìn)位,秒/分能做到滿60向前進(jìn)位; 3. 定時(shí)鬧鐘:實(shí)現(xiàn)整點(diǎn)報(bào)時(shí),又揚(yáng)聲器發(fā)出報(bào)時(shí)聲音; 4. 時(shí)間設(shè)置,也就是手動(dòng)調(diào)時(shí)功能:當(dāng)認(rèn)為時(shí)鐘不準(zhǔn)確時(shí),可以分別對(duì)分/時(shí)鐘進(jìn)行調(diào)整; 5. 利用多余兩位數(shù)碼管完成秒表顯示:A、精度達(dá)10ms;B、可以清零;C、完成暫停 可以隨時(shí)記時(shí)、暫停后記錄數(shù)據(jù)。 待改進(jìn)功能: 1. 鬧鐘只是整點(diǎn)報(bào)時(shí),不能手動(dòng)設(shè)置報(bào)時(shí)時(shí)間,遺憾之一; 2. 秒表不能向秒進(jìn)位,也就是最多只能記時(shí)100ms; 3. 秒表暫停記錄數(shù)據(jù)后不能在原有基礎(chǔ)上繼續(xù)計(jì)時(shí),而是復(fù)位重新開始。 【注意】秒表為后來添加功能,所以有很多功能不成熟!

    標(biāo)簽: CPLD VHDL 芯片 時(shí)鐘源

    上傳時(shí)間: 2014-01-02

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  • 數(shù)碼管段碼計(jì)算器

    數(shù)碼管段碼計(jì)算器

    標(biāo)簽: 數(shù)碼管 計(jì)算器

    上傳時(shí)間: 2013-04-15

    上傳用戶:eeworm

  • 工程中使用的一段資源管理vhdl程序,有簡(jiǎn)單的分頻代碼

    工程中使用的一段資源管理vhdl程序,有簡(jiǎn)單的分頻代碼等,希望能給你幫助

    標(biāo)簽: vhdl 工程 分頻 代碼

    上傳時(shí)間: 2013-08-10

    上傳用戶:sxdtlqqjl

  • CPLD VHDL 數(shù)碼管程序

    CPLD VHDL 數(shù)碼管程序 流水燈程序 時(shí)鐘程序CPLD VHDL 數(shù)碼管程序 流水燈程序 時(shí)鐘程序

    標(biāo)簽: CPLD VHDL 數(shù)碼管 程序

    上傳時(shí)間: 2013-08-11

    上傳用戶:huang111

  • 基于CPLD XC95018開發(fā)的一段VHDL代碼

    基于CPLD XC95018開發(fā)的一段VHDL代碼,可實(shí)現(xiàn)多個(gè)8051單片機(jī)互相通訊,對(duì)多單片機(jī)系統(tǒng)的設(shè)計(jì)很有參考價(jià)值

    標(biāo)簽: 95018 CPLD VHDL XC

    上傳時(shí)間: 2013-08-20

    上傳用戶:qijian11056

  • Arduino學(xué)習(xí)筆記A10_Arduino數(shù)碼管骰子實(shí)驗(yàn)

    電路連接 由于數(shù)碼管品種多樣,還有共陰共陽的,下面我們使用一個(gè)數(shù)碼管段碼生成器(在文章結(jié)尾) 去解決不同數(shù)碼管的問題: 本例作者利用手頭現(xiàn)有的一位不知品牌的共陽數(shù)碼管:型號(hào)D5611 A/B,在Eagle 找了一個(gè) 類似的型號(hào)SA56-11,引腳功能一樣可以直接代換。所以下面電路圖使用SA56-11 做引腳說明。 注意: 1. 將數(shù)碼管的a~g 段,分別接到Arduino 的D0~D6 上面。如果你手上的數(shù)碼管未知的話,可以通過通電測(cè)量它哪個(gè)引腳對(duì)應(yīng)哪個(gè)字段,然后找出a~g 即可。 2. 分清共陰還是共陽。共陰的話,接220Ω電阻到電源負(fù)極;共陽的話,接220Ω電阻到電源+5v。 3. 220Ω電阻視數(shù)碼管實(shí)際工作亮度與手頭現(xiàn)有原件而定,不一定需要準(zhǔn)確。 4. 按下按鈕即停。   源代碼 由于我是按照段碼生成器默認(rèn)接法接的,所以不用修改段碼生成器了,直接在段碼生成器選擇共陽極,再按“自動(dòng)”生成數(shù)組就搞定。   下面是源代碼,由于偷懶不用寫循環(huán),使用了部分AVR 語句。 PORTD 這個(gè)是AVR 的端口輸出控制語句,8 位對(duì)應(yīng)D7~D0,PORTD=00001001 就是D3 和D0 是高電平。 PORTD = a;就是找出相應(yīng)的段碼輸出到D7~D0。 DDRD 這個(gè)是AVR 語句中控制引腳作為輸出/輸入的語句。DDRD = 0xFF;就是D0~D7 全部 作為輸出腳了。 ARDUINO CODECOPY /* Arduino 單數(shù)碼管骰子 Ansifa 2011-12-28 */ //定義段碼表,表中十個(gè)元素由LED 段碼生成器生成,選擇了共陽極。 inta[10] = {0xC0, 0xF9, 0xA4, 0xB0, 0x99, 0x92, 0x82, 0xF8, 0x80, 0x90}; voidsetup() { DDRD = 0xFF; //AVR 定義PortD 的低七位全部用作輸出使用。即0xFF=B11111111對(duì) 應(yīng)D7~D0 pinMode(12, INPUT); //D12用來做骰子暫停的開關(guān) } voidloop() { for(int i = 0; i < 10; i++) { //將段碼輸出PortD 的低7位,即Arduino 的引腳D0~D6,這樣需要取出PORTD 最高位,即 D7的狀態(tài),與段碼相加,之后再輸出。 PORTD = a[i]; delay(50); //延時(shí)50ms while(digitalRead(12)) {} //如果D12引腳高電平,則在此死循環(huán),暫停LED 跑 動(dòng) } }      

    標(biāo)簽: Arduino 10 數(shù)碼管 實(shí)驗(yàn)

    上傳時(shí)間: 2013-10-15

    上傳用戶:baitouyu

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