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基于CPLD器件的現(xiàn)代數(shù)字系統(tǒng)設(shè)計(jì)方法

資 源 簡 介

摘要:介紹了一種利用CPLD芯片設(shè)計(jì)的數(shù)字鐘電路,該系統(tǒng)采用自頂向下的層次模塊化
設(shè)計(jì)手段構(gòu)建電路,代表了BDA的發(fā)展趨勢。文中結(jié)合實(shí)例詳盡介紹了原理圖設(shè)計(jì)輸入方
式以及設(shè)計(jì)過程。

 


 

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