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Verilog編碼中的非阻塞性賦值

  • 資源大小:54 K
  • 上傳時(shí)間: 2013-11-01
  • 上傳用戶:myhpgnl
  • 資源積分:2 下載積分
  • 標(biāo)      簽: Verilog 編碼 非阻塞性賦值

資 源 簡 介

 

One of the most misunderstood constructs in the Verilog language is the nonblockingassignment. Even very experienced Verilog designers do not fully understand how nonblockingassignments are scheduled in an IEEE compliant Verilog simulator and do not understand whenand why nonblocking assignments should be used. This paper details how Verilog blocking andnonblocking assignments are scheduled, gives important coding guidelines to infer correctsynthesizable logic and details coding styles to avoid Verilog simulation race conditions

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