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一種混沌偽隨機序列發生器的FPGA實現

資 源 簡 介

隨著混沌理論應用于產生偽隨機序列的發展,用現場可編程邏輯門陣列實現了基于TD—ERCS
混沌的偽隨機序列發生器.為了便于硬件實現并減少硬件占用資源.對原算法(即基于TD—ERCS構造
偽隨機序列發生器的算法)進行了適當改進,密鑰空間縮減到2⋯.設計采用雙精度浮點運算,選用Cyclone
系列的EPIC20F400芯片。完成了CPRSG的系統仿真實驗.系統的硬件電路占用17716個邏輯單
元,占芯片資源88%,工作頻率50 MHz,EPRS產生速率10 Mbps.

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