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基于FPGA的時鐘跟蹤環路的設計

  • 資源大小:223 K
  • 上傳時間: 2014-12-28
  • 上傳用戶:littlefish
  • 資源積分:2 下載積分
  • 標      簽: FPGA 時鐘 跟蹤環路

資 源 簡 介

提出了一種基于FPGA的時鐘跟蹤環路的設計方案,該方案簡化了時鐘跟蹤環路的結構,降低了時鐘調整電路的復雜度。實際電路測試結果表明,該方案能夠使接收機時鐘快速準確地跟蹤發射機時鐘的變化,且時鐘抖動小、穩準度高、工作穩定可靠。

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