賽靈思推出業(yè)界首款自動化精細粒度時鐘門控解決方案,該解決方案可將 Virtex®-6 和 Spartan®-6 FPGA 設計方案的動態(tài)功耗降低高達 30%。賽靈思智能時鐘門控優(yōu)化可自動應用于整個設計,既無需在設計流程中添加更多新的工具或步驟,又不會改變現(xiàn)有邏輯或時鐘,從而避免設計修改。此外,在大多數(shù)情況下,該解決方案都能保留時序結(jié)果。
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