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從零開始學(xué)CPLD和Verilog HDL編程技術(shù)

  • 資源大小:33352 K
  • 上傳時間: 2022-07-11
  • 上傳用戶:hxd
  • 資源積分:2 下載積分
  • 標      簽: cpld verilog hdl

資 源 簡 介

CPLD(復(fù)雜可編程邏輯器件)在數(shù)字電子技術(shù)領(lǐng)域中的應(yīng)用越來越廣泛,尤其適合于新產(chǎn)品的開發(fā)與小批量生產(chǎn),因此深

受廣大工程技術(shù)人員喜愛。

本書定位于讓初學(xué)者從零起步,輕松學(xué)會 CPLD 的系統(tǒng)設(shè)計技術(shù)。本書以 ALTERA 公司的系列芯片為目標載體,簡要分析

了可編程邏輯器件的結(jié)構(gòu)和特點,以及相應(yīng)開發(fā)軟件的使用方法,同時,還用大量篇幅介紹了初學(xué)者最容易掌握的

Verilog HDL硬件描述語言。本書完全以實戰(zhàn)為主、通過實踐的方法幫助讀者加深理解CPLD 的基本知識。

本書附贈光盤一張,光盤中包含了書中所有實驗的源程序。


本書可供從事各類電子系統(tǒng)設(shè)計的廣大工程技術(shù)人員以及電子愛好者閱讀,也可作為電子類專業(yè)的教材或教學(xué)參考書使用。


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