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DVB系統信道編碼的研究與FPGA實現.rar

  • 資源大小:3202 K
  • 上傳時間: 2013-06-26
  • 上傳用戶:xjd69
  • 資源積分:2 下載積分
  • 標      簽: FPGA DVB

資 源 簡 介

數字圖像通信的最廣泛的應用就是數字電視廣播系統,與以往的模擬電視業務相比,數字電視在節省頻譜資源、提高節目質量方面帶來了一場新的革命,而與此對應的DVB(Digital Video Broadcasting)標準的建立更是加速了數字電視廣播系統的大規模應用。DVB標準選定MPEG—2標準作為音頻及視頻的編碼壓縮方式,隨后對MPEG—2碼流進行打包形成TS流(transport stream),進行多個傳輸流復用,最后通過不同媒介進行傳輸。在DVB標準的傳輸系統中,無論是衛星傳輸,電纜傳輸還是地面傳輸,為了保障圖像質量,使數字節目在傳輸過程中避免出現因受到各種信道噪聲干擾而出現失真的現象,都采用了信道編碼的方式來保護傳輸數據。信道編碼是數字通信系統中一個必需的、重要的環節。 信道編碼設計方案的優劣決定了DVB系統的成功與否,本文重點研究了DVB系統中的信道編碼算法及其FPGA實現方案,主要進行了如下幾項工作: 1)介紹了DVB系統信道編碼的基本概念及特點,深入研究了DVB標準中信道編碼部分的關鍵技術,并針對每個信道編碼模塊進行工作原理分析、算法分析。 2)根據DVB信道編碼的特點,重點對信道編碼中四個模塊,包括擾碼、RS編碼、卷積交織編碼和卷積編碼的FPGA硬件實現算法進行了比較詳細的分析,并闡述了每個模塊及QPSK調制的設計方案及實現模塊功能的程序流程。 3)在RS(204,188)編碼過程中,利用有限域常數乘法器的特點,對編碼器進行了優化,在很大程度上提高了編碼效率,卷積交織器部分采用RAM移位法,實現起來更為簡單且節省了FPGA器件內部資源。 4)設計以Altera公司的QuartusⅡ為開發平臺,利用FPGA芯片EP1C6Q240C8完成了信道編碼各模塊及QPSK調制的硬件實現,通過Verilog HDL描述和時序仿真來驗證算法的可行性,并給出系統設計中減少毛刺的方法,使系統更為穩定。最終的系統仿真結果表明該系統工作穩定,達到了DVB系統信道編碼設計的要求。

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