在視頻傳輸系統中，最大障礙是視頻數據的大數據量傳輸。故壓縮就顯得尤為必要。MJPEG是以25幀每秒傳輸的JPEG圖像。本文根據JPEG基本壓縮模式，通過前端圖像采集芯片輸出標準的4：2：2格式的圖像流，在XILINX公司的SPARTAN IIE芯片下壓縮，獲得了良好效果，壓縮比達到10：1。中間的各個環節同MATLAB下同等壓縮相比，除了精度上有點差別外，基本一致。同專用芯片相比，比專用芯片靈活得多，FPGA內部全部是可編程，燒寫不同的程序便可實現不同的壓縮。同DSP相比，壓縮時間極大的提高，同周霖的“基于DSP技術的靜態圖像壓縮編碼”一文中編碼所需的時間進行比較(DCT變換消耗4224個指令，量化Z排序耗960指令，huffman編碼至少耗1400指令)，假設令其采用6000系列DSP，指令周期為6ns，運算速度為1336MIPS。壓縮一個8*8DCT塊，采用高檔的DSP，消耗39tJs，而采用27M的FPGA只需6us，若采用FPGA內部自帶的DLL將時鐘倍頻到54M，則只需要3us．本設計同傳統的壓縮實現方式相比，在速度和靈活性上有了極大的提高。
資源簡介：基于FPGA的MJPEG編碼,用硬件描述語言vlogic寫的
上傳時間： 2015-06-27
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資源簡介：基于FPGA的交織編碼器設計，主要講敘如何在FPGA上實現交織編碼器。
上傳時間： 2017-05-28
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資源簡介：基于FPGA的PCM編碼器與解碼器的設計
上傳時間： 2014-12-03
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資源簡介：基于FPGA的PCM編碼器與解碼器的設計
上傳時間： 2017-06-11
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資源簡介：未來的時代是信息時代，信息需要通過媒體來進行記錄、傳播和獲取。視頻數據的壓縮技術和解壓縮技術成了多媒體技術中的關鍵技術之一，本論文設計的芯片正是基于FPGA實現視頻編碼器的設計，主要面向于對音頻和視頻信號進行壓縮和解壓縮的廣泛場合。 本論文首先...
上傳時間： 2013-06-28
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資源簡介：基于FPGA的MJPEG視頻解碼器的芯片設計
上傳時間： 2013-06-10
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資源簡介：基于FPGA的分頻器,可以根據更改參數,實現不同倍數的分頻.
上傳時間： 2013-08-15
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資源簡介：verilog編寫基于FPGA的鑒相器模塊
上傳時間： 2013-08-19
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資源簡介：基于FPGA的SD轉換器的設計與實現，已經在實際項目中測試過，完全OK！
上傳時間： 2013-08-23
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上傳時間： 2013-11-23
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資源簡介：基于cpld的hdb3編碼器\r\n
上傳時間： 2013-08-29
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資源簡介：基于cpld的hdb3編碼器 基于cpld的hdb3編碼器
上傳時間： 2015-10-27
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資源簡介：基于FPGA的分頻器設計,已經通過了仿真(VHDL語言編寫)
上傳時間： 2013-12-14
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資源簡介：基于FPGA的SD轉換器的設計與實現，已經在實際項目中測試過，完全OK！
上傳時間： 2016-04-30
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資源簡介：電話計費器的verilog實現?；贔PGA的電話計費器實現。完成撥打電話自動計費的功能
上傳時間： 2016-05-10
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資源簡介：verilog編寫基于FPGA的鑒相器模塊
上傳時間： 2016-08-09
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資源簡介：基于FPGA的分頻器,可以根據更改參數,實現不同倍數的分頻.
上傳時間： 2014-11-18
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資源簡介：基于FPGA的PAL_VGA轉換器的實現.pdf
上傳時間： 2013-12-18
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資源簡介：一種基于FPGA的Viterbi譯碼器一種基于FPGA的Viterbi譯碼器
上傳時間： 2013-11-25
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上傳時間： 2021-11-14
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上傳時間： 2021-11-15
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上傳時間： 2021-12-01
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上傳時間： 2021-12-27
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上傳時間： 2022-03-16
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上傳時間： 2022-04-20
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上傳時間： 2022-04-28
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上傳時間： 2022-05-01
上傳用戶：d1997wayne
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上傳時間： 2013-04-24
上傳用戶：TI初學者
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上傳時間： 2013-06-24
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資源簡介：對于H.264視頻編碼系統，雖然單純用軟件也可以實現整個編碼過程，但是由于整個編碼系統的算法復雜度很高，里面又有大量的數學運算，使得軟件的計算能力差、速度慢，容易造成總線擁擠，所以單純地依靠軟件無法實現視頻編碼的要求。為了縮短整個編碼的時間，提...
上傳時間： 2013-06-30
上傳用戶：hehuaiyu
