本文以Turbo碼譯碼器的FPGA實現為目標,對Turbo碼的迭代譯碼算法及用硬件語言實現其譯碼算法進行了深入研究。 本文首先在理論上對Turbo碼的編譯碼原理進行了深入的研究,并用C語言對其MAP譯碼算法進行了驗證仿真,接著就Turbo碼MAP算法的衍生算法即LOG_MAP和MAX_LOG_MAP算法用C程序做了仿真和測試。隨后本文就一些對MAP譯碼性能起著重要影響的參數也用C程序做了仿真對比。 最后,考慮到硬件實現的簡化,MAX-Log-MAP算法成為了本文的硬件實現方案。本文采用了模塊化設計,在對各個模塊進行設計的基礎上提出了一些改進的方案,對Turbo碼編碼器設計中的同步問題進行了改進,對分塊并行Turbo碼譯碼算法的硬件實現進行了研究。在設計中綜合運用了“自頂向下”和“自下而上”的設計方去,通過功能模塊分割,合理設置系統參數,并通過模塊之間的參數傳遞,使Turbo碼編譯碼器具有較好的靈活性。
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