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• Max+Plus-II-簡(jiǎn)易用戶使用入門(mén)-38頁(yè).ppt免費(fèi)下載

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• Max+Plus II 簡(jiǎn)易用戶使用入門(mén) 38頁(yè).ppt免費(fèi)下載

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• 多功能電子時(shí)鐘的VHDL源代碼。使用MAX+PLUS II進(jìn)行編譯。該文檔有詳細(xì)的說(shuō)明和程序注釋。免費(fèi)下載

  資源簡(jiǎn)介：多功能電子時(shí)鐘的VHDL源代碼。使用MAX+PLUS II進(jìn)行編譯。該文檔有詳細(xì)的說(shuō)明和程序注釋。

  標(biāo)簽： VHDL PLUS MAX 多功能

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• MAX+PLUS II快速入門(mén) 16頁(yè) 0.4M.pdf免費(fèi)下載

  資源簡(jiǎn)介：可編程邏輯器件相關(guān)專輯 96冊(cè) 1.77GMAX+PLUS II快速入門(mén) 16頁(yè) 0.4M.pdf

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  上傳用戶：時(shí)代將軍

• MAX+PLUS II Advanced Synthsis 10.230免費(fèi)下載

  資源簡(jiǎn)介：MAX+PLUS II Advanced Synthsis ALtera的一個(gè)免費(fèi)HDL綜合工具，安裝后可以直接使用，是MaxplusII的一個(gè)插件，用這個(gè)插件進(jìn)行語(yǔ)言綜合，比直接使用MaxplusII綜合的效果好

  標(biāo)簽： Advanced Synthsis 10.230 PLUS

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  上傳用戶：feichengweoayauya

• 本文件包是在MAX+plus II 軟件環(huán)境下實(shí)現(xiàn)半加器的邏輯功能免費(fèi)下載

  資源簡(jiǎn)介：本文件包是在MAX+plus II 軟件環(huán)境下實(shí)現(xiàn)半加器的邏輯功能

  標(biāo)簽： plus MAX II 軟件環(huán)境

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• 3-8譯碼器的仿真實(shí)驗(yàn)。本實(shí)驗(yàn)選用的仿真開(kāi)發(fā)軟件是MAX+plus II Version 9.3免費(fèi)下載

  資源簡(jiǎn)介：3-8譯碼器的仿真實(shí)驗(yàn)。本實(shí)驗(yàn)選用的仿真開(kāi)發(fā)軟件是MAX+plus II Version 9.3，原理圖源文件保存在MyProject目錄中，為138decoder.gdf，另有我寫(xiě)的實(shí)驗(yàn)報(bào)告，呵呵，適合仿真入門(mén)

  標(biāo)簽： Version plus MAX 9.3

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• MAX+PLUS II ADVANCED SYNTHSIS 10.230免費(fèi)下載

  資源簡(jiǎn)介：機(jī)械設(shè)計(jì)軟件版R2.0 手冊(cè)

  標(biāo)簽： 2.0 機(jī)械設(shè)計(jì) 軟件

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  上傳用戶：eeworm

• 采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路免費(fèi)下載

  資源簡(jiǎn)介：采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路

  標(biāo)簽： Altera FPGA HDLC plus

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  上傳用戶：ommshaggar

• UART 的VHDL源代碼?？稍贗SE, Max-Plus II,等開(kāi)發(fā)環(huán)境下實(shí)現(xiàn)。免費(fèi)下載

  資源簡(jiǎn)介：UART 的VHDL源代碼?？稍贗SE, Max-Plus II,等開(kāi)發(fā)環(huán)境下實(shí)現(xiàn)。

  標(biāo)簽： Max-Plus UART VHDL ISE

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  上傳用戶：天涯

• 一個(gè)用max+plus II寫(xiě)的很小的源碼。簡(jiǎn)單但對(duì)初學(xué)還行吧免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)用max+plus II寫(xiě)的很小的源碼。簡(jiǎn)單但對(duì)初學(xué)還行吧

  標(biāo)簽： plus max 源碼

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• MAX+plus II 9.23 Baseline免費(fèi)下載

  資源簡(jiǎn)介：MAX+plus II 9.23 Baseline

  標(biāo)簽： Baseline 9.23 plus MAX

  上傳時(shí)間： 2014-01-13

  上傳用戶：franktu

• VHDL實(shí)例,在MAX+Plus+II下開(kāi)發(fā)免費(fèi)下載

  資源簡(jiǎn)介：VHDL實(shí)例,在MAX+Plus+II下開(kāi)發(fā)

  標(biāo)簽： VHDL Plus MAX II

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  上傳用戶：wanghui2438

• This a vhdl programme for realise an electron watch by max-plus II. The function includes time showi免費(fèi)下載

  資源簡(jiǎn)介：This a vhdl programme for realise an electron watch by max-plus II. The function includes time showing and time setting. It may be extended to other functions like alarming clock and so forth.

  標(biāo)簽： programme electron max-plus function

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  上傳用戶：dbs012280

• 本文件包是在MAX+plus II 軟件環(huán)境下實(shí)現(xiàn)全加器的邏輯功能免費(fèi)下載

  資源簡(jiǎn)介：本文件包是在MAX+plus II 軟件環(huán)境下實(shí)現(xiàn)全加器的邏輯功能

  標(biāo)簽： plus MAX II 軟件環(huán)境

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• 本文件包是在MAX+plus II 軟件環(huán)境下驗(yàn)證門(mén)電路的邏輯功能免費(fèi)下載

  資源簡(jiǎn)介：本文件包是在MAX+plus II 軟件環(huán)境下驗(yàn)證門(mén)電路的邏輯功能

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• 本文件包是在MAX+plus II 軟件環(huán)境下實(shí)現(xiàn)計(jì)數(shù)器的邏輯功能免費(fèi)下載

  資源簡(jiǎn)介：本文件包是在MAX+plus II 軟件環(huán)境下實(shí)現(xiàn)計(jì)數(shù)器的邏輯功能

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• 在EDA的MAX+PLUS II開(kāi)發(fā)環(huán)境下用VHDL編寫(xiě)的全加器免費(fèi)下載

  資源簡(jiǎn)介：在EDA的MAX+PLUS II開(kāi)發(fā)環(huán)境下用VHDL編寫(xiě)的全加器

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• 在MAX+PLUS II環(huán)境下用VHDL編寫(xiě)的加法器免費(fèi)下載

  資源簡(jiǎn)介：在MAX+PLUS II環(huán)境下用VHDL編寫(xiě)的加法器

  標(biāo)簽： PLUS VHDL MAX 環(huán)境

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• 在軟件MAX+plus II環(huán)境中免費(fèi)下載

  資源簡(jiǎn)介：在軟件MAX+plus II環(huán)境中，設(shè)計(jì)了一臺(tái)RISC模型機(jī)，具有以下功能：輸入包含10個(gè)整數(shù)（無(wú)符號(hào)數(shù)）的數(shù)組M，按從小到大的順序輸出這10個(gè)數(shù)。

  標(biāo)簽： plus MAX 軟件 環(huán)境

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