有限期作業(yè)安排問題”描述如下:有n個任務(wù)J1,J2,...,Jn,每個任務(wù)Ji都有一個完成期限di,若任務(wù)Ji在它的期限di內(nèi)完成,則可以獲利Ci(1[i[n) 問如何安排使得總的收益最大(假設(shè)完成每一個任務(wù)所需時間均為一個單位時間).這個問題適合用貪心算法來解決,貪心算法的出發(fā)點是每一次都選擇利潤大的任務(wù)來完成以期得到最多的收益 但是對于本問題由于每一個任務(wù)都有一個完成的期限,因此在任務(wù)安排過程中除了考慮利潤C(jī)i外,還要考慮期限di.
上傳時間： 2016-06-27
上傳用戶：s363994250
RA8802 是一個中英文文字與繪圖模式的點矩陣液晶顯示(LCD)控制器，可最大支援320x240 點的LCD 面 板。內(nèi)建512Kbyte 的字形碼可以顯示中文字型、數(shù)字符號與英文字母。在文字模式中，RA8802 可接收標(biāo)準(zhǔn) 中文文字內(nèi)碼直接顯示中文，而不需要進(jìn)入繪圖模式以繪圖方式描繪中文，可以節(jié)省許多微處理器時間，提 升液晶顯示中文之處理效率。
上傳時間： 2014-06-08
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許多電信和計算應(yīng)用都需要一個能夠從非常低輸入電壓獲得工作電源的高效率降壓型 DC/DC 轉(zhuǎn)換器。高輸出功率同步控制器 LT3740 就是這些應(yīng)用的理想選擇，該器件能把 2.2V 至 22V 的輸入電源轉(zhuǎn)換為低至 0.8V 的輸出，並提供 2A 至 20A 的負(fù)載電流。其應(yīng)用包括分布式電源繫統(tǒng)、負(fù)載點調(diào)節(jié)和邏輯電源轉(zhuǎn)換。
上傳時間： 2013-12-30
上傳用戶：arnold
控制器源代碼,包含輸入點N個，輸出點N個，AD轉(zhuǎn)換16位，DA輸出8位
上傳時間： 2013-12-05
上傳用戶：heart520beat
富士N系列可編程控制器PLC編程手冊,介紹Flex N系列PLC的情況和其操作。
上傳時間： 2013-12-15
上傳用戶：sk5201314
樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個節(jié)點內(nèi)元素個數(shù)在 [MIN,2*MIN] 之間, 但根節(jié)點元素個數(shù)為 [1,2*MIN] (2) 節(jié)點內(nèi)元素由小排到大, 元素不重複 (3) 每個節(jié)點內(nèi)的指標(biāo)個數(shù)為元素個數(shù)加一 (4) 第 i 個指標(biāo)所指向的子節(jié)點內(nèi)的所有元素值皆小於父節(jié)點的第 i 個元素 (5) B 樹內(nèi)的所有末端節(jié)點深度一樣
上傳時間： 2017-05-14
上傳用戶：日光微瀾
基于FPGA的SPI控制器.doc,包括FPGA實現(xiàn)地源代碼和協(xié)議的基本介紹\\r\\n
上傳時間： 2013-08-14
上傳用戶：lili123
基于ARM 微控制器配置FPGA 的實現(xiàn)\r\n摘 要:介紹了基于ARM 內(nèi)核的ATMEL AT91FR4081 微控制器以J TAG 的ISP 方式配置XILINX\r\nXC2S150PQ208 FPGA 的實現(xiàn)過程。這是一種靈活和經(jīng)濟(jì)的FPGA 的配置方法。介紹了ISP 和J TAG 的原\r\n理、系統(tǒng)實現(xiàn)的流程、硬件電路設(shè)計、J TAG 驅(qū)動算法的實現(xiàn)和配置時間的測試結(jié)果。
標(biāo)簽： XILINXFPGA ATMEL 4081 JTAG
上傳時間： 2013-08-15
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針對嵌入式系統(tǒng)的底層網(wǎng)絡(luò)接口給出了一種由FPGA實現(xiàn)的以太網(wǎng)控制器的設(shè)計方法．該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式，同時可提供MII接口，可并通過外接以太網(wǎng)物理層（PHY）芯片來實現(xiàn)網(wǎng)絡(luò)接入\r\n
標(biāo)簽： FPGA 嵌入式系統(tǒng) 以太網(wǎng)控制器 底層
上傳時間： 2013-08-18
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FPGA視頻控制器設(shè)計,FED驅(qū)動控制系統(tǒng)的研制與FPGA設(shè)計\r\n
標(biāo)簽： FPGA FED 視頻 制器設(shè)計
上傳時間： 2013-08-20
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