十分鐘學會Xilinx FPGA 設計1.1，內(nèi)容明了，推薦
標簽： Xilinx FPGA 1.1 十分
上傳時間： 2013-12-30
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XILINX的FPGA實現(xiàn)的雙口ram源碼，可作為dsp\SDRAM和pci橋接作用，可直接使用，實際工程通過。
標簽： XILINX FPGA ram 雙口
上傳時間： 2013-12-29
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這是個基于 Xilinx Spartan3 的加法器，利用Verilog語言編寫，對于EDA初學者來說有一定的參考價值。
標簽： Spartan3 Xilinx 加法器
上傳時間： 2014-02-02
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FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼7
標簽： FPGA CPLD ise 集成開發(fā)環(huán)境
上傳時間： 2015-10-28
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FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼8
上傳時間： 2014-12-04
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FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼9
上傳用戶：凌云御清風
FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼10
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FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼
上傳時間： 2013-11-26
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xilinx ddr controler
標簽： controler xilinx ddr
上傳時間： 2015-10-31
本程序以ISE為開發(fā)平臺，采用VHDL為開發(fā)語言，實現(xiàn)了對一個時鐘信號延時的功能
標簽： ISE 程序 開發(fā)平臺
上傳時間： 2015-11-03
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