niOSII那些事兒-Qsys_EP4CE15_v1.1.2 學(xué)習(xí)niOSII的首選材料 通俗易懂
標(biāo)簽： Qsys_EP niOSII CE 15
上傳時(shí)間： 2013-04-24
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此書是有關(guān)FPGA的niOSII開發(fā)系統(tǒng)的書，其內(nèi)容較好，值得學(xué)習(xí)
標(biāo)簽： niOSII FPGA 開發(fā)系統(tǒng)
上傳時(shí)間： 2013-08-17
上傳用戶：lty6899826
用niOSII軟核配置FPGA的C語言源程序，比較經(jīng)典，我用一年了，時(shí)序不需更改
標(biāo)簽： niOSII FPGA C語言 軟核
上傳時(shí)間： 2013-08-21
上傳用戶：qq521
niOSII培訓(xùn)教程與實(shí)驗(yàn)材料 不錯(cuò)的培訓(xùn)教程，希望你們能夠喜歡!
標(biāo)簽： niOSII 培訓(xùn)教程 實(shí)驗(yàn) 材料
上傳時(shí)間： 2014-12-27
上傳用戶：yueguizhilin
niOSII入門
標(biāo)簽： niOSII 5.0 REV
上傳時(shí)間： 2013-10-28
上傳用戶：lepoke
niOSII從入門到精通。ＳＯＰＣ學(xué)習(xí)的好資料
標(biāo)簽： niOSII
上傳時(shí)間： 2014-12-28
上傳用戶：gtzj
niOSII軟核處理器是Altera公司開發(fā)，基于FPGA操作平臺(tái)使用的一款高速處理器，為了適應(yīng)高速運(yùn)動(dòng)圖像采集，提出了一種基于niOSII軟核處理的步進(jìn)電機(jī)接口設(shè)計(jì)，使用verilog HDL語言完成該接口設(shè)計(jì)，最后通過QuartusII軟件，給出了實(shí)驗(yàn)仿真結(jié)果。
標(biāo)簽： niOSII 軟核處理器 步進(jìn)電機(jī) 接口設(shè)計(jì)
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利用niOSII多核處理器，提出了基于Internet的實(shí)時(shí)路況查詢系統(tǒng)和智能車載終端。通過配置雙niOSII軟核，改善了MCU處理速度不高、外設(shè)資源有限、接口配置繁瑣、硬件設(shè)計(jì)和軟件設(shè)計(jì)編程復(fù)雜等問題，將大量控制以及對多種外設(shè)訪問的工作進(jìn)行了合理分配。既具有普通導(dǎo)航設(shè)備的方便實(shí)用性，又能通過無線通訊及Internet與后臺(tái)服務(wù)器連接，獲取道路擁堵情況、停車場車位情況等動(dòng)態(tài)實(shí)時(shí)信息，同時(shí)可作為智能交通的車載前端。
標(biāo)簽： niOSII 多核 智能交通 車載終端
上傳時(shí)間： 2014-12-30
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上傳時(shí)間： 2013-10-19
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上傳時(shí)間： 2013-11-03
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