針對實時型相機對系統小型化、通用化及數據高速率可靠傳輸的需求，文中在研究高速串行器/解串器（SerDes）器件TLK2711工作原理的基礎上，提出了高速串行全雙工通信協議總體設計方案。文章以TLK2711為物理層、FPGA為鏈路層設計了高速串行全雙工通信協議，對協議的實現進行了詳細的描述。協議的在定制中力求做到了最簡化，為上層用戶提供簡單的數據接口。試驗中通過兩塊電路板的聯調，完成了數據率為2.5Gbps的點對點高速傳輸，采用發送偽隨機碼測試，系統工作2小時，所測誤碼率小于10-12。
上傳時間： 2014-12-28
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目前，大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計，對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求，一般在FPGA設計中采用全局時鐘資源驅動設計的主時鐘，以達到最低的時鐘抖動和延遲。 FPGA全局時鐘資源一般使用全銅層工藝實現，并設計了專用時鐘緩沖與驅動結構，從而使全局時鐘到達芯片內部的所有可配置單元(CLB)、I/O單元 (IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜設計的需要，Xilinx的FPGA中集成的專用時鐘資源與數字延遲鎖相環(DLL)的數目不斷增加，最新的 Virtex II器件最多可以提供16個全局時鐘輸入端口和8個數字時鐘管理模塊(DCM)。與全局時鐘資源相關的原語常用的與全局時鐘資源相關的Xilinx器件原語包括：IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等，如圖1所示。
上傳時間： 2013-11-20
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摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議 為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。
上傳時間： 2013-10-13
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SPI（Serial Peripheral Interface，串行外圍接口）是Motorola公司提出的外圍接口協議，它采用一個串行、同步、全雙工的通信方式，解決了微處理器和外設之間的串行通信問題，并且可以和多個外設直接通信，具有配置靈活，結構簡單等優點。根據全功能SPI總線的特點，設計的SPI接口可以最大發送和接收16位數據；在主模式和從模式下SPI模塊的時鐘頻率最大可以達到系統時鐘的1/4，并且在主模式下可以提供具有四種不同相位和極性的時鐘供從模塊選擇；可以同時進行發送和接收操作，擁有中斷標志位和溢出中斷標志位。
上傳時間： 2013-11-11
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單片機最小系統，兩位LED數碼管由串口輸出接兩個164驅動，Lout,Rout為左右聲道輸出，SET， ALT0， ALT1為三個按鍵，也可自己在開始的I/O定義改成你想用的I/O口；12M晶振若用89C51則只可裝下約14首歌曲，用89C52則可裝下近40曲
上傳時間： 2015-03-14
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文介紹一種用單片機普通I/O 口實現串行通信的方法，可在單片機的最小應用系統中實現與兩個以上串行接口設備的多機通信。附有電路圖和源代碼。
上傳時間： 2013-12-11
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linux下 ipv6協議 ping程序 最多運行50線程 2.每個線程發送4個ICMP6包后開始接收 3.試驗程序,多線程結構安排不一定合理,待試驗后進一步修改 4.在終端./pingipv6 IP1 1P2......即可運行程序 5.為單源文件,沒寫make,編譯命令為: gcc -Wall -o pingipv6 pingipv6.c -lpthread
上傳時間： 2015-05-13
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設計一個O(n2)時間的算法，找出由n個數組成的序列的最長單調遞增子序列。
上傳時間： 2015-07-15
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應用斐波納契堆和鄰接表改進單源最短路徑算法，使其算法的時間復雜性由O( )減少為O（nlogn+e）,其中e為有向圖的邊的條數。
上傳時間： 2014-01-21
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嵌入式系統中閃存設備IO軟件的設計與實現 閃存作為最常用的嵌入式存儲設備，其管理和訪問技術對整個系統的性能有著較大的影響。目前嵌入式系統中廣泛采用的閃存管理軟件在可移植性、靈活性方面都存在不足。因此本文在分析了這些管理軟件現存問題的基礎上提出了一種比較合理的閃存I/O軟件分層結構，并通過對軟件的模塊化設計與實現證明了該分層結構在移植性、通用性方面的優勢。
上傳時間： 2015-09-05
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