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dES

  • 基于FPGA的dES加密系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

    本文設(shè)計(jì)實(shí)現(xiàn)了一種基于FPGA的dES加密系統(tǒng)。 概括起來，本文主要完成了以下幾方面的主要工作：完成了dES加密系統(tǒng)的整體設(shè)計(jì)。整個(gè)系統(tǒng)包括dES加密核心模塊，UART通信接口模塊和BLOCKRAM存儲(chǔ)模塊。以EITS2003開發(fā)板為硬件開發(fā)平臺(tái)，ISEwebpack為開發(fā)軟件，用Verilog硬件描述語言設(shè)計(jì)并且實(shí)現(xiàn)了三大模塊的具體功能及整體連接。用PC，串口調(diào)試工具，UART通信接口和EITS2003開發(fā)板測(cè)試并驗(yàn)證了整個(gè)系統(tǒng)的功能。探討了dES加密系統(tǒng)在軍事通信總站內(nèi)的應(yīng)用。

    標(biāo)簽： FPGA dES 加密 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間： 2013-06-14

    上傳用戶：dancnc

  • dES算法

    C代碼實(shí)現(xiàn)dES加密算法，KEil開發(fā)環(huán)境，調(diào)試通過。

    標(biāo)簽： dES 算法

    上傳時(shí)間： 2013-07-03

    上傳用戶：superhand

  • dES和3dES加密算法

    dES和3dES 算法c語言實(shí)現(xiàn),c語言描述了dES和3dES的加密和解密過程，此代碼為成熟代碼，可直接應(yīng)用于工程。

    標(biāo)簽： 3dES dES 加密算法

    上傳時(shí)間： 2013-07-16

    上傳用戶：LSPSL

  • 基于FPGA加密芯片設(shè)計(jì)論文（AES和dES算法）

    基于FPGA加密芯片設(shè)計(jì)論文（AES和dES算法）

    標(biāo)簽： FPGA AES dES 加密

    上傳時(shí)間： 2013-08-29

    上傳用戶：weixiao99

  • dES在線式密度計(jì)

    dES系列在線式密度（濃度）傳感器根據(jù)阿基米德原理：P=ρgh,一定高度液柱的靜壓力與該液體的密度成正比，因此可根據(jù)壓力測(cè)量儀表測(cè)出的靜壓數(shù)值來衡量液體的密度。檢測(cè)端利用膜盒壓力測(cè)量元件，直接測(cè)量液柱的靜壓值，再通過程序處理，將靜壓值轉(zhuǎn)換成介質(zhì)的密度值。 dES 系列在線式密度（濃度）傳感器采用先進(jìn)檢測(cè)技術(shù)，其主要部件包括：一對(duì)高精度差壓傳感器及其直接接觸液體的一對(duì)感壓膜片，兩個(gè)膜片之間有一個(gè)溫度傳感器以補(bǔ)償被測(cè)液體的溫度變化，再通過專用軟件計(jì)算介質(zhì)的密度。

    標(biāo)簽： dES 密度

    上傳時(shí)間： 2013-12-17

    上傳用戶：wkxiian

  • dES加密算法實(shí)現(xiàn)的C++類

    dES加密算法實(shí)現(xiàn)的C++類

    標(biāo)簽： dES 加密算法

    上傳時(shí)間： 2015-01-03

    上傳用戶：haohaoxuexi

  • 一個(gè)使用dES加密傳輸?shù)膗nix下的login程序的服務(wù)器端和客戶端

    一個(gè)使用dES加密傳輸?shù)膗nix下的login程序的服務(wù)器端和客戶端

    標(biāo)簽： login unix dES 加密傳輸

    上傳時(shí)間： 2014-01-09

    上傳用戶：gxmm

  • dES算法實(shí)現(xiàn)源碼

    dES算法實(shí)現(xiàn)源碼

    標(biāo)簽： dES 算法 源碼

    上傳時(shí)間： 2015-01-04

    上傳用戶：Shaikh

  • dES加密算法源碼

    dES加密算法源碼

    標(biāo)簽： dES 加密算法 源碼

    上傳時(shí)間： 2015-01-04

    上傳用戶：woshini123456

  • dES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。

    dES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。

    標(biāo)簽： TESTBENCH VERILOG VHDL dES

    上傳時(shí)間： 2015-01-04

    上傳用戶：songyue1991

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