本文介紹一種以CPLD[1]為核心、以VHDL[2]為開發(fā)工具的時間控制器，該控制器不僅具有時間功能，而且具有定時器功能，能在00：00～23：59之間任意設(shè)定開啟時間和關(guān)閉時間，其設(shè)置方便、靈活，廣泛應(yīng)用于路燈、廣告燈箱、霓虹燈等處的定時控制。
標簽： CPLD VHDL 核心 開發(fā)工具
上傳時間： 2013-08-16
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介紹了Xilinx最新的EDK9．1i和ISE9．1i等工具的設(shè)計使用流程
標簽： EDK9 ISE9 流程
上傳用戶：sunjet
Proteus 是目前最好的模擬單片機外圍器件的工具，真的很不錯。可以仿真51 系列、AVR，PIC 等常用的MCU 及其外\\r\\n圍電路（如LCD，RAM，ROM，鍵盤，馬達，LED，AD/DA，部分SPI 器件，部分IIC 器件，...）
標簽： Proteus 模擬 單片機 外圍器件
上傳時間： 2013-08-20
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通過ISE7.0介紹xilinxFPGA設(shè)計工具的使用.
標簽： xilinxFPGA ISE 7.0 設(shè)計工具
上傳時間： 2013-08-28
上傳用戶：nanshan
Altera FPGA \r\n的開發(fā)工具的詳細教程，有例程與步奏
標簽： Altera FPGA 開發(fā)工具 教程
上傳時間： 2013-08-31
上傳用戶：bs2005
FPGAadvantage61Crack.rar is for MentorGraphics高端設(shè)計工具FPGAAdvantage
標簽： FPGAAdvantage 高端 設(shè)計工具
上傳時間： 2013-09-03
上傳用戶：黃蛋的蛋黃
一篇關(guān)于介紹如何使用Cadence工具的介紹資料
標簽： Cadence 如何使用
上傳時間： 2013-09-04
上傳用戶：zhangyi99104144
中興通訊EDA工具手冊[Cadence]
標簽： Cadence EDA 中興通訊
上傳時間： 2013-09-05
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CADENCE 芯片版圖設(shè)計工具VIRTUSO/DIVA/DRACULA 入門手冊
標簽： CADENCE VIRTUSO DRACULA DIVA
上傳時間： 2013-09-06
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原理圖轉(zhuǎn)換工具可以把PROTELORCAD及PADS的LOGIC轉(zhuǎn)為LOGIC和DX原理圖格式
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上傳時間： 2013-09-09
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