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FPGA-CPLD_DesignTool

通過 VLYNQ 把 Xilinx FPGA 作為 TI DSP 的外設(shè)

通過 VLYNQ 把 Xilinx FPGA 作為 TI DSP 的外設(shè).rar

標(biāo)簽： Xilinx VLYNQ FPGA DSP

上傳時間： 2013-08-13

上傳用戶：lz4v4
基于FPGA的DDS信號發(fā)生器的簡單實現(xiàn)

基于FPGA的DDS信號發(fā)生器的簡單實現(xiàn)。這種方法簡單可靠、控制方便，且具有很高的頻率分辨率和轉(zhuǎn)換速度，非常適合快速跳頻通信的要求。 DDS（直接數(shù)字合成）是近年來迅速發(fā)展起來的一種新的頻率合成方法。

標(biāo)簽： FPGA DDS 信號發(fā)生器

上傳時間： 2013-08-13

上傳用戶：zl5712176
華為的FPGA設(shè)計的規(guī)范

華為的FPGA設(shè)計的規(guī)范，其中包括TESTBENGH等的書寫規(guī)范

標(biāo)簽： FPGA 華為

上傳時間： 2013-08-13

上傳用戶：gxmm
使用cordic實現(xiàn)動態(tài)配置以提高FPGA的整體性能的高效算法具體詳解

一篇關(guān)于使用cordic實現(xiàn)動態(tài)配置以提高FPGA的整體性能的高效算法具體詳解，很實用哦

標(biāo)簽： cordic FPGA 動態(tài)配置性能

上傳時間： 2013-08-13

上傳用戶：a471778
FPGA-CPLD在軟件無線電中的工程應(yīng)用基礎(chǔ)知識

FPGA-CPLD在軟件無線電中的工程應(yīng)用,基礎(chǔ)知識，課件

標(biāo)簽： FPGA-CPLD 軟件無線電工程基礎(chǔ)知識

上傳時間： 2013-08-13

上傳用戶：葉立炫95
利用FPGA技術(shù)解決ARINC429通信的實現(xiàn)方案

提出了一種利用FPGA技術(shù)解決ARINC429通信的實現(xiàn)方案,該方案不僅使國內(nèi)的ARINC429通信設(shè)備擺脫了對國外ASIC電路的依賴,還降低了設(shè)備成本,并且克服了國外ASIC電路的不足,實現(xiàn)了任意長度數(shù)據(jù)幀的群收和群發(fā)功能,具有較好的應(yīng)用前景。利用該方案研制的ARINC429數(shù)據(jù)通信卡,已成功應(yīng)用于空空導(dǎo)彈測控設(shè)備中。\r\n

標(biāo)簽： ARINC FPGA 429 通信

上傳時間： 2013-08-13

上傳用戶：極客
華為的FPGA和Verilog的教程

華為的FPGA和Verilog的教程，我相信對大家的用處是毋庸置疑的。

標(biāo)簽： Verilog FPGA 華為教程

上傳時間： 2013-08-13

上傳用戶：manlian
fpga 設(shè)計經(jīng)典指導(dǎo)原則

fpga 設(shè)計經(jīng)典指導(dǎo)原則，非常經(jīng)典，對于深入理解FPGA設(shè)計方法有很好的幫助

標(biāo)簽： fpga

上傳時間： 2013-08-13

上傳用戶：XLHrest
FPGA學(xué)習(xí)板原理圖

FPGA學(xué)習(xí)板原理圖，對于初學(xué)者來說很有用，免費下載

標(biāo)簽： FPGA 原理圖

上傳時間： 2013-08-13

上傳用戶：liuwei6419
基于FPGA的全數(shù)字鎖相環(huán)設(shè)計

基于FPGA的全數(shù)字鎖相環(huán)設(shè)計,內(nèi)有設(shè)計過程和設(shè)計思想

標(biāo)簽： FPGA 全數(shù)字鎖相環(huán)

上傳時間： 2013-08-13

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