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DS-SS

  • 海康威視 DS-B21 一體機(jī) 操作手冊(cè)

    海康威視 DS-B21_一體機(jī)_操作手冊(cè)_V1.4.2_20190322.pdf

    標(biāo)簽: DS-B21 一體機(jī)

    上傳時(shí)間: 2022-06-26

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  • DSP從入門到精通全集.rar

    DS P從 入門 到 精通 全集

    標(biāo)簽: DSP

    上傳時(shí)間: 2013-04-24

    上傳用戶:jqy_china

  • 基于FPGA的GSM解擴(kuò)解調(diào)的設(shè)計(jì)與實(shí)現(xiàn).rar

    擴(kuò)頻通信系統(tǒng)與常規(guī)的通信系統(tǒng)相比,具有很強(qiáng)的抗窄帶干擾,抗多徑干擾,抗人為干擾的能力,并具有信息隱蔽、多址保密通信等優(yōu)點(diǎn),在近年來得到了迅速的發(fā)展。論文針對(duì)直擴(kuò)通信系統(tǒng)中偽碼和載波同步問題而展開,研究了直擴(kuò)系統(tǒng)的結(jié)構(gòu)、性能及完成了相關(guān)參數(shù)的計(jì)算,改進(jìn)了包絡(luò)算法,設(shè)計(jì)了解擴(kuò)和解調(diào)器,最后用ISE9.1實(shí)現(xiàn)了解擴(kuò)和解調(diào)器的仿真波形,驗(yàn)證了設(shè)計(jì)的正確性。 論文研究了擴(kuò)頻通信系統(tǒng)的特點(diǎn)、國(guó)內(nèi)外發(fā)展現(xiàn)狀及理論基礎(chǔ),完成了DS-QPSK接收機(jī)的解擴(kuò)器和解調(diào)器的設(shè)計(jì)與實(shí)現(xiàn)。解擴(kuò)器主要圍繞著偽碼的捕獲與跟蹤這一核心,分析了解擴(kuò)器的結(jié)構(gòu)、性能及其完成了相關(guān)參數(shù)的計(jì)算,完成了數(shù)字下變頻器、偽碼發(fā)生電路、偽碼相關(guān)積分提取電路、多通道快碼捕獲電路、偽碼跟蹤鑒相電路、偽碼時(shí)鐘調(diào)整電路的設(shè)計(jì),并在ISE9.1編程綜合得到仿真結(jié)果,驗(yàn)證了設(shè)計(jì)的正確性。由于相關(guān)積分包絡(luò)算法是整個(gè)系統(tǒng)的基礎(chǔ)和核心,為了減少時(shí)延和系統(tǒng)所占硬件資源,改進(jìn)了包絡(luò)算法并得到了仿真驗(yàn)證。結(jié)果表明,它不但減少了硬件資源的占用、縮短了延時(shí),而且對(duì)整個(gè)系統(tǒng)的優(yōu)化起著決定性的作用。論文給出了偽碼同步的仿真結(jié)果及資源占用情況,有力地說明了解擴(kuò)器占用資源少、時(shí)延短等特點(diǎn)。 解調(diào)器研究了頻偏及載波相位誤差對(duì)信號(hào)的影響及同步方案,完成了數(shù)控振蕩器、反正切鑒頻器、環(huán)路濾波器的設(shè)計(jì)并得到了相關(guān)的仿真波形,實(shí)現(xiàn)了載波的跟蹤,給出了仿真結(jié)果及資源占用情況,對(duì)系統(tǒng)實(shí)現(xiàn)過程中的一些經(jīng)驗(yàn)進(jìn)行了總結(jié)。最后是對(duì)論文工作的一些總結(jié)和對(duì)今后工作的展望。

    標(biāo)簽: FPGA GSM 解調(diào)

    上傳時(shí)間: 2013-06-13

    上傳用戶:924484786

  • 多載波擴(kuò)頻通信的Rake接收機(jī)理論研究及FPGA實(shí)現(xiàn).rar

    由于移動(dòng)環(huán)境的復(fù)雜性,無線信號(hào)在發(fā)送傳輸和接收過程中有很明顯的衰落現(xiàn)象,特別是在高頻無線通信中,多徑衰落或頻率選擇性衰落對(duì)無線信號(hào)的干擾最為嚴(yán)重。通過分集接收技術(shù),Rake接收機(jī)在CDMA移動(dòng)通信系統(tǒng)中抗多徑衰落效果尤為明顯。作為一種新穎的多址接入方式,多載波CDMA充分利用了OFDM最優(yōu)頻率利用率以及CDMA的多址和頻率分集,且系統(tǒng)容量和抗符號(hào)間干擾性能明顯優(yōu)于傳統(tǒng)的單載波CDMA。這些特性使得多載波CDMA成為未來的寬帶無線通信系統(tǒng)最有希望的候選。 @@ 本文研究了一種多載波擴(kuò)頻通信系統(tǒng),介紹了其Rake接收機(jī)工作原理和設(shè)計(jì)思想,進(jìn)行了理論仿真并用FPGA予以實(shí)現(xiàn)。 @@ 本文首先介紹了移動(dòng)通信系統(tǒng)的發(fā)展歷史以及OFDM和CDMA技術(shù)原理,并描述了OFDM和CDMA結(jié)合的三種系統(tǒng)(MC-DS-CDMA、MT-CDMA、MC-CDMA)的原理和系統(tǒng)模型;接著,介紹了目前影響移動(dòng)通信的主要衰落以及Rake接收機(jī)基本原理及其作用。多徑信號(hào)的每路信號(hào)都可能含有可以利用的信息,Rake接收機(jī)就是通過多個(gè)相關(guān)接收器接收多徑信號(hào)中各路信號(hào),通過信道估計(jì)和信道補(bǔ)償消去信道因子的附加相位,并把他們合并在一起,以此來改善信號(hào)的信噪比和系統(tǒng)的可靠性;在此基礎(chǔ)上,論文提出了一種多載波擴(kuò)頻通信系統(tǒng)的實(shí)現(xiàn)方案,并詳細(xì)介紹了其Rake接收機(jī)實(shí)現(xiàn)原理,給出了最大比合并時(shí)各種分徑數(shù)目下系統(tǒng)誤碼率的仿真圖;最后介紹了此方案中Rake接收機(jī)的FPGA硬件實(shí)現(xiàn)設(shè)計(jì)方案及其系統(tǒng) 測(cè)試結(jié)果。@@ 仿真結(jié)果顯示出隨著分集徑數(shù)的增加,系統(tǒng)的誤碼率顯著降低。表明Rake接收機(jī)抗多徑衰落效果顯著,且在多載波CDMA系統(tǒng)中其分集效果更好,實(shí)現(xiàn)相對(duì)簡(jiǎn)單。最終Rake接收機(jī)的FPGA實(shí)現(xiàn)結(jié)果同理論仿真一致,時(shí)序通過,資源耗費(fèi)不大,具有較大的實(shí)用價(jià)值。 @@關(guān)鍵詞:多載波擴(kuò)頻通信,CDMA,Rake接收機(jī),F(xiàn)PGA

    標(biāo)簽: Rake FPGA 多載波

    上傳時(shí)間: 2013-07-25

    上傳用戶:axxsa

  • 超寬帶脈沖與MB-OFDM物理層的FPGA實(shí)現(xiàn)

    現(xiàn)代通信系統(tǒng)對(duì)帶寬和數(shù)據(jù)速率的要求越來越高,超寬帶(ultra-wideband,UWB)通信以其傳輸速率高、空間容量大、成本低、功耗低的優(yōu)點(diǎn),成為解決企業(yè)、家庭、公共場(chǎng)所等高速因特網(wǎng)接入的需求與越來越擁擠的頻率資源分配之間的矛盾的技術(shù)手段。 論文主要圍繞兩方面展開分析:一是介紹用于UWB無載波脈沖調(diào)制及直接序列碼分多址調(diào)制(DS-CDMA)的新型脈沖,即Hermite正交脈沖,并且分析了這種構(gòu)建UWB多元通信和多用戶通信的系統(tǒng)性能。二是分析了UWB的多帶頻分復(fù)用物理層提案(MBOA)的調(diào)制技術(shù),并在FPGA上實(shí)現(xiàn)了調(diào)制模塊。正交Hermite脈沖集被提出用于UWB的M元雙正交調(diào)制系統(tǒng),獲得高數(shù)據(jù)速率。調(diào)整脈沖的脈寬因子和中心頻率能使脈沖滿足FCC的頻譜要求。M元雙正交調(diào)制的接收機(jī)需要M/2個(gè)相關(guān)器,遠(yuǎn)比M元正交調(diào)制所需的相關(guān)器數(shù)量少。誤碼率一定時(shí),維數(shù)M的增加可獲得高的比特率和低的信噪比。雖然高階的Hermite脈沖易受抖動(dòng)時(shí)延的影響,但當(dāng)抖動(dòng)時(shí)延范圍小于0.02ns時(shí),其影響較為不明顯。本文認(rèn)為1~8階的Hermite脈沖皆可用,可構(gòu)成16元雙正交系統(tǒng)。 正交Hermite脈沖集也可以構(gòu)造UWB多用戶系統(tǒng)。各用戶的信息用不同的Hermite脈沖同時(shí)傳輸,其多用戶的誤比特率上限低于高斯單脈沖構(gòu)成的PPM多用戶系統(tǒng)的誤比特率,所以其系統(tǒng)性能更優(yōu)。正交Hermite脈沖還可以用于UWB的DS-CDMA調(diào)制,在8個(gè)脈沖可用的情況下,最多可容64個(gè)用戶同時(shí)通信。 基于MBOA提出的UWB物理層協(xié)議,本文用Verilog硬件語言實(shí)現(xiàn)了調(diào)制與解調(diào)結(jié)構(gòu),并用Modelsim做了時(shí)序驗(yàn)證。用Verilog編程實(shí)現(xiàn)的輸出數(shù)據(jù)與Matlab生成的UWB建模的輸出結(jié)果一致。為了達(dá)到UWBMB-OFDM系統(tǒng)的FFT處理器的要求,一個(gè)混和基多通道流水線的FFT算法結(jié)構(gòu)被提出。其有效的實(shí)現(xiàn)方法也被提出。這種結(jié)構(gòu)采用多通道以獲得高的數(shù)據(jù)吞吐量。此外,它用于存儲(chǔ)和復(fù)數(shù)乘法器的硬件損耗相比其他的FFT處理器是最少的。高基的FFT蝶算減少了復(fù)數(shù)乘法器的數(shù)量。在132MHz的工作頻率下,整個(gè)128點(diǎn)FFT變換在此結(jié)構(gòu)模式下只需要242.4ns,滿足了MBOA的要求。

    標(biāo)簽: MB-OFDM FPGA 超寬帶 脈沖

    上傳時(shí)間: 2013-07-29

    上傳用戶:TI初學(xué)者

  • NXP產(chǎn)品LPC23XX的開發(fā)板的源文件

    ·詳細(xì)說明:NXP產(chǎn)品LPC23XX的開發(fā)板的原文件,包含了源代碼,使用手冊(cè),開發(fā)板線路圖文件列表:   POLAR LPC23XX-EK  ................\DS  ................\..\ds_lpc2378_en.pdf  ................\..\HR911105A.PDF  ..........

    標(biāo)簽: NXP LPC 23 XX

    上傳時(shí)間: 2013-04-24

    上傳用戶:zhenyushaw

  • 模擬電子技術(shù)實(shí)驗(yàn)

    ss

    標(biāo)簽: 模擬電子技術(shù) 實(shí)驗(yàn)

    上傳時(shí)間: 2013-10-29

    上傳用戶:wdq1111

  • DS-PCB(DesignSpark PCB)v3 激活 快速入門教程

    DesignSpark PCB是功能強(qiáng)勁的**免費(fèi)正版**PCB設(shè)計(jì)工具。 它具有兩個(gè)主要功能:原理圖制作和印刷電路板布局,亦可以連接到業(yè)界標(biāo)準(zhǔn)的Spice模擬器進(jìn)行模擬。 DesignSpark PCB具計(jì)算線路阻抗值的設(shè)計(jì)計(jì)算器,和產(chǎn)生三維視覺效果,能夠給用家以3D的形式觀看屬于你的印刷電路板設(shè)計(jì)。

    標(biāo)簽: DesignSpark DS-PCB PCB v3

    上傳時(shí)間: 2013-10-20

    上傳用戶:chukeey

  • 38V/100A可直接并聯(lián)大功率AC/DC變換器

    38V/100A可直接并聯(lián)大功率AC/DC變換器 隨著電力電子技術(shù)的發(fā)展,電源技術(shù)被廣泛應(yīng)用于計(jì)算機(jī)、工業(yè)儀器儀表、軍事、航天等領(lǐng)域,涉及到國(guó)民經(jīng)濟(jì)各行各業(yè)。特別是近年來,隨著IGBT的廣泛應(yīng)用,開關(guān)電源向更大功率方向發(fā)展。研制各種各樣的大功率,高性能的開關(guān)電源成為趨勢(shì)。某電源系統(tǒng)要求輸入電壓為AC220V,輸出電壓為DC38V,輸出電流為100A,輸出電壓低紋波,功率因數(shù)>0.9,必要時(shí)多臺(tái)電源可以直接并聯(lián)使用,并聯(lián)時(shí)的負(fù)載不均衡度<5%。   設(shè)計(jì)采用了AC/DC/AC/DC變換方案。一次整流后的直流電壓,經(jīng)過有源功率因數(shù)校正環(huán)節(jié)以提高系統(tǒng)的功率因數(shù),再經(jīng)半橋變換電路逆變后,由高頻變壓器隔離降壓,最后整流輸出直流電壓。系統(tǒng)的主要環(huán)節(jié)有DC/DC電路、功率因數(shù)校正電路、PWM控制電路、均流電路和保護(hù)電路等。 1 有源功率因數(shù)校正環(huán)節(jié) 由于系統(tǒng)的功率因數(shù)要求0.9以上,采用二極管整流是不能滿足要求的,所以,加入了有源功率因數(shù)校正環(huán)節(jié)。采用UC3854A/B控制芯片來組成功率因數(shù)電路。UC3854A/B是Unitrode公司一種新的高功率因數(shù)校正器集成控制電路芯片,是在UC3854基礎(chǔ)上的改進(jìn)。其特點(diǎn)是:采用平均電流控制,功率因數(shù)接近1,高帶寬,限制電網(wǎng)電流失真≤3%[1]。圖1是由UC3854A/B控制的有源功率因數(shù)校正電路。   該電路由兩部分組成。UC3854A/B及外圍元器件構(gòu)成控制部分,實(shí)現(xiàn)對(duì)網(wǎng)側(cè)輸入電流和輸出電壓的控制。功率部分由L2,C5,V等元器件構(gòu)成Boost升壓電路。開關(guān)管V選擇西門康公司的SKM75GB123D模塊,其工作頻率選在35kHz。升壓電感L2為2mH/20A。C5采用四個(gè)450V/470μF的電解電容并聯(lián)。因?yàn)椋O(shè)計(jì)的PFC電路主要是用在大功率DC/DC電路中,所以,在負(fù)載輕的時(shí)候不進(jìn)行功率因數(shù)校正,當(dāng)負(fù)載較大時(shí)功率因數(shù)校正電路自動(dòng)投入使用。此部分控制由圖1中的比較器部分來實(shí)現(xiàn)。R10及R11是負(fù)載檢測(cè)電阻。當(dāng)負(fù)載較輕時(shí),R10及R11上檢測(cè)的信號(hào)輸入給比較器,使其輸出端為低電平,D2導(dǎo)通,給ENA(使能端)低電平使UC3854A/B封鎖。在負(fù)載較大時(shí)ENA為高電平才讓UC3854A/B工作。D3接到SS(軟啟動(dòng)端),在負(fù)載輕時(shí)D3導(dǎo)通,使SS為低電平;當(dāng)負(fù)載增大要求UC3854A/B工作時(shí),SS端電位從零緩慢升高,控制輸出脈沖占空比慢慢增大實(shí)現(xiàn)軟啟動(dòng)。 2 DC/DC主電路及控制部分分析 2.1 DC/DC主電路拓?fù)?在大功率高頻開關(guān)電源中,常用的主變換電路有推挽電路、半橋電路、全橋電路等[2]。其中推挽電路的開關(guān)器件少,輸出功率大,但開關(guān)管承受電壓高(為電源電壓的2倍),且變壓器有六個(gè)抽頭,結(jié)構(gòu)復(fù)雜;全橋電路開關(guān)管承受的電壓不高,輸出功率大,但是需要的開關(guān)器件多(4個(gè)),驅(qū)動(dòng)電路復(fù)雜。半橋電路開關(guān)管承受的電壓低,開關(guān)器件少,驅(qū)動(dòng)簡(jiǎn)單。根據(jù)對(duì)各種拓?fù)浞桨傅墓こ袒瘜?shí)現(xiàn)難度,電氣性能以及成本等指標(biāo)的綜合比較,本電源選用半橋式DC/DC變換器作為主電路。圖2為大功率開關(guān)電源的主電路拓?fù)鋱D。

    標(biāo)簽: 100 38 AC DC

    上傳時(shí)間: 2013-11-13

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  • 硬件工程師要求

    ss

    標(biāo)簽: 硬件工程師

    上傳時(shí)間: 2013-10-12

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