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COM技術(shù)內(nèi)幕

  • NI Multisim 10入門教程

    NI Multisim 10入門教程

    標簽: Multisim NI 入門教程

    上傳時間: 2013-07-05

    上傳用戶:eeworm

  • 仿真_《基于NI Multisim 10的電子電路計算機仿真設計與分析》

    仿真_《基于NI Multisim 10的電子電路計算機仿真設計與分析》

    標簽: Multisim 仿真 電子電路 計算機仿真

    上傳時間: 2013-07-02

    上傳用戶:eeworm

  • elecfans.com Protel加漢字軟件

    elecfans.com Protel加漢字軟件

    標簽: elecfans Protel com 漢字

    上傳時間: 2013-05-24

    上傳用戶:eeworm

  • 上海巨馬電氣-光電,接近,光纖,光幕,冷熱金屬檢測-等傳感器樣本-21M.rar

    專輯類----元器件樣本專輯 上海巨馬電氣-光電,接近,光纖,光幕,冷熱金屬檢測-等傳感器樣本-21M.rar

    標簽: 21 光電

    上傳時間: 2013-04-24

    上傳用戶:greethzhang

  • 網絡奇技贏巧大搜捕.pdf

    專輯類-網絡及電腦相關專輯-114冊-4.31G 網絡奇技贏巧大搜捕.pdf

    標簽: 網絡

    上傳時間: 2013-07-25

    上傳用戶:小寶愛考拉

  • -C#.COM.編程指南-219頁-3.2M.pdf

    專輯類-網絡及電腦相關專輯-114冊-4.31G -C#.COM.編程指南-219頁-3.2M.pdf

    標簽: COM 219 3.2

    上傳時間: 2013-05-20

    上傳用戶:glxcl

  • JAVA中基于JACOB的COM組件調用研究

            本文在研究了COM 組件復用,自動化和JNI 技術的基礎上,詳細闡述了JACOB 技術的原理,指出了它的優勢,并以

    標簽: JACOB JAVA COM

    上傳時間: 2013-05-28

    上傳用戶:pkkkkp

  • 《COM技術內幕(微軟組件對象模型)》

    ·詳細說明:《COM技術內幕(微軟組件對象模型)》清華大學出版社

    標簽: COM 微軟 對象模型

    上傳時間: 2013-05-26

    上傳用戶:hn891122

  • NI MultiSIM 10(V10.0.144)電子仿真軟件漢化文件

    NI MultiSIM 10(V10.0.144)電子仿真軟件漢化文件

    標簽: MultiSIM 10 144 NI

    上傳時間: 2013-10-19

    上傳用戶:saharawalker

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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