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Altera-FPGA-<b>CPLd</b>

輸入一個(gè)四位數(shù),共八次機(jī)會(huì),A代表數(shù)字和位置均正確,B代表數(shù)字正確,但位置不正確.比如:A2B1代表三個(gè)數(shù)字正確,兩個(gè)位置也正確

輸入一個(gè)四位數(shù),共八次機(jī)會(huì),A代表數(shù)字和位置均正確,B代表數(shù)字正確,但位置不正確.比如:A2B1代表三個(gè)數(shù)字正確,兩個(gè)位置也正確

標(biāo)簽： 正 A2B1 數(shù)字輸入

上傳時(shí)間： 2013-12-11

上傳用戶(hù)：ukuk
提出了一種基于樣本的分級(jí)檢索 MPEG 視頻的新方法:首先用I 幀的dct_dc_size 字段快速粗檢,然后用斷層攝影(tomography)法分析B 幀運(yùn)動(dòng)矢量的時(shí)空分布特性以進(jìn)一步縮小結(jié)果

提出了一種基于樣本的分級(jí)檢索 MPEG 視頻的新方法:首先用I 幀的dct_dc_size 字段快速粗檢,然后用斷層攝影(tomography)法分析B 幀運(yùn)動(dòng)矢量的時(shí)空分布特性以進(jìn)一步縮小結(jié)果集,最后用DC 圖像的精確匹配方法驗(yàn)證檢索結(jié)果.試驗(yàn)結(jié)果表明,本方法所需計(jì)算量較小,且可保證較高的檢索精度.

標(biāo)簽： dct_dc_size tomography MPEG 幀

上傳時(shí)間： 2013-12-30

上傳用戶(hù)：獨(dú)孤求源
基于CPLD-FPGA的半整數(shù)分頻器的設(shè)計(jì)

基于CPLD-FPGA的半整數(shù)分頻器的設(shè)計(jì)，用于設(shè)計(jì)EDA

標(biāo)簽： CPLD-FPGA 整數(shù) 分頻器

上傳時(shí)間： 2015-04-09

上傳用戶(hù)：凌云御清風(fēng)
B/S的教育部群組管理 JSP頁(yè)面可以參考

B/S的教育部群組管理 JSP頁(yè)面可以參考

標(biāo)簽： JSP 頁(yè)

上傳時(shí)間： 2014-12-05

上傳用戶(hù)：gyq
b樹(shù)的C++實(shí)現(xiàn),運(yùn)用模板實(shí)現(xiàn)B樹(shù) 簡(jiǎn)單明了

b樹(shù)的C++實(shí)現(xiàn),運(yùn)用模板實(shí)現(xiàn)B樹(shù) 簡(jiǎn)單明了

標(biāo)簽： 樹(shù) 模板

上傳時(shí)間： 2015-04-11

上傳用戶(hù)：zwei41
移動(dòng)通信用愛(ài)爾蘭B圖表產(chǎn)生程序。可以在MATLAB6.5上運(yùn)行

移動(dòng)通信用愛(ài)爾蘭B圖表產(chǎn)生程序。可以在MATLAB6.5上運(yùn)行

標(biāo)簽： MATLAB 6.5 移動(dòng)通信圖表

上傳時(shí)間： 2014-11-30

上傳用戶(hù)：thinode
R樹(shù)與B樹(shù)的混合樹(shù)

R樹(shù)與B樹(shù)的混合樹(shù)，在這個(gè)程序里面可以直接用R樹(shù)和B樹(shù)

標(biāo)簽： 樹(shù)

上傳時(shí)間： 2013-12-19

上傳用戶(hù)：ouyangtongze
DataBase keeping program explaining with a sample program a) Ranking Database. b) Library keeping. c

DataBase keeping program explaining with a sample program a) Ranking Database. b) Library keeping. c) Record Keeping.

標(biāo)簽： keeping program explaining DataBase

上傳時(shí)間： 2015-04-16

上傳用戶(hù)：sclyutian
CPLD/FPGA是目前誚用最為廣泛的兩種可編程專(zhuān)用集成電路（ASIC）

CPLD/FPGA是目前誚用最為廣泛的兩種可編程專(zhuān)用集成電路（ASIC），特別適合于產(chǎn)品的樣品開(kāi)發(fā)與小批量生產(chǎn)。本書(shū)從現(xiàn)代電子系統(tǒng)設(shè)計(jì)的角度出發(fā)，以全球著名的可編程邏輯器件供應(yīng)商Xilinx公司的產(chǎn)品為背景，系統(tǒng)全面地介紹該公司的CPLD/FPGA產(chǎn)品的結(jié)構(gòu)原理、性能特點(diǎn)、設(shè)計(jì)方法以及相應(yīng)的EDA工具軟件，重點(diǎn)介紹CPLD/FPGA在數(shù)字系統(tǒng)設(shè)計(jì)、數(shù)字通信與數(shù)字信號(hào)處理等領(lǐng)域中的應(yīng)用。本書(shū)內(nèi)容新穎、技術(shù)先進(jìn)、由淺入深，既有關(guān)于大規(guī)模可編輯邏輯器件的系統(tǒng)論述，又有豐富的設(shè)計(jì)應(yīng)用實(shí)例。對(duì)于從事各類(lèi)電子系統(tǒng)（通信、雷達(dá)、程控交換、計(jì)算機(jī)等）設(shè)計(jì)的科研人員和應(yīng)用設(shè)計(jì)工程師，這是一本具有實(shí)用價(jià)值的新技術(shù)應(yīng)用參考書(shū)。本書(shū)也可作為高等院校電子類(lèi)高年級(jí)本科生或研究生的教材或教學(xué)參考書(shū)。

標(biāo)簽： CPLD ASIC FPGA 可編程

上傳時(shí)間： 2015-04-16

上傳用戶(hù)：lizhen9880
等級(jí)考試命題預(yù)測(cè)試卷模版——全國(guó)計(jì)算機(jī)等級(jí)考試命題預(yù)測(cè)試卷一(一級(jí)B試卷)

等級(jí)考試命題預(yù)測(cè)試卷模版——全國(guó)計(jì)算機(jī)等級(jí)考試命題預(yù)測(cè)試卷一(一級(jí)B試卷)

標(biāo)簽： 測(cè)試等級(jí)考試模版計(jì)算機(jī)等級(jí)考試

上傳時(shí)間： 2014-01-16

上傳用戶(hù)：腳趾頭

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