是基于FPGA高速設(shè)計(jì)指導(dǎo)的一篇文章，很好的！
標(biāo)簽： FPGA 高速設(shè)計(jì)
上傳時(shí)間： 2013-08-16
上傳用戶：yuyizhixia
主要介紹了關(guān)于MAGIC3000系列CPLD開發(fā)板的十個(gè)實(shí)例,如霓虹燈演示、與PC串口通信等。
標(biāo)簽： MAGIC 3000 CPLD 開發(fā)板
上傳用戶：894898248
多款FPGA CPLD開發(fā)板的原理圖，很好的線路設(shè)計(jì)參考
標(biāo)簽： FPGA CPLD 開發(fā)板 原理圖
上傳時(shí)間： 2013-08-18
上傳用戶：shanml
lab1——FPGA這個(gè)文件中體統(tǒng)了如何如何使用verilog Hdl以及如何使其在FPGA開發(fā)板上實(shí)現(xiàn)
標(biāo)簽： verilog FPGA Hdl 如何使用
上傳用戶：qwe1234
基于Xilinx XC3S500E的FPGA最小開發(fā)板制作的文章。
標(biāo)簽： Xilinx S500 500E FPGA
上傳時(shí)間： 2013-08-19
上傳用戶：hhkpj
一套基于XILIX,SPATAN2,XC2S200 芯片實(shí)驗(yàn)板上的,10個(gè)典型VRILOGHDL的FPGA實(shí)驗(yàn),有幫助,
標(biāo)簽： VRILOGHDL SPATAN XILIX FPGA
上傳用戶：偷心的海盜
_Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)_-_DDU一些硬體設(shè)計(jì)教學(xué)文件
標(biāo)簽： Wiley_Synthesis_of_Arithmetic_Cir FPGA_ASIC_and_Embedded_Systems cuits 2006
上傳時(shí)間： 2013-08-20
上傳用戶：lchjng
一個(gè)關(guān)于4CAN卡的硬件程序,用VHDL編寫.就是4路CAN總線
標(biāo)簽： VHDL CAN 硬件 程序
上傳用戶：jiiszha
C6000系列之6701開發(fā)板相關(guān)文件及說明
標(biāo)簽： C6000 6701 開發(fā)板
上傳用戶：xuanjie
YLP270開發(fā)板光盤附帶的cpld邏輯試驗(yàn)
標(biāo)簽： cpld YLP 270 開發(fā)板
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