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高速觸發器

  • easy,51pro,3.0編程器在2.0的基礎上增加了更多的芯片器件

    easy,51pro,3.0編程器在2.0的基礎上增加了更多的芯片器件

    標簽: easy 3.0 2.0 pro

    上傳時間: 2013-07-25

    上傳用戶:qazwsc

  • 基于DTMF的解碼器設計

    本文介紹了DTMF 解碼芯片MT8870 的功能和特點,給出了在解碼器中與89C51 單片機的接口電路,說明了解碼器的工作原理抗干擾措施。關鍵詞:單片機抗干擾 DTMF 解碼監控

    標簽: DTMF 解碼器

    上傳時間: 2013-05-17

    上傳用戶:tuilp1a

  • ADI---高速運放PCB布線實踐指南

    雖然印制電路板(PCB)布線在高速電路中具有關鍵的作用,但它往往是電路設計過程的最后幾個步驟之一。高速 PCB 布線有很多方面的問題,關于這個題目已有人撰寫了大量的文獻。本文主要從實踐的角度來探討高速電路的布線問題。主要目的在于幫助新用戶當設計高速電路 PCB 布線時對需要考慮的多種不同問題引起注意。另一個目的是為已經有一段時間沒接觸PCB 布線的客戶提供一種復習資料。由于版面有限,本文不可能詳細地論述所有的問題,但是我們將討論對提高電路性能、縮短設計時間、節省修改時間具有最大成效的關鍵部分。

    標簽: ADI PCB 高速運放 布線

    上傳時間: 2013-04-24

    上傳用戶:DanXu

  • IEEE80211a物理層關鍵技術研究——FIR濾波器與Viterbi譯碼器的FPGA實現

    無線局域網(WLAN,Wireless Local Area Network)是未來移動通信系統的重要組成部分.為了滿足用戶高速率、方便靈活的接入互聯網的需求,WLAN的研究和建設正在世界范圍內如火如荼的展開.由于擺脫了有線連接的束縛,無線局域網具有移動性好、成本低和不會出現線纜故障等特點.該文對無線局域網的主流協議IEEE 802.11a的物理層實現技術進行了系統的研究和分析,并采用可編程ASIC器件FPGA,設計實現了物理層基帶處理的關鍵模塊,為今后形成具有自主知識產權的IP核奠定了基礎.該文研究內容得到了天津市信息化辦公室"寬帶無線局域網關鍵技術研究"項目經費的支持.該文在對IEEE 802.11a協議深入研究的基礎上,提出了物理層的實現方案和功能模塊劃分.重點研究了實現基帶處理的關鍵模塊:FIR濾波器、卷積碼編碼器以及(2,1,7)Viterbi譯碼器的實現算法和硬件結構.在Viterbi譯碼器的設計中,

    標簽: Viterbi 80211a 80211 IEEE

    上傳時間: 2013-06-19

    上傳用戶:xinzhch

  • 并網逆變器

    并網逆變器并網逆變器并網逆變器并網逆變器

    標簽: 并網逆變器

    上傳時間: 2013-04-24

    上傳用戶:jyycc

  • 漢字ASCII碼-Unicode碼轉化器(轉換工具)

    漢字ASCII碼-Unicode碼轉化器(轉換工具)

    標簽: Unicode ASCII 漢字 轉化器

    上傳時間: 2013-07-16

    上傳用戶:hustfanenze

  • IEEE 802.11信道編解碼及交織解交織的FPGA實現

    隨著糾錯編碼理論研究的不斷深入,糾錯碼的實際應用越來越廣泛。卷積碼作為其中重要的一種,已被大多數通信系統所采用。(2,1,7)卷積碼是一種短約束長度最佳碼,編、譯碼器易于實現,且具有較強的糾錯能力。 本文研究了IEEE 802.11協議中(2,1,7)卷積碼編碼、交織解交織及其軟判決高速Viterbi譯碼的實現問題。 首先介紹了IEEE 802.11無線局域網標準及規范,然后介紹了信道編解碼中卷積碼編碼及Viterbi譯碼算法和FPGA 設計方法,接著通過對(2,1,7)卷積碼特點的具體分析,吸取目前Viterbi譯碼算法和交織解交織算法的優點,采取一系列的改進措施,基于FPGA實現了IEEE 802.11信道編解碼及交織和解交織系統。這些改進措施包括采用并行FIFO、改進的ACS 單元、流水式塊處理結構、改進的SMDO方法、雙重交織策略,使得在同樣時鐘速率下,系統的性能大幅度提高。最后將程序下載到Altera公司的Cyclone 系列的FPGA(型號EP1C6Q240C8)器件上進測試,并對測試結果作了簡單分析。

    標簽: 802.11 IEEE FPGA 信道

    上傳時間: 2013-05-25

    上傳用戶:00.00

  • 高速數字電路設計教材華為黑魔手冊翻譯

    高速數字電路設計教材 華為黑魔手冊翻譯

    標簽: 高速數字電路 設計教材 華為

    上傳時間: 2013-07-20

    上傳用戶:ZHWKLIU

  • 8位電流模模數轉換器設計研究

    8位電流模模數轉換器設計研究 8位電流模模數轉換器設計研究

    標簽: 8位 電流模 模數轉換器

    上傳時間: 2013-06-21

    上傳用戶:kaixinxin196

  • 基于FPGA的JPEG編解碼芯片設計

    近年來,隨著微電子技術的高速發展,數字圖像壓縮編碼技術的逐漸成熟,實時圖象處理在多媒體、HDTV、圖像通信等領域有著越來越廣泛的應用,圖像壓縮/解壓的IC芯片也已成為多媒體技術的核心,實現這些算法芯片的研究成為信息產業的新熱點.該文基于FPGA設計了JPEG圖像壓縮編解碼芯片,通過改進算法優化結構,在合理地利用硬件資源的條件下,有效地挖掘出算法內在的并行性.在JPEG編碼器設計中,改進了JEONG的DCT變換算法,采用流水線優化算法解決時間并行性問題,提高了DCT/IDCT模塊的運算速度;設計了基于查找表結構的定點乘法器,便于在設計中共享乘法單元,以適應流水線設計的要求;依據Huffman編碼表的規律性,采用并行查找表結構,用較少的存儲單元完成Huffman編解碼的運算,同時也提高了編解碼速度.在JPEG解碼器設計中,根據Huffman碼字本身的特點和JPEG標準,設計了一種Huffman碼字分組結構,基于該結構提出分組Huffman查找表及地址編碼的設計方法,進而完成了新的快速Huffman解碼算法及其模塊設計.整個設計及其各個模塊都在ALTERA公司的EDA工具QUARTUSII平臺上進行了邏輯綜合及功能和時序仿真.綜合和仿真結果表明,基于FPGA的JPEG圖像編解碼芯片消耗很少的FPGA硬件資源,達到了較高的工作頻率,在速度和資源利用率方面均達到了較優的狀態,可滿足實時JPEG圖像編解碼的要求.在邏輯設計的基礎上,該設計可以進一步作硬件仿真和實驗,將源代碼燒錄進FPGA芯片,作為獨立器件或有自主知識產權的JPEG IP模塊,應用于可視電話、手機和會議電視等低成本JPEG編解碼系統的實現.

    標簽: FPGA JPEG 編解碼 芯片設計

    上傳時間: 2013-05-31

    上傳用戶:yuying4000

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