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  • (臺達)開關電源基本原理與設計介紹

    (臺達)開關電源基本原理與設計介紹,比較實用

    標簽: 開關電源

    上傳時間: 2013-06-15

    上傳用戶:ybysp008

  • 單電源運放的偏置原因分析與偏置方法.doc

    介紹了單電源運放為什么需要加偏置電源,以及試驗單電源運放的注意事項。

    標簽: 單電源 運放

    上傳時間: 2013-07-29

    上傳用戶:kgylah

  • LM3S系列ADC例程內置的溫度傳感器

    LM3S系列ADC例程:內置的溫度傳感器

    標簽: LM3S ADC 內置 溫度傳感器

    上傳時間: 2013-04-24

    上傳用戶:qunquan

  • 用FPGA設計數字系統

    用FPGA設計數字系統,2007年上海FPGA研修班王巍老師講義

    標簽: FPGA 數字系統

    上傳時間: 2013-08-16

    上傳用戶:duoshen1989

  • FPGA可促進嵌入式系統設計改善即時應用性能

    FPGA可促進嵌入式系統設計改善即時應用性能,臺灣人寫的,關于FPGA應用的技術文章

    標簽: FPGA 嵌入式 系統 性能

    上傳時間: 2013-08-20

    上傳用戶:liuwei6419

  • iSensor IMU快速入門指南和偏置優化技巧

    iSensor IMU快速入門指南和偏置優化技巧

    標簽: iSensor IMU 快速入門

    上傳時間: 2014-12-23

    上傳用戶:小草123

  • AW5007_CN_V0.95_EZ-FM內置FM天線的低噪聲放大器

    AW5007_CN_V0.95_EZ-FM內置FM天線的低噪聲放_大器

    標簽: EZ-FM 5007 0.95 CN_V

    上傳時間: 2014-01-14

    上傳用戶:xiaowei314

  • CMOS工藝下高擺幅共源共柵偏置電路

    共源共柵級放大器可提供較高的輸出阻抗和減少米勒效應,在放大器領域有很多的應用。本文提出一種COMS工藝下簡單的高擺幅共源共柵偏置電路,且能應用于任意電流密度。根據飽和電壓和共源共柵級電流密度的定義,本文提出器件寬長比與輸出電壓擺幅的關系,并設計一種高擺幅的共源共柵級偏置電路。

    標簽: CMOS 工藝 共源共柵 偏置電路

    上傳時間: 2013-10-08

    上傳用戶:debuchangshi

  • BGA焊球重置工藝

    BGA焊球重置工藝

    標簽: BGA 焊球重置 工藝

    上傳時間: 2013-11-01

    上傳用戶:avensy

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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