基于Verilog-HDL的硬件電路的實(shí)現(xiàn) 9.5 脈沖周期的測(cè)量與顯示 9.5.1 脈沖周期的測(cè)量原理 9.5.2 周期計(jì)的工作原理 9.5.3 周期測(cè)量模塊的設(shè)計(jì)與實(shí)現(xiàn) 9.5.4 forever循環(huán)語(yǔ)句的使用方法 9.5.5 disable禁止語(yǔ)句的使用方法 9.5.6 時(shí)標(biāo)信號(hào)發(fā)生模塊的設(shè)計(jì)與實(shí)現(xiàn) 9.5.7 周期計(jì)的Verilog-HDL描述 9.5.8 周期計(jì)的硬件實(shí)現(xiàn) 9.5.9 周期測(cè)量模塊的設(shè)計(jì)與實(shí)現(xiàn)之二 9.5.10 改進(jìn)型周期計(jì)的Verilog-HDL描述 9.5.11 改進(jìn)型周期計(jì)的硬件實(shí)現(xiàn) 9.5.12 兩種周期計(jì)的對(duì)比
標(biāo)簽： Verilog-HDL 周期 9.5 脈沖
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基于Verilog-HDL的硬件電路的實(shí)現(xiàn) 9.6 脈沖高電平和低電平持續(xù)時(shí)間的測(cè)量與顯示 9.6.1 脈沖高電平和低電平持續(xù)時(shí)間測(cè)量的工作原理 9.6.2 高低電平持續(xù)時(shí)間測(cè)量模塊的設(shè)計(jì)與實(shí)現(xiàn) 9.6.3 改進(jìn)型高低電平持續(xù)時(shí)間測(cè)量模塊的設(shè)計(jì)與實(shí)現(xiàn) 9.6.4 begin聲明語(yǔ)句的使用方法 9.6.5 initial語(yǔ)句和always語(yǔ)句的使用方法 9.6.6 時(shí)標(biāo)信號(hào)發(fā)生模塊的設(shè)計(jì)與實(shí)現(xiàn) 9.6.7 脈沖高低電平持續(xù)時(shí)間測(cè)量的Verilog-HDL描述 9.6.8 脈沖高低電平持續(xù)時(shí)間測(cè)量的硬件實(shí)現(xiàn)
標(biāo)簽： Verilog-HDL 低電平 9.6 時(shí)間測(cè)量
上傳時(shí)間： 2013-11-30
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基于Verilog-HDL的硬件電路的實(shí)現(xiàn) 9.7 步進(jìn)電機(jī)的控制 9.7.1 步進(jìn)電機(jī)驅(qū)動(dòng)的邏輯符號(hào) 9.7.2 步進(jìn)電機(jī)驅(qū)動(dòng)的時(shí)序圖 9.7.3 步進(jìn)電機(jī)驅(qū)動(dòng)的邏輯框圖 9.7.4 計(jì)數(shù)模塊的設(shè)計(jì)與實(shí)現(xiàn) 9.7.5 譯碼模塊的設(shè)計(jì)與實(shí)現(xiàn) 9.7.6 步進(jìn)電機(jī)驅(qū)動(dòng)的Verilog-HDL描述 9.7.7 編譯指令-"宏替換`define"的使用方法 9.7.8 編譯指令-"時(shí)間尺度`timescale"的使用方法 9.7.9 系統(tǒng)任務(wù)-"$finish"的使用方法 9.7.10 步進(jìn)電機(jī)驅(qū)動(dòng)的硬件實(shí)現(xiàn)
標(biāo)簽： Verilog-HDL 步進(jìn)電機(jī)驅(qū)動(dòng) 9.7 硬件電路
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基于Verilog-HDL的硬件電路的實(shí)現(xiàn) 9.8 基于256點(diǎn)陣的漢字顯示 9.8.1 單個(gè)靜止?jié)h字顯示的設(shè)計(jì)原理及其仿真實(shí)現(xiàn) 9.8.2 單個(gè)靜止?jié)h字顯示的硬件實(shí)現(xiàn) 9.8.3 多個(gè)靜止?jié)h字顯示的設(shè)計(jì)原理及其硬件實(shí)現(xiàn) 9.8.4 單個(gè)運(yùn)動(dòng)漢字顯示的設(shè)計(jì)原理及其硬件實(shí)現(xiàn) 9.8.5 多個(gè)運(yùn)動(dòng)漢字顯示的設(shè)計(jì)原理及其硬件實(shí)現(xiàn)
標(biāo)簽： Verilog-HDL 漢字顯示 9.8 256
上傳時(shí)間： 2013-12-31
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利用LMS算法仿真了各種線性預(yù)測(cè)濾波器,并證明的該算法效率很高,能節(jié)省硬件資源.
上傳時(shí)間： 2013-12-21
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利用最陡下降法仿真實(shí)現(xiàn)了自適應(yīng)濾波均衡器,該方法用硬件能方便實(shí)現(xiàn).
標(biāo)簽： 仿真實(shí)現(xiàn) 自適應(yīng)濾波 均衡器 硬件
上傳時(shí)間： 2015-09-16
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本文分別以GPI0口直接連接、串并轉(zhuǎn)換連接、CPLD分部連接三種方法闡述了無(wú)外部總線的Philips ARM微控制器LPC2l0X與點(diǎn)陣圖形液晶顯示器的接口設(shè)計(jì),并給出了硬件電路框圖和主要程序。
標(biāo)簽： Philips LPC2l0X GPI0 CPLD
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硬件平臺(tái)為Xilinx Spartan3e，編譯軟件為ISE8.1，實(shí)現(xiàn)了九針com口通信，鍵盤(pán)輸入回顯，switch控制LED功能。
標(biāo)簽： Spartan3e Xilinx 硬件平臺(tái)
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數(shù)字萬(wàn)年歷”的軟件和硬件設(shè)計(jì) 軟件環(huán)境：KEIL C集成環(huán)境，編程語(yǔ)言為C語(yǔ)言 硬件環(huán)境：PROTEL 99，所用硬件主要為AT89S52，液晶，按鍵等
標(biāo)簽： KEIL 數(shù)字萬(wàn)年歷 軟件 硬件設(shè)計(jì)
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JPEG靜止圖像壓縮解壓縮標(biāo)準(zhǔn)的硬件實(shí)現(xiàn)及其改進(jìn)算法的研究 這是本人做圖像壓縮時(shí)收藏的一個(gè)比較經(jīng)典的碩士論文，希望對(duì)大家有參考價(jià)值
標(biāo)簽： JPEG 圖像壓縮 解壓 標(biāo)準(zhǔn)
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